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- 梧 凤
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1 1 SIMATIC S7-300 S7-400 STL A B
2 SIMAT IC SIMATIC HMI SIMATIC NET
3
4 STL STL MS Windows 2000 Professional MS Windows XP Professional PC STEP STL IEC STEP 7 NORM_TBL.WRI iii
5 STEP 7 S7 STEP 7 STEP 7 STEP 7 STEP 7 STEP 7 STEP 7 V5.3 S7-300/400 STEP 7 V5.3 STEP 7 V5.3 S5 S7 STEP 7 S7-300/400 LAD / FBD / STL S7-300/400 LAD FBD STL STEP 7 6ES7810-4CA07-8BW0 6ES7810-4CA06-8BW1 STEP 7 STL/LAD/FBD / SFB / SFC STEP 7 STEP 7 STEP 7 iv
6 F1 Help > Context-Sensitive Help Help > Contents Help on STEP 7 STEP 7 Glossary STEP 7 SIMATIC S7 D (911) (010) (021) (020) (027) (0451) (023) v
7 A&D (0) (0) GMT +1:00 / 08:00:00-17: (0) (0) adsupport@siemens.com GMT +1:00 08:00:00-17:00 +1 (0) (0) isd-callcenter@sea. siemens.com GMT -5:00 SIMAT IC / 8:30-17: adsupport.asia@siemens.com GMT +8:00 vi
8 () () (010) (0411) (021) (020) (028) vii
9 viii
10 ...iii..ix A AN O ON X XN O A( AN( O( ON( X( XN( ) = R S NOT RLO SET RLO = CLR RLO = SAVE RLO BR FN FP ? I ? D ? R BTI BCD ITB 16 BCD BTD BCD ix
11 3.5 ITD DTB 32 BCD DTR IEEE-FP INVI INVD NEGI NEGD NEGR 32 IEEE-FP CAW CAD RND TRUNC RND RND FR L LC BCD R S CU CD OPN CDB L DBLG L DBNO L DILG L DINO JU JL JC RLO = JCN RLO = JCB RLO = 1 BR JNB RLO = 0 BR JBI BR = JNBI BR = JO OV = x
12 6.11 JOS OS = JZ JN JP JM JPZ JMZ JUO LOOP I (16 ) I (16 ) *I (16 ) /I (16 ) D (32 ) D (32 ) *D (32 ) /D (32 ) MOD R (32 IEEE-FP) R (32 IEEE-FP) *R (32 IEEE-FP) /R (32 IEEE-FP) ABS 32 IEEE-FP SQR SQRT EXP LN SIN COS TAN ASIN ACOS ATAN xi
13 L L STW LAR LAR1 <D> (32 ) LAR1 AR LAR LAR2 <D>(32 ) T T STW CAR TAR TAR1 <D> 1 (32 ) TAR1 AR TAR TAR2 <D> 2 (32 ) BE BEC BEU CALL CC UC MCR MCR MCR( RLO MCR MCR )MCR MCR MCRA MCR MCRD MCR SSI SSD xii
14 SLW SRW SLD SRD RLD RRD RLDA CC RRDA CC FR L LC BCD R SP SE SD SS SF AW OW XOW AD OD XOD TAK POP CPU POP CPU PUSH CPU PUSH CPU ENT LEAVE INC DEC AR xiii
15 AR BLD NOP NOP A A-1 A.1... A-1 A.2... A-6 B.B-1 B.1... B-1 B.2... B-2 B.3... B-5 B.4... B-8 B.5...B-10 B.6...B-11 xiv
16 RLO A AN O ON X XN O A( AN( O( ON( X( XN( ) 1-1
17 = R S RLO NOT RLO SET RLO =1 CLR RLO =0 SAVE RLO BR FN FP 1-2
18 1.2 A A < > < > BOOL I Q M L D T C 1 RLO ==0 <>0 >0 <0 >=0 <=0 OV OS UO BR x x x 1 A I 1.0 I A I 1.1 I = Q 4.0 Q
19 1.3 AN N < > < > BOOL I Q M L D T C 0 RLO ==0 <>0 >0 <0 >=0 <=0 OV OS UO BR x x x 1 A I 1.0 I AN I 1.1 I = Q 4.0 Q
20 1.4 O O < > < > BOOL I Q M L D T C 1 RLO ==0 <>0 >0 <0 >=0 <=0 OV OS UO BR x x
21 1.5 ON ON < > < > BOOL I Q M L D T C 0 RLO ==0 <>0 >0 <0 >=0 <=0 OV OS UO BR x x 1 O I 1.0 I I O I 1.1 = Q 4.0 Q
22 1.6 X X < > < > BOOL I Q M L D T C 1 RLO 1 1 ==0 <>0 >0 <0 >=0 <=0 OV OS UO BR x x 1 1-7
23 1.7 XN XN < > < > BOOL I Q M L D T C 0 RLO ==0 <>0 >0 <0 >=0 <=0 OV OS UO BR x x 1 1-8
24 1.8 O O O OR AND x 1 - x 1-9
25 1.9 A( A( A( RLO OR
26 1.10 AN( AN( AN( RLO OR O( O( O( RLO OR
27 1.12 ON( ON( ON( RLO OR X( X( X( RLO OR
28 1.14 XN( XN( XN( RLO OR
29 1.15 ) ) ) OR RLO RLO RLO ANDAND NOT OR U( UN( O( ON( X( XN( x 1 x
30 1.16 = < > < > BOOL I Q M L D MCR = 1= < > RLO MCR = 00 RLO x
31 1.17 R R < > < > BOOL I Q M L D RLO = 1 MCR = 1 R 0 MCR = x
32 1.18 S S < > < > BOOL I Q M L D RLO = 1 MCR = 1 S 1 MCR = x
33 1.19 NOT RLO NOT NOT RLO x SET RLO =1 SET RLO SET RLO RLO 1-18
34 1.21 CLR RLO =0 CLR RLO CLR RLO RLO 1-19
35 1.22 SAVE RLO BR SAVE SAVE RLO BR /FC BR AND SAVE BR BR SAVE ENO = BR RLO x
36 1.23 FN FN < > < > BOOL I Q M L D RLO RLO FN < > RLO 10 RLO = 1 RLO RLO < > RLO 1 RLO x x
37 RLO 1 0 I 1.0 OB1 Q 4.0 OB1 1-22
38 1.24 FP FP < > < > BOOL I Q M L D RLO RLO FP < > RLO 01 RLO = 1 RLO RLO < > RLO 0 RLO x x
39 RLO 1 0 I 1.0 OB1 Q 4.0 OB1 1-24
40 ACCU1 2 ACCU2 == 1 2 <> 1 2 > 1 2 < 1 2 >= 1 2 <= 1 2 RLO 1 CC 1 CC 0? I 16? D 32? R
41 2.2? I 16 ==I <>I >I <I >=I <=I RLO RLO = 1 RLO = 0 CC 1 CC 0 - x x 0-0 x x 1 RLO ACCU 2 > ACCU 1 RLO ACCU 2 = ACCU 1 RLO ==I <> I >I <I >=I <=I ACCU 2 < ACCU 1 RLO L MW10 L IW24 >I = M 2.0 // MW10 16 // IW24 16 // 2 MW10 1 IW24 // MW10 > IW24 RLO = 1 2-2
42 2.3? D 32 ==D <>D >D <D >=D <=D RLO RLO = 1 RLO = 0 CC 1 CC 0 - x x 0-0 x x 1 RLO ACCU 2 > ACCU 1 RLO ACCU 2 = ACCU 1 RLO ==D <>D >D <D >=D <=D ACCU 2 < ACCU 1 RLO L MD10 L ID24 >D = M 2.0 // MD10 32 // ID24 32 // 2 MD10 1 ID24 // MD10 > ID24 RLO = 1 2-3
43 2.4? R 32 ==R <>R >R <R >=R <=R 32 IEEE-FP IEEE-FP RLO RLO = 1 RLO = 0 CC 1 CC 0 - x x x x 0 x x 1 RLO ACCU 2 > ACCU 1 RLO ACCU 2 = ACCU 1 RLO ==R <>R >R <R >=R <=R ACCU 2 < ACCU 1 RLO L MD10 L 1.359E+02 >R = M 2.0 // MD10 // 1.359E+02 // 2 MD E+02 // MD10 > 1.359E+02 RLO = 1 2-4
44 3 3.1 BCD BTI BCD 16 ITB 16 BCD BTD BCD 32 ITD DTB 32 BCD DTR IEEE-FP INVI 16 INVD 32 NEGI 16 NEGD 32 NEGR 32 IEEE-FP 1 1 CAW 1 16 CAD IEEE 32 RND TRUNC RND+ RND- 3-1
45 3.2 BTI BCD 16 BTI BTI 3 BCD 1 3 BCD BCD BCD BCD 15 BCD 0 = 1= BCD BCDF CPU STOP OB L BTI T MW10 MW20 // BCD 1 // BCD 1 // MW20 "+915" BCD BCD "+915" 3-2
46 3.3 ITB 16 BCD ITB ITB BCD BCD BCD 0000 = 1111= 1 2 BCD OV OS 1 RLO RLO x x L ITB T MW10 MW20 // 1 // BCD 16 1 // BCD MW20 "-413" BCD "-413" BCD 3-3
47 3.4 BTD BCD 32 BTD BTD 7 BCD 1 7 BCD BCD BCD -9,999, ,999, BCD 31 BCD 0 = 1= BCD BCD BCDF CPU STOP OB L MD10 BTD T MD20 // BCD 1 // BCD 1 // MD20 BCD " " " " 3-4
48 3.5 ITD ITD ITD L ITD T MW12 MD20 // 1 // // MD20 MW12 = ITD XXXX XXXX XXXX XXXX ITD X =
49 3.6 DTB 32 BCD DTB DTB BCD BCD BCD 0000 = 1111= 2 BCD -9,999,999 +9,999,999 OV OS x x L MD10 DTB T MD20 // 32 1 // 32 BCD 1 // BCD MD20 BCD "-701" "-701" BCD 3-6
50 3.7 DTR IEEE-FP DTR DTR IEEE IEEE L MD10 DTR T MD20 // 32 1 // 32 IEEE FP 1 // BCD MD20 32 IEEE 32 "+500" "+500" IEE-FP 3-7
51 3.8 INVI 16 INVI INVI L IW8 INVI T MW10 // 1 // 16 // MW INVI INVI
52 3.9 INVD 32 INVD INVD L ID8 INVD T MD10 // 1 // 32 // MD INVD INVD
53 3.10 NEGI 16 NEGI NEGI CC 1 CC 0 OS OV - x x x x CC 1 CC 0 OV OS = = L IW8 NEGI T MW10 // 1 // 16 // MW NEGI BEGI
54 3.11 NEGD 32 NEGD NEGD RLO RLO CC 1 CC 0 OS OV - x x x x CC 1 CC 0 OV OS = ,147,483, ,147,483, = 2,147,483, L ID8 NEGD T MD10 // 1 // 32 // MD NEGD ITD X =
55 3.12 NEGR 32 IEEE-FP NEGR NEGR 32 IEEE 1 32 IEEE-FP L ID8 NEGR T MD10 // 1 ID 8 = 1.5E+02 // 32 IEEE FP 1 // MD10 = -1.5E
56 3.13 CAW 1 16 CAW CAW L MW10 CAW T MW20 // MW10 1 // 1 // MW CAW A B C D CAW A B D C
57 3.14 CAD 1 32 CAD CAD L MD10 CAD T MD20 // MD10 1 // 1 // MD CAD A B C D CAD D C B A
58 3.15 RND RND RND 32 IEEE IEEE 32 IEEE-FP 32 IEEE 32 OV OS 1 1 NaN x x L MD10 RND T MD20 // 1 // 32 IEEE FP // MD20 MD10 = "100.5" => RND => MD20 = "+100" MD10 = "-100.5" => RND => MD20 = "-100" 3-15
59 3.16 TRUNC TRUNC TRUNC 32 IEEE IEEE 32 IEEE 32 IEEE OV OS 1 1 NaN x x L MD10 TRUNC T MD20 // 1 // 32 IEEE-FP 32 1 // MD20 MD10 = "100.5" => TRUNC => MD20 = "+100" MD10 = "-100.5" => TRUNC => MD20 = "-100" 3-16
60 3.17 RND+ RND+ RND+ 32 IEEE IEEE 32 IEEE 32 IEEE OV OS 1 1 NaN x x L MD10 RND+ T MD20 // 32 IEEE-FP 1 // 32 IEEE FP 32 1 // MD20 MD10 = "100.5" => RND+ => MD20 = "+101" MD10 = "-100.5" => RND+ => MD20 = "-100" 3-17
61 3.18 RND- RND- RND- 32 IEEE IEEE 32 IEEE 32 IEEE OV OS 1 1 NaN x x L MD10 RND- T MD20 // 1 // 32 IEEE FP 32 1 // MD20 MD10 = "100.5" => RND- => MD20 = "+100" MD10 = "-100.5" => RND- => MD20 = "-101" 3-18
62 4 4.1 STEP 7 CPU CPU CPU FR L 1 LC BCD 1 R S CU CD 4-1
63 4.2 FR FR < > < > COUNTER C CPU RLO 01 RLO A I 2.0 FR C3 // I 2.0 // RLO 01 C3 4-2
64 4.3 L 1 L < > < > COUNTER C CPU L C3 // C3 1 C L C3 L C
65 4.4 LC BCD 1 LC < > < > COUNTER C CPU 1 2 BCD LC C3 // C3 BCD 1 C LC Z3 LC C BCD 4-4
66 4.5 R R < > < > COUNTER C CPU RLO= A I 2.3 R C3 // I 2.3 // RLO 01 C
67 4.6 S S < > < > COUNTER C CPU RLO BCD A I 2.3 L C#3 S C1 // I 2.3 // 3 1 // RLO 01 C1 4-6
68 4.7 CU CU < > < > COUNTER C CPU RLO RLO OV A I 2.1 CU C3 // I 2.1 // RLO 01 C
69 4.8 CD CD < > < > COUNTER C CPU RLO RLO L C#14 A I.1 S C1 A I 0.0 CD C1 AN C1 = Q.0 // // I 0.1 // 1 // I 0.0 // I 0. 0 RLO 01 C1 1 // C1 0 // 1 0 Q 0.0 = 1 4-8
70 5 5.1 OPN OPN CDB L DBLG 1 L DBNO 1 L DILG 1 L DINO 1 5-1
71 5.2 OPN OPN < > < > DB DI OPN DB10 L DBW35 T MW22 OPN DI20 L DIB12 T DBB37 // DB10 // 35 1 // 1 MW22 // DB20 // 12 1 //
72 5.3 CDB CDB L DBLG 1 L DBLG OPN DB10 L DBLG L MD10 <D JC ERRO // DB10 // DB10 // // MD10 ERRO 5-3
73 5.5 L DBNO 1 L DBNO L DILG 1 L DILG OPN D120 L DILG L MW10 <1 JC // DB20 // DB20 // // MW10 ERRO 5-4
74 5.7 L DINO 1 L DINO
75 5-6
76 6 6.1 LOOP 4 : S7-300 CPU JU JL RLO JC RLO = 1 JCN RLO = 0 JCB RLO = 1 BR JNB RLO = 0BR 6-1
77 JBI BR = 1 JNBI BR = 0 JO OV = 1 JOS OS = 1 JZ JN JP JM JPZ JMZ JUO 6-2
78 6.2 JU JU <> <> A I 1.0 A I 1.2 JCDELE L MB10 INC 1 T MB10 JUFORW DELE: L 0 T MB10 FORW: A I 2.1 // RLO=1 DELE // FORW // FORW 6-3
79 6.3 JL JL <> <> 255 JU JL JL JU 1 0 JU 1 1 JU JL JU JL JU L MB0 JL LSTX JU SEG0 JU SEG1 JU COMM JU SEG3 LSTX: JU COMM SEG0: * JU COMM SEG1: * JU COMM SEG3: * JU COMM COMM: * // 1 // 1 3 // 1 0 // 1 1 // 1 2 // 1 3 // // // 6-4
80 6.4 JC RLO = 1 JC <> <> RLO A I 1.0 A I 1.2 JC JOVR L IW8 T MW22 JOVR: A I 2.1 // RLO=1 JOVR // // JOVR 6-5
81 6.5 JCN RLO = 0 JCN <> <> A I 1.0 A I 1.2 JCN JOVR L IW8 T MW22 JOVR: A I 2.1 // RLO = 0 JOVR // // JOVR 6-6
82 6.6 JCB RLO = 1BR JCB <> <> RLO 1 RLO BR RLO x A I 1.0 A I 1.2 JCB JOVR L IW8 T MW22 JOVR: A I 2.1 // RLO=1 JOVR RLO BR // // JOVR 6-7
83 6.7 JNB RLO = 0BR JNB <> <> RLO 1 RLO BR RLO x A I 1.0 A I 1.2 JNB JOVR L IW8 T MW22 JOVR: A I 2.1 // RLO=0 JOVR RLO BR // // JOVR 6-8
84 6.8 JBI BR = 1 JBI <> <> BR 1 4 :
85 6.9 JNBI BR = 0 JNBI <> <> BR
86 6.10 JO OV = 1 JO <> <> OV JOS L MW10 L 3 *I JO OVER T MW10 A M 4.0 R M 4.0 JU NEXT OVER: AN M 4.0 S M 4.0 NEXT: NOP 0 // MW10 3 // OV=1 // // OVER // NEXT 6-11
87 6.11 JOS OS = 1 JOS <> <> OS L IW10 L MW12 *I L DBW25 +I L MW14 -I JOS OVER T MW16 A M 4.0 R M 4.0 JU NEXT OVER: AN M 4.0 S M 4.0 NEXT: NOP 0 // OS=1 // // OVER // NEXT JO JO -I 6-12
88 6.12 JZ JZ <> <> CC 1 = 0 CC 0 = L MW10 SRW 1 JZ ZERO L MW2 INC 1 T MW2 JU NEXT ZERO: L MW4 INC 1 T MW4 NEXT: NOP 0 // = 0 ZERO // // ZERO // NEXT 6-13
89 6.13 JN JN <> <> CC 1 CC 0 CC 1=0/CC 0=1 CC 1=1/CC 0= L IW8 L MW12 XOW JN NOZE AN M 4.0 S M 4.0 JU NEXT NOZE: AN M 4.1 S M 4.1 NEXT: NOP 0 // 1 0 // // NOZE // NEXT 6-14
90 6.14 JP JP <> <> CC 1 = 1 CC 0 = L IW8 L MW12 -I JP POS AN M 4.0 S M 4.0 JUNEXT POS: AN M 4.1 S M 4.1 NEXT: NOP 0 // IW8 MW12 // >0 1 0 // // POS // NEXT 6-15
91 6.15 JM JM <> <> CC 1 = 0 CC 0 = L IW8 L MW12 -I JM NEG AN M 4.0 S M 4.0 JU NEXT NEG: AN M4.1 S M4.1 NEXT: NOP 0 // IW8 MW12 // < // // NEG // NEXT 6-16
92 6.16 JPZ JPZ <> <> CC 1 CC 0 CC 1=0/CC 0=0 CC 1=1/CC 0= L IW8 L MW12 -I JPZ REG0 AN M 4.0 S M 4.0 JU NEXT REG0: AN M 4.1 S M 4.1 NEXT: NOP 0 // IW8 MW12 // // // REG0 // NEXT 6-17
93 6.17 JMZ JMZ <> <> CC 1 CC 0 CC 1=0/CC 0=0 CC 1=0/CC 0= L IW8 L MW12 -I JMZ RGE0 AN M 4.0 S M 4.0 JU NEXT RGE0: AN M 4.1 S M 4.1 NEXT: NOP 0 // IW8 MW12 // // // RGE0 // NEXT 6-18
94 6.18 JUO JUO <> <> CC 1 = 1 CC 0 = CC 1 = 1 CC 0 = L MD10 L ID2 /D JUO ERRO T MD14 A M 4.0 R M 4.0 JU NEXT ERRO: AN M 4.0 S M 4.0 NEXT: NOP 0 // MD10 ID2 // ID2 = 0 // // ERRO // NEXT 6-19
95 6.19 LOOP LOOP <> <> L L#1 T MD20 L 5 NEXT: T MW10 L MD20 * D T MD20 L MW10 LOOP NEXT L MW24 L 200 >I // 32 1 // 1 MD20 // 1 // = / 1 // MD20 MB10 // MD20 // 1 // NEXT // 6-20
96 CPU I I *I /I D D *D /D MOD
97 7.2 CC1 CC0 OV OS CC 1 CC 0 OV OS * < * < > > 0 * OS * CC 1 CC 0 OV OS 16 = = < < > > > > < < CC 1 CC 0 OV OS +D = /D MOD
98 7.3 +I (16 ) 12 +I 16 +I RLO RLO CC 1 CC 0 OS OV / CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < > = > < L IW10 // IW10 1 L MW14 // 1 2 MW14 +I T DB1.DBW25 1 // // 1 DB1 DBW25 7-3
99 7.4 I (16 ) 2 1 -I 16 -I RLO RLO CC 1 CC 0 OS OV / CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < > > < L IW10 // IW10 1 L MW14 // 1 2 MW14 -I T DB1.DBW25 1 // // 1 DB1 DBW25 7-4
100 7.5 *I (16 ) 12 *I 16 *I OV1 = 1 OS = 1 16 RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < > > < L L *I T IW10 MW14 DB1.DBD25 // IW10 1 // 1 2 MW14 1 // // 1 DB1 DBW25 7-5
101 7.6 /I (16 ) 21 /I 16 /I RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < = L L /I T IW10 MW14 MD20 // IW10 1 // 1 2 MW14 1 // // 1 MD IW10 "13" 1 MW14 "4" /I 2 / 1 "13/4" 1 "3" 1 "1" 7-6
102 <> <> <> 1 1 CPU 2 4 CPU <16 > <32 > ,147,483, ,147,483, L L +I IW10 MW T DB1.DBW25 // IW10 1 // 1 2 MW14 1 // // // 1 DB1 DBW25 7-7
103 2 L IW12 L IW >I JC NEXT // // 2 1 IW12 > IW // NEXT 3 L MD20 L MD24 +D + L#-200 T MD28 // //
104 7.8 +D (32 ) 12 +D 32 +D RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < > = > < L L +D T ID10 MD14 DB1.DBD25 // ID10 1 // 1 2 MD14 1 // // 1 DB1 DBD25 7-9
105 7.9 D (32 )2 1 -D 32 -D RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < > > < L L -D T ID10 MD14 DB1.DBD25 // ID10 1 // 1 2 MD14 1 // // 1 DB1 DBD
106 7.10 *D (32 ) 12 *D 32 *D OV1 = 1 OS = 1 32 RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < > > < L L *D T ID10 MD14 DB1.DBD25 // ID10 1 // 1 2 MD14 1 // // 1 DB1 DBD
107 7.11 /D (32 )21 /D 32 /D MOD RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < > = L L /D T ID10 MD14 MD20 // ID10 1 // 1 2 MD14 1 // // 1 MD ID10 "13" 1 MD14 "4" /D 2 / 1 "13/4" 1 "3" 7-12
108 7.12 MOD 32 MOD MOD /D RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < >
109 L ID10 L MD14 MOD T MD20 // ID10 1 // 1 2 MD14 1 // // 1 MD ID10 "13" 1 MD14 "4" MOD 2 / 1 "13/4" 1 "1" 7-14
110 CPU IEEE 32 REAL 32 IEEE +R 1 2 -R 2 1 *R 1 2 /R IEEE ABS SQR SQRT EXP LN SIN COS TAN ASIN ACOS ATAN 8-1
111 8.2 CC 1 CC 0 OV OS 32 CC 1 CC 0 OV OS * E+38 < < E * E-38 < < E * * OS CC 1 CC 0 OV OS E-38 < < E E-45 < < E-38 < E+38 > E
112 R (32IEEE-FP) 12 +R 32 IEEE +R IEEE RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero zero denormalized normalized infinite qnan x x x x
113 OPN DB10 L ID10 L MD14 +R T DBD25 // ID10 1 // 1 2 MD14 1 // // 1 DB10 DBD R (32IEEE-FP) 2 1 -R 32 IEEE -R IEEE RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero zero denormalized normalized infinite qnan
114 - x x x x OPN DB10 L ID10 L MD14 -R T DBD25 // ID10 1 // 1 2 MD14 1 // // 1 DB10 DBD *R (32IEEE-FP) 12 *R 32 IEEE *R IEEE 32 IEEE 1 RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero zero denormalized normalized infinite qnan
115 - x x x x OPN DB10 L ID10 L MD14 *R T DBD25 // ID10 1 // 1 2 MD14 1 // // 1 DB10 DBD /R (32IEEE-FP)21 /R 32 IEEE /R IEEE 32 IEEE 1 RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero zero denormalized normalized infinite qnan
116 - x x x x OPN DB10 L ID10 L MD14 /R T DBD20 // ID10 1 // 1 2 MD14 1 // // 1 DB10 DBD ABS 32 IEEE-FP ABS ABS 32 IEEE 1 32 IEEE-FP L ID8 ABS T MD10 // 1 ID8 = -1.5E+02 // 1 // MD10 = 1.5E
117 SQR 32 SQR SQR 32 IEEE 1 32 IEEE-FP 1 CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero qnan OPN DB17 L DBD0 SQR AN OV JC OK BEU OK: T DBD4 // DB17 // DBD0 1 // 1 32 IEEE FP 1 // OV 0 // SQR OK // SQR // 1 DBD4 8-8
118 8.4.2 SQRT 32 SQRT SQRT 32 IEEE 1 32 IEEE-FP CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero zero qnan L MD10 SQRT AN OV JC OK BEU OK: T MD20 // MD10 1 // 1 32 IEEE FP 1 // OV 0 // SQRT OK // SQRT // 1 MD20 8-9
119 8.4.3 EXP 32 EXP EXP 32 IEEE 1 32 IEEE-FP e 1 CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero qnan L MD10 EXP AN OV JC OK BEU OK: T MD20 // MD10 1 // 1 32 IEEE FP e 1 // OV 0 // EXP OK // EXP // 1 MD
120 8.4.4 LN 32 LN LN 32 IEEE 1 32 IEEE-FP 1 0 CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero zero denormalized normalized infinite qnan L MD10 LN AN OV JC OK BEU OK: T MD20 // MD10 1 // 1 (32 IEEE FP) 1 // OV 0 // OK // // 1 MD
121 8.4.5 SIN 32 SIN SIN 32 IEEE 1 1 CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan normalized denormalized zero zero denormalized normalized qnan L SIN T MD10 MD20 // MD10 1 // 1 32 IEEE FP 1 // 1 MD
122 8.4.6 COS 32 COS COS 32 IEEE 1 1 CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan normalized denormalized zero zero denormalized normalized qnan L MD10 COS T MD20 // MD10 1 // 1 32 IEEE FP 1 // 1 MD
123 8.4.7 TAN 32 TAN TAN 32 IEEE 1 1 CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero zero denormalized normalized infinite qnan L MD10 TAN AN OV JC OK BEU OK: T MD20 // MD10 1 // 1 32 IEEE FP 1 // OV 0 // TAN OK // TAN // 1 MD
124 8.4.8 ASIN 32 ASIN ASIN 32 IEEE / / 2 = CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan normalized denormalized zero zero denormalized normalized qnan L MD10 ASIN AN OV JC OK BEU OK: T MD20 // MD10 1 // 1 (32 IEEE FP) 1 // OV 0 // ASIN OK // ASIN // 1 MD
125 8.4.9 ACOS 32 ACOS ACOS 32 IEEE = CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan normalized denormalized zero zero denormalized normalized qnan L MD10 ACOS AN OV JC OK BEU OK: T MD20 // MD10 1 // 1 (32 IEEE FP) 1 // OV 0 // ACOS OK // ACOS // 1 MD
126 ATAN 32 ATAN ATAN 32 IEEE 1 - / / 2 = CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan normalized denormalized zero zero denormalized normalized qnan L MD10 ATAN AN OV JC OK BEU OK: T MD20 // MD10 1 // 1 (32 IEEE FP) 1 // OV 0 // ATAN OK // ATAN // 1 MD
127 8-18
128 9 9.1 L T CPU RLO L L STW 1 LAR1 AR2 2 1 LAR1 <D> 1 LAR1 1 1 LAR2 <D> 2 LAR2 2 1 T T STW 1 TAR1 AR2 1 2 TAR1 <D> 1 32 TAR2 <D> 2 32 TAR1 1 1 TAR2 2 1 CAR
129 9.2 L L <> <> BYTE WORD DWORD E A PE M L D L IB10 L MB120 L DBB12 L DIW15 L LD252 L P# I 8.7 L OTTO L P# ANNA 1 // IB10 1 // MB120 1 // DBB12 1 // DIW15 1 // LD252 1 // 1 // OTTO 1 // 1 AR XXXXXXXX XXXXXXXX XXXXXXXX XXXXXXXX L MB10 L <> <MB10> L MW10 L < > <MB10> <MB11> L MD10 L <> <MB10> <MB11> <MB12> <MB13> L P# ANNA L P# ANNA <86> < ANNA > AR2 <ANNA > X =
130 9.3 L STW 1 L STW L STW STW 1 S7-300 CPU L STW FC STA OR L STW // 1 L STW
131 9.4 LAR1 1 1 LAR AR
132 9.5 LAR1 <D> (32 ) 1 LAR1 <D> <D> DWORD D M L <D> AR LAR1 LAR1 LAR1 LAR1 DBD20 DID30 LD180 MD24 // DBD20 AR1 // DID30 AR1 // LD180 AR1 // MD24 AR1 LAR1 P#M100.0 // 32 AR1 9-5
133 9.6 LAR1 AR2 2 1 LAR1 AR2 AR2 LAR1 AR2 AR LAR2 1 2 LAR AR
134 9.8 LAR2 <D>(32 ) 2 LAR2 <D> <D> DWORD D M L <D> AR LAR2 DBD 20 LAR2 DID 30 LAR2 LD 180 LAR2 MD 24 // DBD20 AR2 // DID30 AR2 // LD180 AR2 // MD24 AR2 LAR2 P#M100.0 // 32 AR2 9-7
135 9.9 T T <> <> BYTE WORD DWORD I Q PQ M L D MCR = 1 1 MCR = I/O PQ 1 0 MCR = 0 Q T QB10 // 1 QB10 T MW14 // 1 MW14 T DBD2 // 1 DBD2 9-8
136 9.10 T STW 1 T STW T STW STW x x x x x x x x x T STW // *) * 9-9
137 9.11 CAR 1 2 CAR CAR AR1 AR2 AR1 AR2 AR2 AR TAR1 1 1 TAR1 AR
138 9.13 TAR1 <D>1 (32 ) TAR1 <D> <D> DWORD D M L AR1 <D> MD LD DBD DID TAR1 DBD20 // AR1 DBD20 TAR1 DID30 // AR1 DID30 TAR1 LD18 // AR1 LD18 TAR1 MD24 // AR1 MD
139 9.14 TAR1 AR2 1 2 TAR1 AR2 AR2 TAR1 AR1 AR TAR2 2 1 TAR2 AR
140 9.16 TAR2 <D>2 (32 ) TAR2 <D> <D> DWORD D M L AR2 <D> MD LD DBD DID TAR2 DBD20 // AR2 DBD20 TAR2 DID30 // AR2 DID30 TAR2 LD18 // AR2 LD18 TAR2 MD24 // AR2 MD
141 9-14
142 BE BEC BEU CALL CC UC MCR MCR MCR( RLO MCR MCR )MCR MCR MCRA MCR MCRD MCR 10-1
143 10.2 BE BE MCR RLO S5 S7 BEU A I 1.0 JC NEXT L IW4 T IW10 A I 6.0 A I 6.1 S M 12.0 BE NEXT: NOP 0 // RLO = 1 I 1.0 = 1 NEXT // // // 10-2
144 10.3 BEC BEC RLO = 1 MCR RLO (= 1) RLO = 0 RLO x A I 1.0 BEC L IW4 T MW10 // RLO // RLO = 1 // BEC RLO =
145 10.4 BEU BEU MCR RLO A I 1.0 JC NEXT L IW4 T IW10 A I 6.0 A I 6.1 S M 12.0 BEU NEXT: NOP 0 // RLO = 1 I 1.0 = 1 NEXT // // // 10-4
146 10.5 CALL CALL <> FCSFB SFC SFB FC SFC FB SFB RLO FB SFB SFB/SFC CALL FB1 DB1 CALL FILLVAT1 RECIPE1 FC CALL FCn SFC CALL SFCn FB CALL FBn1,DBn2 SFB CALL SFBn1,DBn2 STL Editor n n1 n2 10-5
147 FBSFB FC SFC IN OUT IN_OUT FC SFC FBSFB DB1 DBW2 IN OUT IN_OUT MA B MCR
148 1 FC6 CALL FC6 NO OF TOOL TIME OUT FOUND ERROR := MW100 := MW110 := Q 0.1 := Q SFC CALL SFC43 // SFC43 3 DB1 FB99 CALL FB99 DB1 MAX_RPM MIN_RPM MAX_POWER MAX_TEMP := #RPM1_MAX := #RPM1 := #POWER1 := #TEMP1 4 DB2 FB99 CALL FB99 DB2 MAX_RPM MIN_RPM MAX_POWER MAX_TEMP := #RPM2_MAX := #RPM2 := #POWER2 := #TEMP2 FBSFB DB1 DB2 10-7
149 10.6 CALL FB n1 DB n1 FB RLO IN OUT IN_OUT DB1 DBW2 IN OUT IN_OUT MA B MCR
150 1 DB1 FB99 CALL FB99 DB1 MAX_RPM MIN_RPM MAX_POWER MAX_TEMP := #RPM1_MAX := #RPM1 := #POWER1 := #TEMP1 2 DB2 FB99 CALL FB99 DB2 MAX_RPM MIN_RPM MAX_POWER MAX_TEMP := #RPM2_MAX := #RPM2 := #POWER2 := #TEMP2 FB DB1 DB
151 10.7 CALL FC n STL Editor n FC FC RLO IN OUT IN_OUT IN OUT IN_OUT MA B MCR 10-10
152 FC6 CALL FC6 NO OF TOOL TIME OUT FOUND ERROR := MW100 := MW110 := Q0.1 := Q
153 10.8 CALL SFB n1 DB n2 SFB SFB RLO IN OUT IN_OUT DB1 DBW2 IN OUT IN_OUT MA B MCR 10-12
154 CALL SFB4 DB4 IN: PT: Q: ET: I0.1 T#20s M0.0 MW10 SFB4 DB
155 10.9 CALL SFC n STL Editor n SFC SFC RLO IN OUT IN_OUT IN OUT IN_OUT MA B MCR SFC CALL SFC43 // SFC
156 10.10 CALL # x x x SIMATIC CPU Standard Library 10-15
157 10.12 CC CC <> RLO=1 FC FB CC CALL MA B MCR A I 2.0 CC FC6 A M 3.0 // I 2.0 // I FC6 // I 2.0 = 1 I 2.0 = 0 A I 2.0 CALL FBSFB CC Program Editor UC CC CALL 10-16
158 10.13 UC UC <> FC SFC UC CALL MA B MCR UC FC6 // FC6 2 UC SFC43 // SFC43 CALL FBSFB UC Program Editor UC CC CALL 10-17
159 10.14 MCR MCR MCR MCR MCR = < > S < > R < > T <> T < > T <> MCR 0 T 0 S R = 0 MCR MCR MCR = < > S < > R < > T <> T < > T <>
160 MCR( - MCR )MCR MCR MCR MCR MCR( RLO MCR )MCR 1 MCR( )MCR MCR( 8 MCR )MCR MCRF MCRA MCR MCRD MCR MCRA MCRD MCRA MCRD MCR MCRA-MCRD MCR MCRA FCFB MCR 10-19
161 10.15 MCR MCRA MCR MCR( )MCR T = 0 MCR( RLO = 0 MCR PLC STOP VAR_TEMP PLC STOP STRUCT UDT ARRAY STRING FC 2 IN_OUT STRUCT UDT ARRAY STRING FB BLOCK_DB DB0 CPU STOPT 0 C 0 FC0 FB0 TIMER COUNTER BLOCK_FC BLOCK_FB LAD/FBD FBD T RLO = 0 MCR 1. MCRD 2. MCRA 10-20
162 10.16 MCR( RLO MCR MCR MCR MCR( MCR( MCR RLO MCR MCR MCR MCR( )MCR MCR( )MCR RLO=1 MCR MCR MCR RLO=0 MCR MCR MCR MCR MCR = < > S < > R < > T <> T < > T <> MCR( )MCR 8 8 MCR( MCR MCRF 10-21
163 MCRA A I 1.0 MCR( A I 4.0 = Q 8.0 L MW20 T QW10 )MCR MCRD A I 1.1 = Q 8.1 // MCR // RLO MCR MCR RLO=1 I 1.0 = 1 MCR RLO=0 I 1.0 = 0MCR // MCR Q I 4.0 // MCR 0 QW10 // MCR // MCR // MCR MCR 10-22
164 10.17 )MCR MCR MCR )MCR )MCR MCR MCR MCR MCR 1 MCR( )MCR )MCR MCR MCRF MCRA A I 1.0 MCR( A I 4.0 = Q 8.0 L MW20 T QW10 )MCR MCRD A I 1.1 = Q 8.1 // MCR // RLO MCR MCR RLO=1 I 1.0 = 1 MCR RLO=0 I 1.0 = 0MCR // MCR Q I 4.0 // MCR 0 QW10 // MCR // MCR // MCR MCR 10-23
165 10.18 MCRA MCR MCR MCRA MCRA MCR MCRA MCRD MCRA MCRD MCR MCRA A I 1.0 MCR( A I 4.0 = Q 8.0 L MW20 T QW10 )MCR MCRD A I 1.1 = Q 8.1 // MCR // RLO MCR MCR RLO=1 I 1.0 = 1 MCR RLO=0 I 1.0 = 0MCR // MCR Q I 4.0 // MCR 0 QW10 // MCR // MCR // MCR MCR 10-24
166 10.19 MCRD MCR MCR MCRD MCRD MCR MCRD MCRA MCRA MCRD MCR MCRA A I 1.0 MCR( A I 4.0 = Q 8.0 L MW20 T QW10 )MCR MCRD A I 1.1 = Q 8.1 // MCR // RLO MCR MCR RLO=1 I 1.0 = 1 MCR RLO=0 I 1.0 = 0MCR // MCR Q I 4.0 // MCR 0 QW10 // MCR // MCR // MCR MCR 10-25
167 10-26
168 CPU CC 1 CC 0 OV CC 1 SSI 16 SSD 32 SLW 16 SRW 16 SLD 32 SRD
169 SSI 16 SSI SSI <> <> 0 15 SSI 1 15 CC 1 <> 2 SSI <> <> 0 15 < > 0 CC 0 OV 0 <> 0NOP SSI ACCU 1 = 16#0000 CC 1 = 0 ACCU 1 = 16#FFFF CC 1 = 1 0 CC 0 OV 0 0 NOP - x x x SSI SSI L MW4 SRW 6 T MW8 // 1 // 1 6 // MW8 11-2
170 2 L +3 L MW20 SRW JP NEXT // +3 1 // 1 2 MW20 1 // 2 => 1 3 // CC 1 = 1 NEXT SSD 32 SSD SSD <> <> 0 32 SSD 1 CC 1 <> 2 SSD <> <> 0 32 < > 0 CC 0 OV 0 <> 0NOP SSD ACCU 1 = 32# CC 1 = 0 ACCU 1 = 32#FFFFFFFF CC 1 = 1 0 CC 0 OV 0 0 NOP - x x x
171 SSD SSD L MD4 SSD 7 T MD8 // 1 // 1 7 // MD8 2 L +3 L MD20 SSD JP NEXT // +3 1 // 1 2 MD20 1 // 2 => 1 3 // CC 1 = 1 NEXT 11-4
172 SLW 16 SLW SLW <> <> 0 15 SLW 1 0 CC 1 <> 2 SLW <> <> 0 15 < > 0 CC 0 OV 0 <> 0NOP SLW ACCU 1- L = 0 CC 1 = 0 CC 0 = 0 OV = 0 16 CC 0 OV 0 0NOP - x x x SLW SLW L MW4 SLW 5 T MW8 // 1 // 1 5 // MW8 11-5
173 2 L +3 L MW20 SLW JP NEXT // +3 1 // 1 2 MW20 1 // 2 => 1 3 // CC 1 = 1 NEXT SRW 16 SRW SRW <> <> 0 15 SRW 1 0 CC 1 <> 2 SRW <> <> 0 15 < > 0 CC 0 OV 0 <> 0NOP SRW ACCU 1- L = 0 CC 1 = 0 CC 0 = 0 OV = 0 16 CC 0 OV 0 0NOP - x x x
174 SRW SRW L MW4 SRW 6 T MW8 // 1 // 1 6 // MW8 2 L +3 L MW20 SRW SPP NEXT // +3 1 // 1 2 MW20 1 // 2 => 1 3 // CC 1 = 1 NEXT SLD 32 SLD SLD <> <> 0 32 SLD 1 0 CC 1 <> 2 SLD <> <> 0 32 < > 0 CC 0 OV 0 <> 0NOP 11-7
175 SLD ACCU 1- L = 0 CC 1 = 0 CC 0 = 0 OV = 0 32 CC 0 OV 0 0NOP - x x x SLD SLD L MD4 SLD 5 T MD8 // 1 // 1 5 // MD8 2 L +3 L MD20 SLD JP NEXT // +3 1 // 1 2 MD20 1 // 2 => 1 3 // CC 1 = 1 NEXT SRD 32 SRD SRD <> <>
176 SRD 1 0 CC 1 <> 2 SRD <> <> 0 32 < > 0 CC 0 OV 0 <> 0NOP SRD ACCU 1- L = 0 CC 1 = 0 CC 0 = 0 OV = 0 32 CC 0 OV 0 0NOP - x x x SRD SRD L MD4 SRD 7 T MD8 // 1 // 1 7 // MD8 2 L +3 L MD20 SRD JP NEXT // +3 1 // 1 2 MD20 1 // 2 => 1 3 // CC 1 = 1 NEXT 11-9
177 CPU CC 1 CC 0 0 RLD 32 RRD 32 RLDA CC RRDA CC RLD 32 RLD RLD <> <>
178 RLD 1 1 CC 1 <> 2 RLD <> <> 0 32 <> 0 CC 0 OV 0 <> 0NOP RLD CC 0 OV 0 0 NOP - x x x RLD RLD L MD2 RLD 4 T MD8 // 1 // 1 4 // MD8 2 L +3 L MD20 RLD JP NEXT // +3 1 // 1 2 MD20 1 // 2 => 1 3 // CC 1 = 1 NEXT 11-11
179 RRD 32 RRD RRD <> <> 0 32 RRD 1 1 CC 1 <> 2 RRD <> <> 0 32 <> 0 CC 0 OV 0 <> 0NOP RRD x x x RRD RRD L MD2 RRD 4 T MD8 // 1 // 1 4 // MD
180 2 L +3 L MD20 RRD JP NEXT // +3 1 // 1 2 MD20 1 // 2 => 1 3 // CC 1 = 1 NEXT RLDA CC RLDA 1 CC 1 1 CC 0 OV 0 - x CC RLDA X RLDA X X = 0 1 CC 1 L MD2 RLDA JP NEXT // MD2 1 // 1 CC 1 1 // CC 1 = 1 NEXT 11-13
181 RRDA CC RRDA 1 1 CC 0 OV 0 - x CC RRDA X RRDA 1 X X = 0 1 CC 1 L MD2 RRDA JP NEXT // MD2 1 // 1 CC 1 1 // CC 1 = 1 NEXT 11-14
182 FR L 1 LC BCD 1 R SD SE SF SP SS 12-1
183 12.2 CPU CPU CPU RUN BCD 1 W#16#txyz - t = - xyz = - S5T#aH_bM_cS_dMS - H= M= S=MS=a b c d - 9,990 2H_46M_30S
184 ms 10 s h46m30s h10ms S5TIME BCD BCD
185 I 0.0 Q 4.0 Q 4.0 Q 4.0 Q 4.0 Q 4.0 SP_PUL SE SE_PEXT SD_ODT SS_ODTS SF_OFFDT SP_PUL SE SE_PEXT SD_ODT SS_ODT S SF_OFFDT 1 t
186 12.3 FR FR < > < > TIMER T CPU RLO 01 FR RLO 0 1 RLO = A I 2.0 FR T1 A I 2.1 L S5T#10s SI T1 A I 2.2 R T1 A T1 = Q 4.0 L T1 T MW10 // T1 // 1 10 // T1 // T1 // T1 // T1 12-5
187 t = RLO I 2.0 (1) RLO 01 RLO 1 RLO I (2) RLO 01 I 2.2 RLO RLO 1 (3) RLO 01 RLO 0 Q 4.0 L LC t = (1) RLO 01 RLO 10 (2) RLO 01 RLO 1 (3) RLO 01 RLO
188 12.4 L 1 L < > < > TIMER T CPU L T1 // T1 1 T1 L T1 1 00=10ms 01=100ms 10=1s 11=10s L T
189 12.5 LC BCD 1 LC < > < > TIMER T CPU 1 2 BCD LC T1 // T1 BCD 1 T1 LC T1 1 00=10ms 01=100ms 10=1s 11=10s LC T1 BCD (BCD ) 12-8
190 12.6 R R < > < > TIMER T CPU RLO STL A I 2.1 R T1 // I 2.1 RLO 01 T1 12-9
191 12.7 SP SP < > < > TIMER T CPU RLO 01 RLO = 1RLO 0 BCD A I 2.0 FR T1 A I 2.1 L S5T#10s SP T1 A I 2.2 R T1 A T1 = Q 4.0 L T1 T MW10 LC T1 T MW12 // T1 // 1 10 // T1 // T1 // T1 // T1 // T1 BCD 12-10
192 I 2.0 I 2.1 I 2.2 Q 4.0 L LC t = 12.8 SE SE < > < > TIMER T CPU RLO 01 RLO 0 RLO 01 BCD
193 A I 2.0 FR T1 A I 2.1 L S5T#10s SE T1 A I 2.2 R T1 A T1 = Q 4.0 L T1 T MW10 LC T1 T MW12 // T1 // 1 10 // T1 // T1 // T1 // T1 // T1 BCD I 2.0 I 2.1 I 2.2 Q 4.0 L LC t = 12-12
194 12.9 SD SD < > < > TIMER T CPU RLO 01 RLO = 1RLO 0 BCD A I 2.0 FR T1 A I 2.1 L S5T#10s SD T1 A I 2.2 R T1 A T1 = Q 4.0 L T1 T MW10 LC T1 T MW12 // T1 // 1 10 // T1 // T1 // T1 // T1 // T1 BCD 12-13
195 I 2.0 I 2.1 I 2.2 Q 4.0 L LC t = SS SS < > < > TIMER T CPU RLO 01 RLO 0 RLO 01 BCD
196 A I 2.0 FR T1 A I 2.1 L S5T#10s SS T1 A I 2.2 R T1 A T1 = Q 4.0 L T1 T MW10 LC T1 T MW12 // T1 // 1 10 // T1 // T1 // T1 // T1 // T1 BCD I 2.0 I 2.1 I 2.2 Q 4.0 L LC t = 12-15
197 12.11 SF SF < > < > TIMER T CPU RLO 10 RLO = 0RLO 1 BCD A I 2.0 FR T1 A I 2.1 L S5T#10s SF T1 A I 2.2 R T1 A T1 = Q 4.0 L T1 T MW10 LC T1 T MW12 // T1 // 1 10 // T1 // T1 // T1 // T1 // T1 BCD 12-16
198 I 2.0 I 2.1 I 2.2 Q 4.0 L LC t = 12-17
199 12-18
200 CC CC 1 0 AW 16 OW 16 XOW 16 AD 32 OD 32 XOD
201 13.2 AW 16 AW AW <> <> WORD CPU CC 1 0 CC 1 = 1 CC 0 OV 0 AW 1 2 AW <> x AW AW L IW20 // IW20 1 L IW22 // 1 2 IW22 AW T MW 8 1 // // MW8 13-2
202 2 L IW20 AW W#16#0FFF JP NEXT // IW20 1 // _1111_1111_ // 0CC 1 = 1 NEXT 13.3 OW 16 OW OW <> <> WORD CPU RLO RLO CC 1 0 CC 1 = 1 CC 0 OV 0 OW 1 2 OW <> x OW OW
203 1 L L OW T IW20 IW22 MW8 // IW20 1 // 1 2 IW22 1 // // MW8 2 L IW20 OW W#16#0FFF JP NEXT // IW20 1 // _1111_1111_ // 0CC 1 = 1 NEXT 13.4 XOW 16 XOW XOW <> <> WORD CC 1 0 CC 1 = 1 CC 0 OV XOW 1 2 XOW <>
204 - x XOW XOW L L XOW T IW20 IW22 MW8 // IW20 1 // 1 2 ID24 1 // // MW8 2 L IW20 // IW20 1 XOW16#0FFF // _1111_1111_1111 JP NEXT 1 // 0CC 1 = 1 NEXT 13-5
205 13.5 AD 32 AD AD <> <> WORD CPU CC 1 0 CC 1 = 1 CC 0 OV 0 AD 1 2 AD <> x UD UD L L AD ID20 ID24 T MD8 2 L ID 20 AD DW#16#0FFF_EF21 JP NEXT // ID20 1 // 1 2 ID24 1 // // MD8 // ID20 1 // _1111_1111_1111_1110_ 1111_0010_ // 0CC 1 = 1 NEXT 13-6
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209 13-10
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