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1 1 SIMATIC S7-300 S7-400 () A5E A B C

2 / 2006

3 MS Windows 2000 Professional MS Windows Server 2003 XP Professional STEP IEC STEP 7 NORM_TBL.WRI iii

4 STEP 7 S7 STEP 7 STEP 7 STEP 7 STEP 7 STEP 7 V5.3 STEP 7 V5.3 STEP 7 V5.3 S5 S7 STEP 7 S7-300/400 LAD / FBD / S7-300/400 STEP 7 S7-300/400 LAD FBD STEP 7 6ES7810-4CA08-8BW0 6ES7810-4CA08-8BW1 STEP 7 /LAD/FBD / SFB / SFC STEP 7 STEP 7 STEP 7 iv

5 F1 Help > Context-Sensitive Help Help > Contents Help on STEP 7 STEP 7 Glossary STEP 7 SIMATIC S7 D (911) (010) (021) (020) (027) (024) (023) v

6 A&D (0) (0) GMT +1:00 / 08:00:00-17: (0) (0) adsupport@siemens.com GMT +1:00 08:00:00-17:00 +1 (0) (0) isd-callcenter@sea. siemens.com GMT -5:00 SIMATIC / 08:30-17: adsupport.asia@siemens.com GMT +8:00 () () (010) (0411) (021) (020) (028) vi

7 ...iii...vii A AN O ON X XN O A( AN( O( ON( X( XN( ) = R S NOT RLO SET RLO = CLR RLO = SAVE RLO BR FN FP ? I ? D ? R BTI BCD ITB 16 BCD BTD BCD vii

8 3.5 ITD DTB 32 BCD DTR IEEE-FP INVI INVD NEGI NEGD NEGR 32 IEEE-FP CAW CAD RND TRUNC RND RND FR L LC BCD R S CU CD OPN CDB L DBLG L DBNO L DILG L DINO JU JL JC RLO = JCN RLO = JCB RLO = 1 BR JNB RLO = 0 BR JBI BR = JNBI BR = JO OV = viii

9 6.11 JOS OS = JZ JN JP JM JPZ JMZ JUO LOOP I 1 2 (16 ) I 2 1 (16 ) *I 1 2 (16 ) /I 2 1 (16 ) D 1 2 (32 ) D 2 1 (32 ) *D 1 2 (32 ) /D 2 1 (32 ) MOD R 1 2 (32 IEEE-FP) R 2 1 (32 IEEE-FP) *R 1 2 (32 IEEE-FP) /R 2 1 (32 IEEE-FP) ABS 32 IEEE-FP SQR SQRT EXP LN SIN COS TAN ASIN ACOS ATAN ix

10 L L STW LAR LAR1 <D> (32 ) LAR1 AR LAR LAR2 <D>(32 ) T T STW CAR TAR TAR1 <D> 1 (32 ) TAR1 AR TAR TAR2 <D> 2 (32 ) BE BEC BEU CALL CC UC MCR MCR MCR( RLO MCR MCR )MCR MCR MCRA MCR MCRD MCR SSI SSD x

11 SLW SRW SLD SRD RLD RRD RLDA CC RRDA CC FR L LC BCD R SP SE SD SS SF AW OW XOW AD OD XOD TAK POP CPU POP CPU PUSH CPU PUSH CPU ENT LEAVE INC DEC AR xi

12 AR BLD NOP NOP A...A-1 A.1... A-1 A.2... A-6 B...B-1 B.1... B-1 B.2... B-2 B.3... B-5 B.4... B-8 B.5...B-10 B.6...B-11 C...C-1 xii

13 RLO A AN O ON X XN O A( AN( O( ON( X( XN( ) 1-1

14 = R S RLO NOT RLO SET RLO =1 CLR RLO =0 SAVE RLO BR FN FP 1-2

15 1.2 A A < > < > BOOL I Q M L D T C 1 RLO ==0 <>0 >0 <0 >=0 <=0 OV OS UO BR x x x 1 A I 1.0 I A I 1.1 I = Q 4.0 Q

16 1.3 AN N < > < > BOOL I Q M L D T C 0 RLO ==0 <>0 >0 <0 >=0 <=0 OV OS UO BR x x x 1 A I 1.0 I AN I 1.1 I = Q 4.0 Q

17 1.4 O O < > < > BOOL I Q M L D T C 1 RLO ==0 <>0 >0 <0 >=0 <=0 OV OS UO BR x x

18 1.5 ON ON < > < > BOOL I Q M L D T C 0 RLO ==0 <>0 >0 <0 >=0 <=0 OV OS UO BR x x 1 O I 1.0 ON I 1.1 I I = Q 4.0 Q

19 1.6 X X < > < > BOOL I Q M L D T C 1 RLO 1 1 ==0 <>0 >0 <0 >=0 <=0 OV OS UO BR x x 1 1-7

20 1.7 XN XN < > < > BOOL I Q M L D T C 0 RLO ==0 <>0 >0 <0 >=0 <=0 OV OS UO BR x x 1 1-8

21 1.8 O O O x 1 - x 1-9

22 1.9 A( A( A( RLO OR

23 1.10 AN( AN( AN( RLO OR O( O( O( RLO OR

24 1.12 ON( ON( ON( RLO OR X( X( X( RLO OR

25 1.14 XN( XN( XN( RLO OR

26 1.15 ) ) ) OR RLO RLORLO ANDAND NOT OR A( AN( O( ON( X( XN( x 1 x

27 1.16 = < > < > BOOL I Q M L D MCR = 1= < > RLO MCR = 00 RLO x

28 1.17 R R < > < > BOOL I Q M L D RLO = 1 MCR = 1 R 0 MCR = x

29 1.18 S S < > < > BOOL I Q M L D RLO = 1 MCR = 1 S 1 MCR = x

30 1.19 NOT RLO NOT NOT RLO x SET RLO =1 SET RLO SET RLO RLO 1-18

31 1.21 CLR RLO =0 CLR RLO CLR RLO RLO 1-19

32 1.22 SAVE RLO BR SAVE SAVE RLO BR /FC BR AND BR SAVEBR SAVE ENO(= BR ) RLO x

33 1.23 FN FN < > < > BOOL I Q M L D RLO RLO FN < > RLO 10 RLO = 1 RLO RLO RLO < > RLO 1 RLO x x 1 RLO

34 I 1.0 OB1 Q 4.0 OB1 1-22

35 1.24 FP FP < > < > BOOL I Q M L D RLO RLO FP < > RLO 01 RLO = 1 RLO RLO RLO < > RLO 0 RLO x x 1 RLO

36 I 1.0 OB1 Q 4.0 OB1 1-24

37 ACCU1 2 ACCU2 == 1 2 <> 1 2 > 1 2 < 1 2 >= 1 2 <= 1 2 RLO 1 CC 1 CC 0? I 16? D 32? R

38 2.2? I 16 ==I <>I >I <I >=I <=I RLO RLO = 1 RLO = 0 CC 1 CC 0 - x x 0-0 x x 1 RLO ACCU 2 > ACCU 1 RLO ACCU 2 = ACCU 1 RLO ==I <> I >I <I >=I <=I ACCU 2 < ACCU 1 RLO L MW10 L IW24 >I = M 2.0 // MW10 16 // IW24 16 // 2 MW10 1 IW24 // MW10 > IW24 RLO = 1 2-2

39 2.3? D 32 ==D <>D >D <D >=D <=D RLO RLO = 1 RLO = 0 CC 1 CC 0 - x x 0-0 x x 1 RLO ACCU 2 > ACCU 1 RLO ACCU 2 = ACCU 1 RLO ==D <>D >D <D >=D <=D ACCU 2 < ACCU 1 RLO L MD10 L ID24 >D = M 2.0 // MD10 32 // ID24 32 // 2 MD10 1 ID24 // MD10 > ID24 RLO = 1 2-3

40 2.4? R 32 ==R <>R >R <R >=R <=R 32 IEEE-FP IEEE-FP RLO RLO = 1 RLO = 0 CC 1 CC 0 - x x x x 0 x x 1 RLO ACCU 2 > ACCU 1 RLO ACCU 2 = ACCU 1 RLO ==R <>R >R <R >=R <=R ACCU 2 < ACCU 1 RLO L MD10 L 1.359E+02 >R = M 2.0 // MD10 // 1.359E+02 // 2 MD E+02 // MD10 > 1.359E+02 RLO = 1 2-4

41 3 3.1 BCD BTI BCD 16 ITB 16 BCD BTD BCD 32 ITD DTB 32 BCD DTR IEEE-FP INVI 16 INVD 32 NEGI 16 NEGD 32 NEGR 32 IEEE-FP 1 1 CAW 1 16 CAD IEEE 32 RND TRUNC RND+ RND- 3-1

42 3.2 BTI BCD 16 BTI BTI 3 BCD 1 3 BCD BCD BCD BCD 15 BCD 0 = 1= BCD BCDF CPU STOP OB L BTI T MW10 MW20 // BCD 1 // BCD 1 // MW20 "+915" BCD BCD "+915" 3-2

43 3.3 ITB 16 BCD ITB ITB BCD BCD BCD 0000 = 1111= 1 2 BCD OV OS1 RLO RLO x x L ITB T MW10 MW20 // 1 // BCD 16 1 // BCD MW20 "-413" BCD "-413" BCD 3-3

44 3.4 BTD BCD 32 BTD BTD 7 BCD 1 7 BCD BCD BCD -9,999,999 +9,999, BCD 31 BCD 0 = 1= BCD BCD BCDF CPU STOP OB L MD10 BTD T MD20 // BCD 1 // BCD 1 // MD20 BCD " " " " 3-4

45 3.5 ITD ITD ITD L ITD T MW12 MD20 // 1 // // MD20 MW12 = ITD XXXX XXXX XXXX XXXX ITD X =

46 3.6 DTB 32 BCD DTB DTB BCD BCD BCD 0000 = 1111= 2 BCD -9,999,999 +9,999,999 OV OS x x L MD10 DTB T MD20 // 32 1 // 32 BCD 1 // BCD MD20 BCD "-701" "-701" BCD 3-6

47 3.7 DTR IEEE-FP DTR DTR IEEE IEEE L MD10 DTR T MD20 // 32 1 // 32 IEEE FP 1 // BCD MD20 32 IEEE 32 "+500" "+500" IEE-FP 3-7

48 3.8 INVI 16 INVI INVI L IW8 INVI T MW10 // 1 // 16 // MW INVI INVI

49 3.9 INVD 32 INVD INVD L ID8 INVD T MD10 // 1 // 32 // MD INVD INVD

50 3.10 NEGI 16 NEGI NEGI CC 1 CC 0 OS OV - x x x x CC 1 CC 0 OV OS = = L IW8 NEGI T MW10 // 1 // 16 // MW NEGI NEGI

51 3.11 NEGD 32 NEGD NEGD RLO RLO CC 1 CC 0 OS OV - x x x x CC 1 CC 0 OV OS = ,147,483, ,147,483, = 2,147,483, L ID8 NEGD T MD10 // 1 // 32 // MD NEGD NEGD

52 3.12 NEGR 32 IEEE-FP NEGR NEGR 32 IEEE 1 32 IEEE-FP L ID8 NEGR T MD10 // 1 ID 8 = 1.5E+02 // 32 IEEE FP 1 // MD10 = -1.5E

53 3.13 CAW 1 16 CAW CAW L MW10 CAW T MW20 // MW10 1 // 1 // MW CAW A B C D CAW A B D C

54 3.14 CAD 1 32 CAD CAD L MD10 CAD T MD20 // MD10 1 // 1 // MD CAD A B C D CAD D C B A

55 3.15 RND RND RND 32 IEEE IEEE 32 IEEE-FP 32 IEEE 32 OV OS1 1 (32NaN) x x L MD10 RND T MD20 // 1 // 32 IEEE FP // MD20 MD10 = "100.5" => RND => MD20 = "+100" MD10 = "-100.5" => RND => MD20 = "-100" 3-15

56 3.16 TRUNC TRUNC TRUNC 32 IEEE IEEE 32 IEEE 32 IEEE OV OS 1 1 (32NaN) x x L MD10 TRUNC T MD20 // 1 // 32 IEEE-FP 32 1 // MD20 MD10 = "100.5" => TRUNC => MD20 = "+100" MD10 = "-100.5" => TRUNC => MD20 = "-100" 3-16

57 3.17 RND+ RND+ RND+ 32 IEEE IEEE 32 IEEE 32 IEEE OV OS 1 1 (32NaN) x x L MD10 RND+ T MD20 // 32 IEEE-FP 1 // 32 IEEE FP 32 1 // MD20 MD10 = "100.5" => RND+ => MD20 = "+101" MD10 = "-100.5" => RND+ => MD20 = "-100" 3-17

58 3.18 RND- RND- RND- 32 IEEE IEEE 32 IEEE 32 IEEE OV OS 1 1 (32NaN) x x L MD10 RND- T MD20 // 1 // 32 IEEE FP 32 1 // MD20 MD10 = "100.5" => RND- => MD20 = "+100" MD10 = "-100.5" => RND- => MD20 = "-101" 3-18

59 4 4.1 STEP 7 CPU CPU CPU FR L 1 LC BCD 1 R S CU CD 4-1

60 4.2 FR FR < > < > COUNTER C CPU RLO 01 RLO A I 2.0 FR C3 // I 2.0 // RLO 01 C3 4-2

61 4.3 L 1 L < > < > COUNTER C CPU L C3 // C3 1 C L C3 L C

62 4.4 LC BCD 1 LC < > < > COUNTER C CPU 1 2 BCD LC C3 // C3 BCD 1 C LC Z3 LC C BCD 4-4

63 4.5 R R < > < > COUNTER C CPU RLO= A I 2.3 R C3 // I 2.3 // RLO 01 C

64 4.6 S S < > < > COUNTER C CPU RLO BCD A I 2.3 L C#3 S C1 // I 2.3 // 3 1 // RLO 01 C1 4-6

65 4.7 CU CU < > < > COUNTER C CPU RLO RLO OV A I 2.1 CU C3 // I 2.1 // RLO 01 C

66 4.8 CD CD < > < > COUNTER C CPU RLO RLO L C#14 A I 0.1 S C1 A I 0.0 CD C1 AN C1 = Q.0 // // I 0.1 // 1 // I 0.0 // I 0.0 RLO 01 C1 1 // C1 0 // 1 0 Q 0.0 = 1 4-8

67 5 5.1 OPN OPN CDB L DBLG 1 L DBNO 1 L DILG 1 L DINO 1 5-1

68 5.2 OPN OPN < > < > DB DI OPN DB10 L DBW35 T MW22 OPN DI20 L DIB12 T DBB37 // DB10 // 35 1 // 1 MW22 // DB20 // 12 1 //

69 5.3 CDB CDB L DBLG 1 L DBLG OPN DB10 L DBLG L MD10 <D JC ERRO // DB10 // DB10 // // MD10 ERRO 5-3

70 5.5 L DBNO 1 L DBNO L DILG 1 L DILG OPN DI20 L DILG L MW10 <I JC // DB20 // DB20 // // MW10 ERRO 5-4

71 5.7 L DINO 1 L DINO

72 5-6

73 6 6.1 LOOP 4 : S7-300 CPU JU JL RLO JC RLO = 1 JCN RLO = 0 JCB RLO = 1 BR JNB RLO = 0 BR JBI BR = 1 JNBI BR = 0 JO OV = 1 JOS OS = 1 6-1

74 JZ JN JP JM JPZ JMZ JUO 6-2

75 6.2 JU JU <> <> A I 1.0 A I 1.2 JC DELE L MB10 INC 1 T MB10 JU FORW DELE: L 0 T MB10 FORW: A I 2.1 // RLO=1 DELE // FORW // FORW 6-3

76 6.3 JL JL <> <> 255 JU JL JL JU 1 0 JU 1 1 JU JL JU JU JL L JL JU JU JU JU LSTX: JU SEG0: * JU SEG1: * JU SEG3: * JU COMM: * MB0 LSTX SEG0 SEG1 COMM SEG3 COMM COMM COMM COMM // 1 // 1 3 LSTX // 1 0 SEG0 // 1 1 SEG1 // 1 2 SEG2 // 1 3 SEG3 // // // 6-4

77 6.4 JC RLO = 1 JC <> <> RLO= RLO=0 RLO A I 1.0 A I 1.2 JC JOVR L IW8 T MW22 JOVR: A I 2.1 // RLO=1 JOVR // // JOVR 6-5

78 6.5 JCN RLO = 0 JCN <> <> RLO= RLO= A I 1.0 A I 1.2 JCN JOVR L IW8 T MW22 JOVR: A I 2.1 // RLO = 0 JOVR // // JOVR 6-6

79 6.6 JCB RLO = 1 BR JCB <> <> RLO= RLO=0 RLO 1 RLO BR RLO x A I 1.0 A I 1.2 JCB JOVR L IW8 T MW22 JOVR: A I 2.1 // RLO=1 JOVR RLO BR // // JOVR 6-7

80 6.7 JNB RLO = 0 BR JNB <> <> RLO= RLO=1 RLO 1 RLO BR RLO x A I 1.0 A I 1.2 JNB JOVR L IW8 T MW22 JOVR: A I 2.1 // RLO=0 JOVR RLO BR // // JOVR 6-8

81 6.8 JBI BR = 1 JBI <> <> BR=

82 6.9 JNBI BR = 0 JNBI <> <> BR=

83 6.10 JO OV = 1 JO <> <> OV= JOS L MW10 L 3 *I JO OVER T MW10 A M 4.0 R M 4.0 JU NEXT OVER: AN M 4.0 S M 4.0 NEXT: NOP 0 // MW10 3 // OV=1 // // OVER // NEXT 6-11

84 6.11 JOS OS = 1 JOS <> <> OS= L IW10 L MW12 *I L DBW25 +I L MW14 -I JOS OVER T MW16 A M 4.0 R M 4.0 JU NEXT OVER: AN M 4.0 S M 4.0 NEXT: NOP 0 // OS=1 // // OVER // NEXT JOJO-I 6-12

85 6.12 JZ JZ <> <> CC 1 = 0 CC 0 = L MW10 SRW 1 JZ ZERO L MW2 INC 1 T MW2 JU NEXT ZERO: L MW4 INC 1 T MW4 NEXT: NOP 0 // = 0 ZERO // // ZERO // NEXT 6-13

86 6.13 JN JN <> <> CC 1 CC 0 CC 1=0/CC 0=1 CC 1=1/CC 0= L IW8 L MW12 XOW JN NOZE AN M 4.0 S M 4.0 JU NEXT NOZE: AN M 4.1 S M 4.1 NEXT: NOP 0 // 1 0 NOZE // // NOZE // NEXT 6-14

87 6.14 JP JP <> <> CC 1 = 1 CC 0 = L IW8 L MW12 -I JP POS AN M 4.0 S M 4.0 JU NEXT POS: AN M 4.1 S M 4.1 NEXT: NOP 0 // IW8 MW12 // >0 1 0 // // POS // NEXT 6-15

88 6.15 JM JM <> <> CC 1 = 0 CC 0 = L IW8 L MW12 -I JM NEG AN M4.0 S M4.0 JU NEXT NEG: AN M4.1 S M4.1 NEXT: NOP 0 // IW8 MW12 // < // // NEG // NEXT 6-16

89 6.16 JPZ JPZ <> <> CC 1 CC 0 CC 1=0/CC 0=0 CC 1=1/CC 0= L IW8 L MW12 -I JPZ REG0 AN M 4.0 S M 4.0 JU NEXT REG0: AN M 4.1 S M 4.1 NEXT: NOP 0 // IW8 MW12 // // // REG0 // NEXT 6-17

90 6.17 JMZ JMZ <> <> CC 1 CC 0 CC 1=0/CC 0=0 CC 1=0/CC 0= L IW8 L MW12 -I JMZ RGE0 AN M 4.0 S M 4.0 JU NEXT RGE0: AN M 4.1 S M 4.1 NEXT: NOP 0 // IW8 MW12 // // // RGE0 // NEXT 6-18

91 6.18 JUO JUO <> <> CC 1 = 1 CC 0 = CC 1 = 1 CC 0 = L MD10 L ID2 /D JUO ERRO T MD14 A M 4.0 R M 4.0 JU NEXT ERRO: AN M 4.0 S M 4.0 NEXT: NOP 0 // MD10 ID2 // ID2 = 0 // // ERRO // NEXT 6-19

92 6.19 LOOP LOOP <> <> L L#1 T MD20 L 5 NEXT: T MW10 L MD20 * D T MD20 L MW10 LOOP NEXT L MW24 L 200 >I // 32 1 // 1 MD20 // 1 // = / 1 // MD20 MB10 // MD20 // 1 // NEXT // 6-20

93 CPU 2 CPU I I *I /I D D *D /D MOD

94 7.2 CC1 CC0 OV OS CC 1 CC 0 OV OS * < < > > 0 * OS * * CC 1 CC 0 OV OS 16 = = < < > > > > < < CC 1 CC 0 OV OS +D = /D MOD

95 7.3 +I 12(16 ) +I 16 +I RLO RLO CC 1 CC 0 OS OV / CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < > = > < L L +I T IW10 MW14 DB1.DBW25 // IW10 1 // 1 2 MW14 1 // // 1 DB1 DBW25 7-3

96 7.4 I 2 1 (16 ) -I 16 -I RLO RLO CC 1 CC 0 OS OV / CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < > > < L L -I T IW10 MW14 DB1.DBW25 // IW10 1 // 1 2 MW14 1 // // 1 DB1 DBW25 7-4

97 7.5 *I 12(16 ) *I 16 *I OV1 = 1 OS = 1 16 RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < > > < L L *I T IW10 MW14 DB1.DBD25 // IW10 1 // 1 2 MW14 1 // // 1 DB1 DBD25 7-5

98 7.6 /I 21 (16 ) /I 16 /I RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < > = L L /I T IW10 MW14 MD20 // IW10 1 // 1 2 MW14 1 // // 1 MD IW10"13" 1 MW14"4" /I 2 / 1 "13/4" 1 "3" 1 "1" 7-6

99 <> <> <> <16 > <32 > ,147,483, ,147,483, L L +I IW10 MW T DB1.DBW25 // IW10 1 // 1 2 MW14 1 // // // 1 DB1 DBW25 7-7

100 2 L IW12 L IW >I JC NEXT // // 2 1 IW12 > (IW ) // NEXT 3 L MD20 L MD24 +D + L#-200 T MD28 // //

101 7.8 +D 12 (32) +D 32 +D RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < > = > < L L +D T ID10 MD14 DB1.DBD25 // ID10 1 // 1 2 MD14 1 // // 1 DB1 DBD25 7-9

102 7.9 D 2 1 (32) -D 32 -D RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < > > < L L -D T ID10 MD14 DB1.DBD25 // ID10 1 // 1 2 MD14 1 // // 1 DB1 DBD

103 7.10 *D 12 (32) *D 32 *D OV1 = 1 OS = 1 32 RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < > > < L L *D T ID10 MD14 DB1.DBD25 // ID10 1 // 1 2 MD14 1 // // 1 DB1 DBD

104 7.11 /D 21 (32) /D 32 /D MOD RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < > = L L /D T ID10 MD14 MD20 // ID10 1 // 1 2 MD14 1 // // 1 MD ID10"13" 1 MD14"4" /D 2 / 1 "13/4" 1 "3" 7-12

105 7.12 MOD 32 MOD MOD /D RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU x x x x CC 1 CC 0 OV OS = < >

106 L ID10 L MD14 MOD T MD20 // ID10 1 // 1 2 MD14 1 // // 1 MD ID10 "13" 1 MD14 "4" MOD 2 / 1 "13/4" 1 "1" 7-14

107 CPU 2 CPU IEEE 32 REAL 32 IEEE +R 1 2 -R 2 1 *R 1 2 /R IEEE ABS SQR SQRT EXP LN SIN COS TAN ASIN ACOS ATAN 8-1

108 8.2 CC 1 CC 0 OV OS 32 CC 1 CC 0 OV OS * E+38 < < E * E-38 < < E * * OS CC 1 CC 0 OV OS E-38 < < E E-45 < < E-38 < E+38 > E

109 R 12(32 IEEE-FP) +R 32 IEEE +R IEEE RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero zero denormalized normalized infinite qnan x x x x

110 OPN DB10 L ID10 L MD14 +R T DBD25 // ID10 1 // 1 2 MD14 1 // // 1 DB10 DBD R 2 1(32 IEEE-FP) -R 32 IEEE -R IEEE RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero zero denormalized normalized infinite qnan

111 - x x x x OPN DB10 L ID10 L MD14 -R T DBD25 // ID10 1 // 1 2 MD14 1 // // 1 DB10 DBD *R 12(32 IEEE-FP) *R 32 IEEE *R IEEE 32 IEEE 1 RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero zero denormalized normalized infinite qnan

112 - x x x x OPN DB10 L ID10 L MD14 *R T DBD25 // ID10 1 // 1 2 MD14 1 // // 1 DB10 DBD /R 21 (32 IEEE-FP) /R 32 IEEE /R IEEE 32 IEEE 1 RLO RLO CC 1 CC 0 OS OV CPU 2 4 CPU CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero zero denormalized normalized infinite qnan

113 - x x x x OPN DB10 L ID10 L MD14 /R T DBD20 // ID10 1 // 1 2 MD14 1 // // 1 DB10 DBD ABS 32 IEEE-FP ABS ABS 32 IEEE 1 32 IEEE-FP L ID8 ABS T MD10 // 1 ID8 = -1.5E+02 // 1 // MD10 = 1.5E

114 SQR 32 SQR SQR 32 IEEE 1 32 IEEE-FP 1 CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero qnan OPN L SQR AN JC BEU OK: T DB17 DBD0 OV OK DBD4 // DB17 // DBD0 1 // 1 32 IEEE FP 1 // OV 0 // SQR OK // SQR // 1 DBD4 8-8

115 8.4.2 SQRT 32 SQRT SQRT 32 IEEE 1 32 IEEE-FP CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero zero qnan L SQRT AN JC BEU OK: T MD10 OV OK MD20 // MD10 1 // 1 32 IEEE FP 1 // OV 0 // SQRT OK // SQRT // 1 MD20 8-9

116 8.4.3 EXP 32 EXP EXP 32 IEEE 1 32 IEEE-FP e 1 CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero qnan L EXP AN JC BEU OK: T MD10 OV OK MD20 // MD10 1 // 1 32 IEEE FP e 1 // OV 0 // EXP OK // EXP // 1 MD

117 8.4.4 LN 32 LN LN 32 IEEE 1 32 IEEE-FP 1 0 CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero zero denormalized normalized infinite qnan L MD10 LN AN OV JC OK BEU OK: T MD20 // MD10 1 // 1 (32 IEEE FP) 1 // OV 0 // OK // // 1 MD

118 8.4.5 SIN 32 SIN SIN 32 IEEE ( ) 1 1 CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan normalized denormalized zero zero denormalized normalized qnan L SIN T MD10 MD20 // MD10 1 // 1 32 IEEE FP 1 // 1 MD

119 8.4.6 COS 32 COS COS 32 IEEE ( ) 1 1 CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan normalized denormalized zero zero denormalized normalized qnan L MD10 COS T MD20 // MD10 1 // 1 32 IEEE FP 1 // 1 MD

120 8.4.7 TAN 32 TAN TAN 32 IEEE ( ) 1 1 CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan infinite normalized denormalized zero zero denormalized normalized infinite qnan L TAN AN JC BEU OK: T MD10 OV OK MD20 // MD10 1 // 1 32 IEEE FP 1 // OV 0 // TAN OK // TAN // 1 MD

121 8.4.8 ASIN 32 ASIN ASIN 32 IEEE / / 2= CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan normalized denormalized zero zero denormalized normalized qnan L ASIN AN JC BEU OK: T MD10 OV OK MD20 // MD10 1 // 1 (32 IEEE FP) 1 // OV 0 // ASIN OK // ASIN // 1 MD

122 8.4.9 ACOS 32 ACOS ACOS 32 IEEE = CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan normalized denormalized zero zero denormalized normalized qnan L ACOS AN JC BEU OK: T MD10 OV OK MD20 // MD10 1 // 1 (32 IEEE FP) 1 // OV 0 // ACOS OK // ACOS // 1 MD

123 ATAN 32 ATAN ATAN 32 IEEE 1 - / / 2= CC 1 CC 0 OV OS CPU 1 CC 1 CC 0 OV OS +qnan normalized denormalized zero zero denormalized normalized qnan L ATAN AN JC BEU OK: T MD10 OV OK MD20 // MD10 1 // 1 (32 IEEE FP) 1 // OV 0 // ATAN OK // ATAN // 1 MD

124 8-18

125 9 9.1 L T CPU RLO L L STW 1 LAR1 AR2 2 1 LAR1 <D> 1 LAR1 1 1 LAR2 <D> 2 LAR2 2 1 T T STW 1 TAR1 AR2 1 2 TAR1 <D> 1 32 TAR2 <D> 2 32 TAR1 1 1 TAR2 2 1 CAR

126 9.2 L L <> <> E A PE M L D L IB10 L MB120 L DBB12 L DIW15 L LD252 L P# I 8.7 L OTTO L P# ANNA // IB10 1 // MB120 1 // DBB12 1 // DIW15 1 // LD252 1 // 1 // OTTO 1 // 1 AR2 9-2

127 XXXXXXXX XXXXXXXX XXXXXXXX XXXXXXXX L MB10 L <> <MB10> L MW10 L < > <MB10> <MB11> L MD10 L <> <MB10> <MB11> <MB12> <MB13> L P# ANNA L P# ANNA <86> < ANNA > AR2 <ANNA > X =

128 9.3 L STW 1 L STW L STW STW 1 S7-300 CPU L STW FC STA OR L STW // 1 L STW

129 9.4 LAR1 1 1 LAR AR

130 9.5 LAR1 <D> (32 ) 1 LAR1 <D> <D> D M L <D> AR LAR1 LAR1 LAR1 LAR1 DBD20 DID30 LD180 MD24 // DBD20 AR1 // DID30 AR1 // LD180 AR1 // MD24 AR1 LAR1 P#M100.0 // 32 AR1 9-6

131 9.6 LAR1 AR2 2 1 LAR1 AR2 AR2 LAR1 AR2 AR LAR2 1 2 LAR AR

132 9.8 LAR2 <D>(32 ) 2 LAR2 <D> <D> D M L <D> AR LAR2 DBD 20 LAR2 DID 30 LAR2 LD 180 LAR2 MD 24 // DBD20 AR2 // DID30 AR2 // LD180 AR2 // MD24 AR2 LAR2 P#M100.0 // 32 AR2 9-8

133 9.9 T T <> <> I Q PQ M L D MCR = 1 1 MCR = I/O PQ 1 0 MCR = 0 Q T T T QB10 MW14 DBD2 // 1 QB10 // 1 MW14 // 1 DBD2 9-9

134 9.10 T STW 1 T STW T STW STW x x x x x x x x x T STW // *) * 9-10

135 9.11 CAR 1 2 CAR CAR AR1 AR2 AR1 AR2 AR2 AR TAR1 1 1 TAR1 AR

136 9.13 TAR1 <D>1 (32 ) TAR1 <D> <D> D M L AR1 <D> MD LD DBD DID TAR1 TAR1 TAR1 TAR1 DBD20 DID30 LD18 MD24 // AR1 DBD20 // AR1 DID30 // AR1 LD18 // AR1 MD

137 9.14 TAR1 AR2 1 2 TAR1 AR2 AR2 TAR1 AR1 AR TAR2 2 1 TAR2 AR

138 9.16 TAR2 <D>2 (32 ) TAR2 <D> <D> D M L AR2 <D> MD LD DBD DID TAR2 TAR2 TAR2 TAR2 DBD20 DID30 LD18 MD24 // AR2 DBD20 // AR2 DID30 // AR2 LD18 // AR2 MD

139 BE BEC BEU CALL CC UC (FB) (FC) (SFB) (SFC) MCR MCR MCR( RLO MCR MCR )MCR MCR MCRA MCR MCRD MCR 10-1

140 10.2 BE BE MCR RLO S5 S7 BEU A I 1.0 JC NEXT L IW4 T IW10 A I 6.0 A I 6.1 S M 12.0 BE NEXT: NOP 0 // RLO = 1 I 1.0 = 1 NEXT // // // 10-2

141 10.3 BEC BEC RLO = 1 MCR RLO (= 1) RLO = 0 RLO x A I 1.0 BEC L IW4 T MW10 // RLO // RLO = 1 // BEC RLO =

142 10.4 BEU BEU MCR RLO A I 1.0 JC NEXT L IW4 T IW10 A I 6.0 A I 6.1 S M 12.0 BEU NEXT: NOP 0 // RLO = 1 I 1.0 = 1 NEXT // // // 10-4

143 10.5 CALL CALL <> FCFB SFC SFB FC SFC FB SFB RLO FB SFB SFB/SFC CALL FB1 DB1 CALL FILLVAT1 RECIPE1 FC CALL FCn SFC CALL SFCn FB CALL FBn1,DBn2 SFB CALL SFBn1,DBn2 Editor n n1 n2 FBSFB FC SFC IN OUT IN_OUT FC SFC FBSFB FB DB1.DBW2 IN OUT IN_OUT 10-5

144 MA B MCR FC6 CALL FC6 NO OF TOOL TIME OUT FOUND ERROR := MW100 := MW110 := Q 0.1 := Q SFC CALL SFC43 // SFC43 3 DB1 FB99 CALL FB99 DB1 MAX_RPM MIN_RPM MAX_POWER MAX_TEMP := #RPM1_MAX := #RPM1 := #POWER1 := #TEMP1 4 DB2 FB99 CALL FB99 DB2 MAX_RPM MIN_RPM MAX_POWER MAX_TEMP := #RPM2_MAX := #RPM2 := #POWER2 := #TEMP2 10-6

145 FB SFB DB1 DB2 10-7

146 10.6 CALL FB n1 DB n1 FB RLO IN OUT IN_OUT FB DB1.DBW2 IN OUT IN_OUT MA B MCR

147 1 DB1 FB99 CALL FB99 DB1 MAX_RPM MIN_RPM MAX_POWER MAX_TEMP := #RPM1_MAX := #RPM1 := #POWER1 := #TEMP1 2 DB2 FB99 CALL FB99 DB2 MAX_RPM MIN_RPM MAX_POWER MAX_TEMP := #RPM2_MAX := #RPM2 := #POWER2 := #TEMP2 FB DB1 DB2 10-9

148 10.7 CALL FC n Editor n FC RLO IN OUT IN_OUT FC IN OUT IN_OUT MA B MCR FC6 CALL FC6 NO OF TOOL TIME OUT FOUND ERROR := MW100 := MW110 := Q0.1 := Q

149 10.8 CALL SFB n1 DB n2 SFB SFB RLO IN OUT IN_OUT SFB DB1.DBW2 IN OUT IN_OUT MA B MCR 10-11

150 CALL SFB4 DB4 IN: PT: Q: ET: I0.1 T#20s M0.0 MW10 SFB4 DB

151 10.9 CALL SFC n Editor n SFC SFC RLO IN OUT IN_OUT SFC IN OUT IN_OUT MA B MCR SFC CALL SFC43 // SFC

152 10.10 CALL # x x x SIMATIC CPU Standard Library 10-14

153 10.12 CC CC <> RLO=1 FC FB CC CALL MA B MCR A I 2.0 CC FC6 A M 3.0 // I 2.0 // I FC6 // I 2.0 = 1 I 2.0 = 0 A I 2.0 CALL FBSFB CC (LAD)() Program Editor UC CC CALL 10-15

154 10.13 UC UC <> FC SFC UC CALL MA B MCR UC FC6 // FC6 2 UC SFC43 // SFC43 CALL FBSFB UC (LAD)() Program Editor UC CC CALL 10-16

155 10.14 MCR MCR MCR MCR MCR = < > S < > R < > T <> T < > T <> MCR 0 T 0 S R = 0 MCR MCR MCR = < > S < > R < > T <> T < > T <>

156 MCR( MCR )MCR MCR MCR MCR MCR( RLO MCR )MCR 1 MCR( )MCR 8 MCR( MCR )MCR MCRF MCRA MCR MCRD MCR MCRA MCRD MCRA MCRD MCR MCRA-MCRD MCR MCRA FCFB MCR 10-18

157 10.15 MCR MCRA MCR MCR( )MCR T = 0 MCR( RLO = 0 MCR PLC STOP VAR_TEMP PLC STOP STRUCT UDT ARRAY STRING FC (V2) IN_OUT STRUCT UDT ARRAY STRING FB (V2) (V2)BLOCK_DB CPU STOPT 0 C 0 FC0 FB0 TIMER COUNTER BLOCK_FC BLOCK_FB LAD/FBD LAD FBD T RLO = 0 MCR 1. MCRD 2. MCRA 10-19

158 10.16 MCR( RLO MCR MCR MCR MCR( MCR( MCR RLO MCR MCR MCR MCR( )MCR MCR( )MCR RLO=1 MCR MCR RLO=0 MCR MCR MCR MCR = < > S < > R < > T <> T < > T <> MCR( )MCR 8 8 MCR( MCR MCRF 10-20

159 MCRA A I 1.0 MCR( A I 4.0 = Q 8.0 L MW20 T QW10 )MCR MCRD A I 1.1 = Q 8.1 // MCR // RLO MCR MCR RLO=1 I 1.0 = 1 MCR= RLO=0 I 1.0 = 0MCR= // MCR= I 4.0 Q // MCR=0 QW10 // MCR // MCR // MCR MCR 10-21

160 10.17 )MCR MCR MCR )MCR )MCR MCR MCR MCR MCR 1 MCR( )MCR )MCR MCR MCRF MCRA A I 1.0 MCR( A I 4.0 = Q 8.0 L MW20 T QW10 )MCR MCRD A I 1.1 = Q 8.1 // MCR // RLO MCR MCR RLO=1 I 1.0 = 1 MCR= RLO=0 I 1.0 = 0MCR= // MCR= I 4.0 Q // MCR= 0 QW10 // MCR // MCR // MCR MCR 10-22

161 10.18 MCRA MCR MCR MCRA MCRA MCR MCRA MCRD MCRA MCRD MCR MCRA A I 1.0 MCR( A I 4.0 = Q 8.0 L MW20 T QW10 )MCR MCRD A I 1.1 = Q 8.1 // MCR // RLO MCR MCR RLO=1 I 1.0 = 1 MCR= RLO=0 I 1.0 = 0MCR= // MCR= I 4.0 Q // MCR= 0 QW10 // MCR // MCR // MCR MCR 10-23

162 10.19 MCRD MCR MCR MCRD MCRD MCR MCRD MCRA MCRA MCRD MCR MCRA A I 1.0 MCR( A I 4.0 = Q 8.0 L MW20 T QW10 )MCR MCRD A I 1.1 = Q 8.1 // MCR // RLO MCR MCR RLO=1 I 1.0 = 1 MCR= RLO=0 I 1.0 = 0MCR= // MCR= I 4.0 Q // MCR= 0 QW10 // MCR // MCR // MCR MCR 10-24

163 CPU n2 n n2 n CC 1 CC 0 OV CC 1 SSI 16 SSD 32 SLW 16 SRW 16 SLD 32 SRD

164 SSI 16 SSI SSI <> <> 0 15 SSI 1 15 CC 1 <> 2 SSI <> <> 0 15 < > 0 CC 0 OV 0 <> 0NOP SSI ACCU 1 = 16#0000 CC 1 = 0 ACCU 1 = 16#FFFF CC 1 = 1 0 CC 0 OV 0 0 NOP - x x x SSI SSI L MW4 SSI 6 T MW8 // 1 // 1 6 // MW8 11-2

165 2 L +3 L MW20 SSI JP NEXT // +3 1 // 1 2 MW20 1 // 2 => 1 3 // CC 1 = 1 NEXT SSD 32 SSD SSD <> <> 0 32 SSD 1 CC 1 <> 2 SSD <> <> 0 32 < > 0 CC 0 OV 0 <> 0NOP SSD ACCU 1 = 32# CC 1 = 0 ACCU 1 = 32#FFFFFFFF CC 1 = 1 0 CC 0 OV 0 0 NOP - x x x

166 SSD SSD L MD4 SSD 7 T MD8 // 1 // 1 7 // MD8 2 L +3 L MD20 SSD JP NEXT // +3 1 // 1 2 MD20 1 // 2 => 1 3 // CC 1 = 1 NEXT 11-4

167 SLW 16 SLW SLW <> <> 0 15 SLW 1 0 CC 1 <> 2 SLW <> <> 0 15 < > 0 CC 0 OV 0 <> 0NOP SLW ACCU 1- L = 0 CC 1 = 0 CC 0 = 0 OV = 0 16 CC 0 OV 0 0NOP - x x x SLW SLW L MW4 SLW 5 T MW8 // 1 // 1 5 // MW8 11-5

168 2 L +3 L MW20 SLW JP NEXT // +3 1 // 1 2 MW20 1 // 2 => 1 3 // CC 1 = 1 NEXT SRW 16 SRW SRW <> <> 0 15 SRW 1 0 CC 1 <> 2 SRW <> <> 0 15 < > 0 CC 0 OV 0 <> 0NOP SRW ACCU 1- L = 0 CC 1 = 0 CC 0 = 0 OV = 0 16 CC 0 OV 0 0NOP - x x x

169 SRW SRW L MW4 SRW 6 T MW8 // 1 // 1 6 // MW8 2 L +3 L MW20 SRW SPP NEXT // +3 1 // 1 2 MW20 1 // 2 => 1 3 // CC 1 = 1 NEXT SLD 32 SLD SLD <> <> 0 32 SLD 1 0 CC 1 <> 2 SLD <> <> 0 32 < > 0 CC 0 OV 0 <> 0NOP 11-7

170 SLD ACCU 1 = 0 CC 1 = 0 CC 0 = 0 OV = 0 32 CC 0 OV 0 0NOP - x x x SLD SLD L MD4 SLD 5 T MD8 // 1 // 1 5 // MD8 2 L +3 L MD20 SLD JP NEXT // +3 1 // 1 2 MD20 1 // 2 => 1 3 // CC 1 = 1 NEXT SRD 32 SRD SRD <> <>

171 SRD 1 0 CC 1 <> 2 SRD <> <> 0 32 < > 0 CC 0 OV 0 <> 0NOP SRD ACCU 1 = 0 CC 1 = 0 CC 0 = 0 OV = 0 32 CC 0 OV 0 0NOP - x x x SRD SRD L MD4 SRD 7 T MD8 // 1 // 1 7 // MD8 2 L +3 L MD20 SRD JP NEXT // +3 1 // 1 2 MD20 1 // 2 => 1 3 // CC 1 = 1 NEXT 11-9

172 CPU CC 1 CC 0 0 RLD 32 RRD 32 RLDA CC RRDA CC RLD 32 RLD RLD <> <>

173 RLD 1 1 CC 1 <> 2 RLD <> <> 0 32 <> 0 CC 0 OV 0 <> 0NOP RLD CC 0 OV 0 0 NOP - x x x RLD RLD L MD2 RLD 4 T MD8 // 1 // 1 4 // MD8 2 L +3 L MD20 RLD JP NEXT // +3 1 // 1 2 MD20 1 // 2 => 1 3 // CC 1 = 1 NEXT 11-11

174 RRD 32 RRD RRD <> <> 0 32 RRD 1 1 CC 1 <> 2 RRD <> <> 0 32 <> 0 CC 0 OV 0 <> 0NOP RRD x x x RRD RRD L MD2 RRD 4 T MD8 // 1 // 1 4 // MD

175 2 L +3 L MD20 RRD JP NEXT // +3 1 // 1 2 MD20 1 // 2 => 1 3 // CC 1 = 1 NEXT RLDA CC RLDA 1 CC 1 1 CC 0 OV 0 - x CC RLDA X RLDA X X = 0 1 CC 1 L MD2 RLDA JP NEXT // MD2 1 // 1 CC 1 1 // CC 1 = 1 NEXT 11-13

176 RRDA CC RRDA 1 CC 1 1 CC 0 OV 0 - x CC RRDA X RRDA 1 X X = 0 1 CC 1 L MD2 RRDA JP NEXT // MD2 1 // 1 CC 1 1 // CC 1 = 1 NEXT 11-14

177 FR L 1 LC BCD 1 R SD SE SF SP SS 12-1

178 12.2 CPU CPU CPU RUN BCD 1 W#16#txyz - t = - xyz = - S5T#aH_bM_cS_dMS - H= M= S=MS=a b c d - 9,990 2H_46M_30S

179 ms 10 s h46m30s ( 2h10ms) S5TIME BCD BCD

180 S_PULSE S_PEXT S_ODT S_ODTS S_OFFDT 1 t

181 12.3 FR FR < > < > TIMER T CPU RLO 01 FR RLO 0 1 RLO = A I 2.0 FR T1 A I 2.1 L S5T#10s SI T1 A I 2.2 R T1 A T1 = Q 4.0 L T1 T MW10 // T1 // 1 10 // T1 // T1 // T1 // T1 12-5

182 t = RLO I 2.0 (1) RLO 01 RLO 10 (2) RLO I 2.1 RLO 01 RLO 1 I 2.2 (3) RLO RLO 01 RLO 0 Q 4.0 L LC t = (1) RLO 01 RLO 10 (2) RLO 01 RLO 1 (3) RLO 01 RLO

183 12.4 L 1 L < > < > TIMER T CPU L T1 // T1 1 T1 00=10ms 01=100ms 10=1s 11=10s L T1 L T

184 12.5 LC BCD 1 LC < > < > TIMER T CPU 1 2 BCD LC T1 // T1 BCD 1 T1 LC T1 1 00=10ms 01=100ms 10=1s 11=10s LC T1 BCD (BCD ) 12-8

185 12.6 R R < > < > TIMER T CPU RLO A I 2.1 R T1 // I 2.1 RLO 01 T1 12-9

186 12.7 SP SP < > < > TIMER T CPU RLO 01 RLO = 1 RLO 0 BCD A I 2.0 FR T1 A I 2.1 L S5T#10s SP T1 A I 2.2 R T1 A T1 = Q 4.0 L T1 T MW10 LC T1 T MW12 // T1 // 1 10 // T1 // T1 // T1 // T1 // BCD T

187 I 2.0 I 2.1 I 2.2 Q 4.0 L LC t = 12.8 SE SE < > < > TIMER T CPU RLO 01 RLO 0 RLO 01 BCD

188 A I 2.0 FR T1 A I 2.1 L S5T#10s SE T1 A I 2.2 R T1 A T1 = Q 4.0 L T1 T MW10 LC T1 T MW12 // T1 // 1 10 // T1 // T1 // T1 // T1 // BCD T1 I 2.0 I 2.1 I 2.2 Q 4.0 L LC t = 12-12

189 12.9 SD SD < > < > TIMER T CPU RLO 01 RLO = 1 RLO 0 BCD A I 2.0 FR T1 A I 2.1 L S5T#10s SD T1 A I 2.2 R T1 A T1 = Q 4.0 L T1 T MW10 LC T1 T MW12 // T1 // 1 10 // T1 // T1 // T1 // T1 // BCD T

190 I 2.0 I 2.1 I 2.2 Q 4.0 L LC t = SS SS < > < > TIMER T CPU RLO 01 RLO 0 RLO 01 BCD

191 A I 2.0 FR T1 A I 2.1 L S5T#10s SS T1 A I 2.2 R T1 A T1 = Q 4.0 L T1 T MW10 LC T1 T MW12 // T1 // 1 10 // T1 // T1 // T1 // T1 // BCD T1 I 2.0 I 2.1 I 2.2 Q 4.0 L LC t = 12-15

192 12.11 SF SF < > < > TIMER T CPU RLO 10 RLO = 0 RLO 1 BCD A I 2.0 FR T1 A I 2.1 L S5T#10s SF T1 A I 2.2 R T1 A T1 = Q 4.0 L T1 T MW10 LC T1 T MW12 // T1 // 1 10 // T1 // T1 // T1 // T1 // BCD T

193 I 2.0 I 2.1 I 2.2 Q 4.0 L LC t = 12-17

194 12-18

195 CC CC 1 0 AW 16 OW 16 XOW 16 AD 32 OD 32 XOD

196 13.2 AW 16 AW AW <> <> WORD CPU CC 1 0 CC 1 = 1 CC 0 OV 0 AW 1 2 AW <> x AW AW L L AW IW20 IW22 T MW 8 // IW20 1 // 1 2 IW22 1 // // MW8 13-2

197 2 L IW20 AW W#16#0FFF JP NEXT // IW20 1 // _1111_1111_ // 0CC 1 = 1 NEXT 13.3 OW 16 OW OW <> <> WORD CPU RLO RLO CC 1 0 CC 1 = 1 CC 0 OV 0 OW 1 2 OW <> x OW OW

198 1 L L OW T IW20 IW22 MW8 // IW20 1 // 1 2 IW22 1 // // MW8 2 L IW20 OW W#16#0FFF JP NEXT // IW20 1 // _1111_1111_ // 0CC 1 = 1 NEXT 13.4 XOW 16 XOW XOW <> <> WORD CC 1 0 CC 1 = 1 CC 0 OV XOW 1 2 XOW <>

199 - x XOW XOW L L XOW T IW20 IW22 MW8 // IW20 1 // 1 2 IW24 1 // // MW8 2 L IW20 XOW16#0FFF JP NEXT // IW20 1 // _1111_1111_ // 0CC 1 = 1 NEXT 13-5

200 13.5 AD 32 AD AD <> <> DWORD CPU CC 1 0 CC 1 = 1 CC 0 OV 0 AD 1 2 AD <> x UD UD L L AD ID20 ID24 T MD8 2 L ID 20 AD DW#16#0FFF_EF21 JP NEXT // ID20 1 // 1 2 ID24 1 // // MD8 // ID20 1 // _1111_1111_1111_1110_ 1111_0010_ // 0CC 1 = 1 NEXT 13-6

201 13.6 OD 32 OD OD <> <> DWORD CPU CC 1 0 CC 1 = 1 CC 0 OV 0 OD 1 2 OD <> x OD OD L L OD T ID20 ID24 MD8 // ID20 1 // 1 2 ID24 1 // // MD8 13-7

202 2 L ID20 OD DW#16#0FFF_EF21 JP NEXT // ID20 1 // _1111_1111_1111_1110_ 1111_0010_ // 0CC 1 = 1 NEXT 13.7 XOD 32 XOD XOD <> <> DWORD CC 1 0 CC 1 = 1 CC 0 OV XOD 1 2 XOD <> x

203 XOD XOD L L XOD T ID20 ID24 MD8 // ID20 1 // 1 2 ID24 1 // // MD8 2 L ID20 XOD DW#16#0FFF_EF21 JP NEXT // ID20 1 // _1111_1111_1111_1111_ 1110_0010_ // 0CC 1 = 1 NEXT 13-9

204 13-10

205 TAK 1 2 PUSH CPU PUSH CPU POP CPU POP CPU ENT LEAVE INC 1 DEC 1 +AR AR2 1 2 BLD NOP 0 NOP

206 14.2 TAK 1 2 TAK 1 2 CPU L L >I SPB TAK NEXT: -I T MW10 MW12 NEXT MW14 // MW10 1 // 1 2 MW12 1 // 2 (MW10) 1 (MW12) // 2 (MW10) 1 (MW12) NEXT // 1 2 // 1 2 // (=) MW TAK <MW12> <MW10> TAK <MW10> <MW12> 14-2

207 14.3 POP CPU POP T MD10 POP T MD14 // 1 = A MD10 // 2 1 // 1 = B MD POP A B POP B B 14-3

208 14.4 POP CPU POP T MD10 POP T MD14 // 1 = A MD10 // 2 1 // 1 = B MD POP A B C D POP B C D D 14-4

209 14.5 PUSH CPU PUSH L MW10 PUSH // MW10 1 // PUSH <MW10> <X> PUSH <MW10> <MW10> 14-5

210 14.6 PUSH CPU PUSH L MW10 PUSH // MW10 1 // PUSH A B C D PUSH A A B C 14-6

211 14.7 ENT ENT ENT 3 L L +R L ENT L -R /R T DBD0 DBD4 DBD8 DBD12 DBD16 // DBD0 1 // 1 2 DBD4 1 // IEEE FP 1 // 1 2 DBD8 1 // // DBD12 1 // // 2 DBD0 + DBD4 1 DBD8 DBD12 1 // 1 DBD LEAVE LEAVE LEAVE

212 14.9 INC 1 INC <8 > <8 > I +D L MB22 INC 1 T MB22 // MB22 // 1 MB // 1 MB

213 14.10 DEC 1 DEC <8 > <8 > I -D L MB250 DEC 1 T MB250 // MB250 // // 1 MB

214 AR AR1 +AR1 <P#Byte.Bit> <P#Byte.Bit> ID AR AR1 <P#Byte.Bit><P#Byte.Bit> L AR1 // 1 // AR1 P#300.0 //

215 AR AR2 +AR2 <P#Byte.Bit> <P#Byte.Bit> ID AR AR2 <P#Byte.Bit><P#Byte.Bit> L AR2 // 1 // AR2 P#300.0 //

216 14.13 BLD BLD <> <> BLD PG LAD FBD <> BLD

217 14.14 NOP 0 NOP 0 NOP PG NOP 1 NOP 1 NOP PG

218 14-14

219 A A = = ) ) +AR1 +AR1 AR AR2 +AR2 AR D +D D D *D *D /D /D ? D? D 32 == <> > < >= <= +I +I I I *I *I /I /I ? I? I 16 == <> > < >= <= +R +R IEEE-FP 1 2 R R IEEE-FP 2 1 *R *R IEEE-FP 1 2 /R /R IEEE-FP 2 1 A-1

220 ? R? R 32 == <> > < >= <= ABS ABS 32 IEEE-FP ACOS ACOS 32 ASIN ASIN 32 ATAN ATAN 32 AUF OPN BE BE BEA BEU BEB BEC BLD BLD BTD BTD BCD 32 BTI BTI BCD 16 CALL CALL CALL CALL CALL CALL CC CC CLR CLR RLO =0 COS COS 32 DEC DEC 1 DTB DTB 32 BCD DTR DTR IEEE-FP ENT ENT EXP EXP 32 FN FN FP FP FR FR FR C 0 C 255 FR FR INC INC 1 INVD INVD 32 INVI INVI 16 ITB ITB 16 BCD ITD ITD L L / L DBLG L DBLG / 1 L DBNO L DBNO / 1 L DILG L DILG / 1 L DINO L DINO / 1 L STW L STW / 1 A-2

221 L L / L T 32 L L / L C 15 LAR1 LAR1 / 1 1 LAR1 LAR1 / 1 LAR1 LAR1 / 2 1 LAR2 LAR2 / 2 1 LAR2 LAR2 / 2 LC LC BCD LC C 15 LC LC BCD LC T 32 LEAVE LEAVE LN LN 32 LOOP LOOP MCR( MCR( RLO MCR MCR )MCR )MCR MCR MCRA MCRA MCR MCRD MCRD MCR MOD MOD NEGD NEGD 32 NEGI NEGI 16 NEGR NEGR IEEE-FP NOP 0 NOP 0 NOP 1 NOP 1 NOT NOT RLO O O O( O( OD OD ON ON ON( ON( OW OW POP POP POP POP POP CPU A-3

222 POP POP CPU PUSH PUSH CPU PUSH PUSH CPU R R R R R C 15 R R R T 32 RLD RLD 32 RLDA RLDA CC RND RND RND+ RND+ RND RND RRD RRD 32 RRDA RRDA CC S S S S S C 15 SA SF SAVE SAVE RLO BR SE SD SET SET SI SP SIN SIN 32 SLD SLD 32 SLW SLW 16 SPA JU SPB JC RLO = 1 SPBB JCB RLO = 1 BR= 1 SPBI JBI BR = 1 SPBIN JNBI BR = 0 SPBN JCN RLO = 0 SPBNB JNB RLO = 0 BR= 1 SPL JL SPM JM SPMZ JMZ SPN JN SPO JO OV = 1 SPP JP SPPZ JPZ SPS JOS OS = 1 A-4

223 SPU JUO SPZ JZ SQR SQR 32 SQRT SQRT 32 SRD SRD 32 SRW SRW 16 SS SS SSD SSD 32 SSI SSI 16 SV SE T T / T STW T STW / 1 TAD CAD 1 32 TAK TAK 1 2 TAN TAN 32 TAR CAR / 1 2 TAR1 TAR1 / 1 1 TAR1 TAR1 / 1 TAR1 TAR1 / 1 2 TAR2 TAR2 / 2 1 TAR2 TAR2 / 2 TAW CAW 1 16 TDB CDB TRUNC TRUNC U A U( A( UC UC UD AD 32 UN AN UN( AN( UW AW 16 X X X( X( XN XN XN( XN( XOD XOD XOW XOW A-5

224 ZR CD ZV CU A = = ) ) +AR1 +AR1 AR AR2 +AR2 AR D +D D D *D *D /D /D ? D? D 32 == <> > < >= <= +I +I I I *I *I /I /I ? I? I 16 == <> > < >= <= +R +R IEEE-FP 1 2 R R IEEE-FP 2 1 *R *R IEEE-FP 1 2 /R /R IEEE-FP 2 1 A-6

225 ? R? R == <> > < >= <= A U A( U( ABS ABS IEEE-FP ACOS ACOS 32 AD UD 32 AN UN AN( UN( ASIN ASIN 32 ATAN ATAN 32 AW UW 16 BE BE BEC BEB BEU BEA BLD BLD BTD BTD BCD 32 BTI BTI BCD 16 CAD TAD Change Byte Sequence in ACCU 1 (32-bit) CALL CALL CALL CALL CALL CALL CAR TAR / 1 2 CAW TAW Change Byte Sequence in ACCU 1-L (16-bit) CC CC CD ZR CDB TDB CLR CLR RLO =0 COS COS 32 CU ZV DEC DEC 1 DTB DTB 32 BCD DTR DTR IEEE-FP ENT ENT EXP EXP 32 FN FN FP FP FR FR FR C 0 - C 255 A-7

226 FR FR INC INC 1 INVD INVD 32 INVI INVI 16 ITB ITB 16 BCD ITD ITD JBI SPBI BR = 1 JC SPB RLO = 1 JCB SPBB RLO = 1 BR= 1 JCN SPBN RLO = 0 JL SPL JM SPM JMZ SPMZ JN SPN JNB SPBNB RLO = 0 BR= 1 JNBI SPBIN BR = 0 JO SPO OV = 1 JOS SPS OS = 1 JP SPP JPZ SPPZ JU SPA JUO SPU JZ SPZ L L / L DBLG L DBLG / 1 L DBNO L DBNO / 1 L DILG L DILG / 1 L DINO L DINO / 1 L STW L STW / 1 L L L T 32 L L L C 15 LAR1 LAR1 / 1 1 LAR1 <D> LAR1<D> / 1 LAR1 AR2 LAR1 AR2 / 2 1 LAR2 LAR2 / 2 1 A-8

227 LAR2 <D> LAR2 <D> / 2 LC LC BCD LC C 15 LC LC BCD LC T 32 LEAVE LEAVE LN LN 32 LOOP LOOP MCR( MCR( RLO MCR MCR )MCR )MCR MCR MCRA MCRA MCR MCRD MCRD MCR MOD MOD NEGD NEGD 32 NEGI NEGI 16 NEGR NEGR IEEE-FP NOP 0 NOP 0 NOP 1 NOP 1 NOT NOT RLO O O O( O( OD OD ON ON ON( ON( OPN AUF OW OW POP POP POP POP POP CPU POP POP CPU PUSH PUSH CPU PUSH PUSH CPU R R R R R C 15 R R R T 32 RLD RLD 32 RLDA RLDA CC A-9

228 RND RND RND RND RND+ RND+ RRD RRD 32 RRDA RRDA CC S S S S S C 15 SAVE SAVE RLO BR SD SE SE SV SET SET SF SA SIN SIN 32 SLD SLD 32 SLW SLW 16 SP SI SQR SQR 32 SQRT SQRT 32 SRD SRD 32 SRW SRW 16 SS SS SSD SSD 32 SSI SSI 16 T T / T STW T STW / 1 TAK TAK 1 2 TAN TAN 32 TAR1 TAR1 / 1 1 TAR1 TAR1 / 1 32 TAR1 TAR1 / 1 2 TAR2 TAR2 / 2 1 TAR2 TAR2 / 2 32 TRUNC TRUNC UC UC X X X( X( XN XN A-10

229 XN( XN( XOD XOD 32 XOW XOW 16 A-11

230 A-12

231 B B.1 AW OW CD CU S R NOT RLO FP +I 1 2 /I 2 1 *I 1 2 >=I <=I A AN O ON = INC 1 BE BEC L T / SE B-1

232 B.2 1 S1 S2 S3 S4 S5 S5 MOTOR_ON S1 S2 S3 S4 STEP 7 I 1.1 S1 I 1.1 S1 I 1.2 S2 I 1.2 S2 I 1.3 S3 I 1.3 S3 I 1.4 S4 I 1.4 S4 I 1.5 S5 I 1.5 S5 Q 4.0 MOTOR_ON Q 4.0 MOTOR_ON O O S O O ON R I 1.1 I 1.3 Q 4.0 I 1.2 I 1.4 I 1.5 Q 4.0 O O S O O ON R S1 S3 MOTOR_ON S2 S4 S5 MOTOR_ON B-2

233 O I 1.1 O I 1.3 S Q 4.0 O I 1.2 O I 1.4 ON I 1.5 R Q 4.0 // // 2 PEB1 PEB2 Q 4.0 PEB2 PEB1 Q 4.1 B-3

234 STEP 7 1 I 0.0 PEB1 I 0.0 PEB1 2 I 0.1 PEB2 I 0.1 PEB2 Q 4.0 RIGHT Q 4.0 RIGHT Q 4.1 LEFT Q 4.1 LEFT 1 M 0.0 PMB1 M 0.0 PMB1 2 M 0.1 PMB2 M 0.1 PMB2 A FP AN S A FP AN S AN AN R R I 0.0 M 0.0 I 0.1 Q 4.1 I 0.1 M 0.1 I 0.0 Q 4.0 I 0.0 I 0.1 Q 4.0 Q 4.1 A FP AN S A FP AN S AN AN R R PEB1 PMB1 PEB 2 LEFT PEB 2 PMB 2 PEB 1 RIGHT PEB 1 PEB 2 RIGHT LEFT A I 0.0 FP M 0.0 AN I 0.1 S Q 4.1 A I 0.1 FP M 0.1 AN I 0.0 S Q 4.0 AN I 0.0 AN I 0.1 R Q 4.0 R Q 4.1 // I I // I I // B-4

235 B.3 S :1 U T1 L S5T#250ms SV T1 NOT BEB L MB100 INC 1 T MB100 // T 1 // 250 ms T 1 // T1 // // // MB100 // 1 // MB100 T1 RLO ms AN T1 1 B-5

236 RLO ms 250 ms RLO 0 BEC MB100 1 MB ms 0 -> 1 -> 2 -> 3 ->... -> 254 -> 255 -> 0 -> 1... MB100 MB100 [] M s 250 ms 1 / 250 ms 0 ) M s 0.5 s 1 / 0.5 s 0 M s 1 s 1 / 1 s 0 M s 2 s 1 / 2 s 0 M s 4 s 1 / 4 s 0 M s 8 s 1 / 8 s 0 M s 16 s 1 / 16 s 0 M s 32 s 1 / 32 s 0 A M10.0 A M100.1 = Q 4.0 // M 10.0 = 1 1 Hz B-6

237 MB [ms] MB M = 1/T = 1/1 s = 1 Hz 1 M ms 0.5 s 0.75 s 1 s 1.25 s 1.5 s B-7

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