系统架构 - 模块划分 功能 状态机 H265 主要的模块 : 1. 顶层模块 H265ENC_top 包括 sys_ctrl,enc_core 及 fetch 三个模块 2. sys_ctrl 就是一个状态机, 控制 fetch 和 enc_core 中各子模块的工作 3. enc_core 编码
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- 峰秋 咸
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1 3.1 系统架构与模块仿真文件 作者 : 江亲炜 日期 :2017/1/8
2 系统架构 - 模块划分 功能 状态机 H265 主要的模块 : 1. 顶层模块 H265ENC_top 包括 sys_ctrl,enc_core 及 fetch 三个模块 2. sys_ctrl 就是一个状态机, 控制 fetch 和 enc_core 中各子模块的工作 3. enc_core 编码器的核心 4. 存取 cur_pixel 和 ref_pixel 1/14/2017 2
3 系统的状态机 Intra 编码时的状态 State Description State Description IDLE 空闲状态 I_S0 Fetch load数据 P_S0 Fetch load数据 I_S1 Pre_intra模块on P_S1 Ime模块on I_S2 Intra 模块 on P_S2 Fme 模块 on P_S3 Mc模块 on DB&EC 模块 on I_S3 Inter 编码时的状态 1/14/2017 I_S4 Fetch 模块off P_S4 DB&EC 模块 on I_S5 Pre_intra模块off P_S5 Fetch 模块off I_S6 Intra 模块 off P_S6 Ime模块off P_S7 Fme 模块 off P_S8 Mc模块 off 3
4 模块接口 Enc_core 模块与其他模块的接口 : 1. Sys_if 接口为控制信号, 与 SYS_CTRL 模块通信 以 INTRA_SYS_IF 为例, 包括信号 Intra_start_i, Intra_x_i, Intra_y_i, Intra_qp_i, Intra_done_o 2. 其他接口为数据信号, 与 FETCH 模块通信 以 IME_CUR_IF 为例, 包括信号 Ime_cur_4x4_x_o, Ime_cur_4x4_y_o, Ime_cur_idx o, Ime_cur_sel_o, Ime_cur_size_o, Ime_cur_ren_o Ime_cur_data_i, 1/14/2017 4
5 模块接口 ENC_CORE 内部各子模块接口 Pre_intra 顶层模块的接口 Intra 顶层模块的接口 global 1/14/2017 original pixel data read 从 fetch 取 cur_pixel mode ram 将 pre_intra 得到的 mode 写入 ram, 由 intra 读取 sys_ctrl_if sys_ctrl_if mode ram 5 tq_pred_if Intra 模块预测的数据交给 tq 模块, tq /itq 得到重建像素 tq_rec_if 重建数据写回, 作为相邻块的 ref_data
6 模块接口 ENC_CORE 内部各子模块接口 Ime 顶层模块的接口 Fme 顶层模块的接口 sys_ctrl_if sys_ctrl_if cur_if 原始像素 ime_if cur_if ref_if 前一帧的参考像素 fme_if Partition 和 imv ref_if 1/14/ mc_if 最终的 mv 和 luma 分量的预测像素
7 模块接口 ENC_CORE 内部各子模块接口 Mc 顶层模块的接口 ec_if sys_ctrl_if Tq_pre_if x/y position of ref_if ref lcu in SW (U/V) Tq_rec_if pre_data_o [16*pixel_width-1 :0] 4x4 tq_data fme_if Pred_wr_if Chroma predicted pixel out Pred_rd_if Luma/Chroma predicted pixel in 1/14/2017 7
8 模块接口 ENC_CORE 内部各子模块接口 deblocking 顶层模块的接口 1:previous 0:current Write out pixel Intra/inter if Read the top pixel Mv ram if Tq if 1/14/2017 8
9 模块接口 ENC_CORE 内部各子模块接口 Cabac 顶层模块的接口 Coeff data Intra if Inter if bs buffer full cabac done slice done Bs if Split/skip cbf 1/14/2017 9
10 模块仿真文件 Tb 文件格式 : `define DUMP_FSDB `define XXX_AUTO_CHECK parameter XXX_CHECK_FILE_I // 仿真的输入文件 parameter XXX_CHECK_FILE_O // 仿真的比对文件 Module xxx_tb dut_xxx initial begin 控制仿真的过程块 End Task load; //load 输入数据的任务块 Task run; // 对设计文件请求和应答 (start 和 done 信号 ) `ifdef XXX_AUTO_CHECK..// 设计输出与 CHECK_FILE_O 数据比对 `endif //DISPLY //DUMP_FSDB endmodule 1/14/
11 模块仿真测试文件 -top_module 和各子模块 Top_module `define TEST_I `define_test_p //I 帧和 P 帧是分开单独仿真的./tv/cur_mb_p32.dat./tv/bs_i(p)_check_o.dat 其中 cur_mb_p32.dat 数据格式是 QLCU0_luma // 每行 32pixel QLCU1_luma // 32pixel QLCU2_luma // 32pixel QLCU3_luma // 32pixel QLCU0_chroma//cbcrcbcr.cbcrcbcr 32pixel QLCU1_chroma//cbcrcbcr.cbcrcbcr 32pixel QLCU2_chroma//cbcrcbcr.cbcrcbcr 32pixel QLCU3_chroma//cbcrcbcr.cbcrcbcr 32pixel tv/bs_i(p)_check_o.dat 数据为编码码流 1/14/
12 模块仿真测试文件 -top_module 和各子模块 Intra 模块 :./tv/intra_mode.dat./tv/intra_mode_uv.dat./tv/intra_mb_position.dat./tv/intra_md_decision.dat./tv/intra_rec4x4(8x8,16x16,32x32)(_u,_v).dat./tv/intra_pred4x4(8x8,16x16,32x32)(_u,_v).dat Intra_mode : pre_intra 输出的方向模式, pre_min_size== d0 num=85 in a LCU pre_min_size== d0 num=21 in a LCU Intra_mode_uv: 用于 UV 预测的方向模式 Intra_mb_position: mb_x mb_y mb_x_total, mb_x mb_y mb_x_total,. Intra_md_decision: rec_cover Intra_rec: 经 rec_loop 重建的数据 Intra_pred: 设计文件输出比对的数据 1/14/
13 模块仿真测试文件 -top_module 和各子模块 Ime 模块 :./tv/ime_check_i.dat./tv/ime_check_o.dat 其中 ime_check_i.dat 数据格式 //lcu 0 LCU_luma // 每行 64pixel Ref_luma // 每行 (sw+lcu_size) pixel Ime_check_o.dat 数据格式 //imv data mv8x4_x,mv8x4_y // 按 zig_zag 顺序 lcu 中所有 8x4 块的 imv(x,y) //partition info For loop Ime cu16_mode For loop Ime cu32_mode Ime cu64_mode Case -1: 11 Case 0: 00 Case 1: 01 Case 2: 10 Case 15: xx Default : E! /* Line 64 Line 96 Line 64 Line 96 Line 64 Line */ Lcu0 Lcu1 Lcu2 1/14/
14 模块仿真测试文件 -top_module 和各子模块 Fme 模块 :./tv/fme_input.dat./tv/fme_check.dat 其中 fme_input.dat 数据格式类似 ime 的 cur_mb,ref_mb 以及 ime 的 output mv&partition info fme_check.dat 数据为 luma 分量的 pred_pixel Mc 模块 :./tv/mc_luma_chroma.dat //luma pred & chroma ref./tv/mc_fmv_part.dat./tv/mc_check_uvpred.dat Mc_fmc_part.dat Line1 partition 同 ime_check Line64 fmv mc_check_uvpred 数据为 cb/cr 分量的 pred_pixel 1/14/
15 模块仿真测试文件 -top_module 和各子模块 Db 模块 :./tv/db_input.dat./tv/db_check.dat./tv/db_left_check.dat 其中 db_input.dat 数据格式 : db_check.dat : y_cache[68][68]//16pixel 4x4 block in a line u_cache[34][34] v_cache[34][34] db_left_check.dat //lcu 0 frame_mb_x_total -1 frame_mb_y_total-1 mb_x mb_y qp slice_type is_spilt(16x16,32x32,64x64) mode(16x16,32x32,64x64, size2nx2n,2nxn,nx2n) cbf \n cbf _u \n cbf_v mv mv_top luma pixel (68x68) \n cb pixel \n cr pixel //4x4 block in a line luma_top (4x68)\n cb_top pixel \n cr_top pixel org pixel \n org_u \n org_v 1/14/
16 模块仿真测试文件 -top_module 和各子模块 Cabac 模块 :./tv/cabac_input.dat./tv/bs_check.dat 其中 cabac_input.dat 数据格式 : /* Ctrl_if Sao_if (when sao_open) Intra/inter if (split info,mb_i_luma/chroma_mode,mb_p_luma/chroma_mode) Tq_rdata_i (coeff info,cbf_info) Mb_mvd_rdata_i (mvd&mvp_idx) */ bs_check.dat (bitstream info) 1/14/
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* 1992.10 43 (91.49%) 4 9.51% 26 60.46% 13 4 30.2% 9.31 % 21 6 16 13 45 6 X1=8.16X=40.6 X2 X1 p 0.01 n =43 n =64 51 13 25 18 X1=6.635 X2=18.6 18.6 6.635 P 0.01 n =64 n =43
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