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1 ST 240MHz D/A SFDR 50MH 1MH 70dB 140MH 40HM -53dB RS-343A/RS-170 DA 2mA 26mA TTL / LQFP 3 30mW 3 6mW C +85 DA TTL SYNC 2BLANK 5CMOS CMOS 48 LQFP shenzhenshuianjichengdianlu (1600x1200@0H) 求实创新合作共享

2 AA BLACK SYNC BLACK AND SYNC LOGIC R9-R0 DATA REGISTER DAC IOR IOR G9-G0 DATA REGISTER DAC IOG IOG B9-B0 DATA REGISTER DAC IOB IOB PSAE CLOCK POWER-DOWN MODE OLTAGE REFERENCE CIRCUIT REF GND RSET COMP 求实创新合作共享

3 bi DA B9 B8 B7 B6 B5 B4 B3 B2 B1 B0 48 PSAE RSET REF 1 COMP IOR IOR IOG IOG AA AA IOB IOB GND GND AA B0 B1 B2 B3 B4 B5 B6 B7 B8 B9 CLOCK G0 G1 G2 G3 G4 G5 G6 G7 G8 G9 BLACK SYNC

4 bi DA L L w1 L1 L w H H1 1 3 G0-G9 TTL 1- G0 PCB TTL IORIOB BLANK 11 IOG R0-R9G1-G9B0-B9 SYNC TTL 40 IRE IOG 12 green SYNC 0 13 AA 5 ± 5% AA B0-B9 TTL B0 PCB R0-R9 G1-G9 B0-B9SYNC 24 CLOCK BLANK TTL

5 bi DA 2526 GND 27 IOB RGB RS-343 RS Ω 28 IOB, 75Ω 2930 AA 5 ± 5% AA 31 IOG RGB RS-343 RS Ω 32 IOG 75Ω 33 IOR RGB RS-343 RS Ω 34 IOR 75Ω 35 COMP 0.1u COMP AA REF R SET IOG R SET ( ) ( ) RSET = REF / IOG ma ( ) RSET IORIOB IOR, IOB ( )/ R ( Ω) = REF SET 38 PSAE R0-R9 TTL B0 PCB 2 5 AA = + 5 ± 5%, = 1.235, R = 560Ω, C = uf REF SET L

6 bi DA T o T MAX, TJ = 1 MIN DA Bis INL -1 ± LSB DNL -1 ± LSB IH 2 IL IN ua PSAE 20 ua C IN pf IN = 0. 0 IN = DD ma DAC Sync=High ma R/G/B DAC,Sync=Low DAC DAC % OC R OUT KΩ C OUT pf I OUT = 0mA %FSR DAC Oupu= %FSR FSR=17.62mA REF ma.5 15 ma ma = 240MH

7 bi DA ma 8 ma R SET R SET = 560Ω = 4933Ω ma PSAE=Low, %% DD 5 AA = + 5 ± 5%, = 1.235, R = 560Ω, C = uf REF SET L T MIN o T MAX, TJ = 1 SFDR OUT = 1. 00MH 67 dbc OUT OUT OUT = 0MH OUT = 0MH OUT = 0MH OUT = 0MH OUT = 40. 4MH OUT OUT OUT OUT = 40. 4MH 67 dbc 63 dbc 55 dbc 62 dbc 60 dbc 54 dbc 48 dbc 57 dbc 58 dbc 52 dbc 41 dbc

8 bi DA OUT = 1. 00MH OUT OUT OUT = 0MH OUT = 0MH OUT = 0MH OUT = 0MH OUT = 40. 4MH OUT OUT OUT OUT = 40. 4MH 50MH = OUT 1. 00MH 50MH = OUT 5. 04MH = 1MH = 2MH OUT 4MH 50MH = OUT 1. 00MH 50MH = OUT 5. 00MH = 1MH = 2MH OUT = 5. 00MH 4MH 70 dbc 70 dbc 65 dbc 54 dbc 67 dbc 63 dbc 58 dbc 52 dbc 62 dbc 61 dbc 55 dbc 53 dbc 77 dbc 73 dbc 64 dbc 74 dbc 73 dbc 60 dbc

9 bi DA THD 50MH = OUT 1. 00MH 50MH = T = + 25 = OUT = 1. 00MH MIN 50MH = OUT = 2. 00MH = 0MH OUT = 2. 00MH OUT = 2. 00MH A T o T MAX 66 dbc 65 dbc 64 dbc 63 dbc 55 dbc DAC ps DACu crossalk 23 db 22 db 33 db 5 AA = + 5 ± 5%, = 1.235, R = 560Ω, C = uf REF SET L T MIN o T MAX, TJ = ns 4 7 / ns 15 ns 1 2 ns MHz 50MHz Grade MHz 140MHz Grade MHz 240MHz Grade

10 bi DA ns 2.5 ns ns ns 2.85 ns 2.85 ns 8.0 ns 8.0 ns MAX = 240MHz MAX = 240MHz MAX = 140MHz MAX = 140MHz MAX = 50MHz MAX = 50MHz 6 PD Pipeline 6 PSAE, ns 3 CLOCK 4 5 DIGITAL INPUTS (R9R0G9G0B9B0 SYNCBLACK ANALOG OUTPUTS (IORIOGIOB IORIOGIOB DATA AA = + 5 ± 5%, = 1.235, R = 560Ω, C = uf REF SET L T MIN o T MAX, TJ = 1 DA Bis INL -1 ± LSB

11 bi DA DNL -1 ± LSB IH IL IN ua PSAE 20 ua C IN pf IN = 0. 0 IN = DD ma DAC Sync=High ma R/G/B DAC,Sync=Low DAC DAC % OC R OUT KΩ C OUT pf I OUT = 0mA %FSR DAC Oupu= %FSR FSR=17.62mA REF ma.5 15 ma ma = 240MH ma 8 ma R SET R SET = 560Ω = 4933Ω ma PSAE=Low, %% DD

12 bi DA 3.3 AA = + 5 ± 5%, = 1.235, R = 560Ω, C = uf REF SET L T MIN o T MAX, TJ = 1 SFDR OUT = 1. 00MH 67 dbc OUT OUT OUT = 0MH OUT = 0MH OUT = 0MH OUT = 0MH OUT = 40. 4MH OUT OUT OUT OUT = 40. 4MH OUT = 1. 00MH OUT OUT 67 dbc 63 dbc 55 dbc 62 dbc 60 dbc 54 dbc 48 dbc 57 dbc 58 dbc 52 dbc 41 dbc 70 dbc 70 dbc 65 dbc

13 bi DA OUT = 0MH OUT = 0MH OUT = 0MH OUT = 0MH OUT = 40. 4MH OUT OUT OUT OUT = 40. 4MH 50MH = 00MH 1MH = OUT 1. 50MH = 04 2MH = OUT 5. MH OUT 4MH 50MH = 00MH 1MH = OUT 1. 50MH = 00MH 2MH = OUT 5. OUT = 5. 00MH 4MH THD 50MH = 00MH T = + 25 = OUT 1. 50MH 00MH = OUT = 1. MIN 50MH 00 = OUT = 2. MH A T o T MAX 54 dbc 67 dbc 63 dbc 58 dbc 52 dbc 62 dbc 61 dbc 55 dbc 53 dbc 77 dbc 73 dbc 64 dbc 74 dbc 73 dbc 60 dbc 66 dbc 65 dbc 64 dbc

14 bi DA = 0MH OUT = 2. 00MH OUT = 2. 00MH 64 dbc 55 dbc DAC ps DACu crossalk 23 db 22 db 33 db 3.3 AA = + 5 ± 5%, = 1.235, R = 560Ω, C = uf REF SET L T MIN o T MAX, TJ = ns 4 7 / ns 15 ns 1 2 ns MHz 50MHz Grade MHz 140MHz Grade MHz 240MHz Grade 1.5 ns 2.5 ns ns ns 2.85 ns MAX = 240MHz MAX = 240MHz MAX = 140MHz

15 bi DA ns 8.0 ns 8.0 ns MAX = 140MHz MAX = 50MHz MAX = 50MHz 6 PD Pipeline 6 PSAE, ns 3 CLOCK 4 5 DIGITAL INPUTS (R9R0G9G0B9B0 SYNCBLACK ANALOG OUTPUTS (IORIOGIOB IORIOGIOB DATA D/A 30 R0-R9G0-G9,B0-B9 DAC CLOCK DIGITAL INPUTS (R9R0G9G0B9B0 SYNCBLACK ANALOG OUTPUTS (IORIOGIOB IORIOGIOB BLANK SYNC BLANK SYNC RGB

16 bi DA BLANK SYNC 5 RGB BLANK SYNC 1 BLANK SYNC TTL RED,BLUE ma GREEN ma WHITE LEEL 0 IRE IRE REF1.235,RSET=530 BLANK LEEL SYNC LEEL 5 RGB 1 R = 530Ω R = 37. 5Ω SET LOAD IOG (ma) IOG (ma) IOR / IOB IOR / IOB SYNC BLANK DAC WHITE LEEL FFH IDEO ideo ideo ideo ideo 1 1 Daa IDEO o BLANK ideo ideo ideo ideo 0 1 Daa BLACK LEEL H BLACK o BLANK H BLANK LEEL xxxh SYNC LEEL xxxh do rae Do Rae=(Hor z Res) (er Res) (Reresh Rae)/(Rerace Facor) Horiz Res =Number o Pixels/line.( ) er Res = Number o Pixels/Frame.( ) Reresh Rae = 60Hz 30Hz Rerace acor = Hz 0.8

17 bi DA Do Rae = / 0. 8 =76.8MHz 78.6MHz TTL 74F244 SYNC HSYNC SYNC SYNC SYNC IOG SYNC 0.1uF 1.23 AD1580 R SET REF R SET ( )/ R ( ) IOG ( ma) Ω = REF SET ( ) R ( Ω) IOR, IOB = REF / SET ( ) R 22 SET D/A D/A bi=1 0 DAC RGB 37.5Ω 75Ω 6 RGB 75Ω 75Ω RS-343A RS Ω 7DAC DAC 75Ω Ω 150 s RS-343A RS-170 DA ideo

18 3 0bi A Formas&Required Load Terminaions 21 RGB 22a 75Ω SYNC BLANK I SYNC BLANK DACs s=75ω (SOURCE TERMINATION) IOR,IOG,IOB o=75ω (CABLE) L=75Ω (MONITOR) TERMINATION REPEATED THREE TIMES FOR RED, GREEN AND BLUE DACs 6 RS-343A DACs s=150ω (SOURCE TERMINATION) IOR,IOG,IOB o=75ω (CABLE) L=150Ω (MONITOR) TERMINATION REPEATED THREE TIMES FOR RED, GREEN AND BLUE DACs 7 RS-170A RED,GREEN,BULE 0 IOR 75Ω Ω 37.5 IOB IOG Ω AD AD84x 80MHz AD9617

19 三路 bi 高速视频 DA 转换器 shenzhenshuianjichengdianlu 缓冲运放的使用 也必须满足除了 RS-343A 和 RS-170 之外的其它视频标准 改变缓冲电路的增益器件应 满足所要求的视频电平 PCB 的考虑 是优化设计了的 针对最低噪声性能 包括幅射和传导干扰噪声 为了实现的最优噪声性 能 对 PCB 的设计必须特别注意 图 25 显出了 的推荐连接图 对于的电源和地线上的噪 声应该优化 可以通过屏蔽数字输入和提供好的退耦达到这一点 AA 和 GND 的引线长度应该尽量的短 这个可以减小电感环路 地平面 和相关的模拟电路 以模拟地做参考 应该有各自独立的地线 地线应该通过一个单端的铁氧体 磁珠与 PCB 的地相连 可参照图 25 这个磁珠应该尽可能的靠近 如三英寸 电源面 PCB 板应该有两个独立的电源线 一个是模拟电源 一个是数字电源 模拟电源应该包括的 AA 和所有的其它相关模拟电路 电源面的一端应该通过一个铁氧珠与常规的 PCB 板电源相连 见插图 25 这个铁氧体应该离在三英寸以内 PCB 板的电源面 应该为所有的数字逻辑电源提供电源 模拟电源面应该为电源脚 电压参考电 路 和其它输出运放提供电源 PCB 的电源和地平面不应该覆盖模拟电源区域 保证 PCB 的电源和地与模拟电源分开 这样可以减少面 与面之间的噪声耦合 电源退耦 模拟电源的噪声可以通过多个退耦电容的使用进一步减少 参考图 25 使用 0.1uF 的陶瓷电容可以得到最佳性能 两组电源 AA 应该分别到地退耦 电容应该尽可能的靠近 器件 并且电容的引线应该尽可能的短 这样可以减小引线电容 需要说明的是 包含了电路去抑制电源 这一点非常重要 这种抑制随着频率的增加而减小 如 果使用的是高频开关电源 设计者应该对减少电源噪声这一点多注意一下 dc 电源滤波器 Muraa BNX002 在电源和主 PCB 之间 提供 EMI 电磁干扰 抑制 择中的办法 使 用一个三端电源调整器值得考虑 数字信号的相互连接 到的数字信号线 应该尽可能的与模拟输出和其它模拟电路分开 数字信号线不应该与模拟电源 平面覆盖 由于使用的时钟频率比较高 因此到的长的时钟线应该尽量避免 这样可以减小噪声的抖动 针 对数字有源上拉电阻应该与通用 PCB 电源 CC 相连 而不是和模拟电源平面相连 模拟信号的互连 应该尽可能的靠近输出端 这样可以减少由于阻抗的不匹配而引起的噪声和抖动和反射 视频输出信号应该由地平面覆盖 而不是由模拟电源平面覆盖 这样可以增大高频电源抑制比 为了优化性能 第一个模拟输出应该有一个到地的源端电阻 75Ω 这个终端的电阻应该尽可能的离 近 这样可以减小反射 PCB 的设计其它附带标题为 design and layou o a ideo a Graphics Sysem or Reduced EMI. 应用手册有 说明 应用手册来自于 AD 公司 版号为 no.e /89 求实 创新 合作 共享 电话

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文件编号 GM7123 3 This specification are subject to be changed without notice. Any latest information please preview http://www.fosvos.com DATA SHEET GM7123 3 2010.07 +86-21-58998693/58994470 This specification

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