(19) 中华人民共和国国家知识产权局 (12) 发明专利 (21) 申请号 X (22) 申请日 (65) 同一申请的已公布的文献号申请公布号 CN A (10) 授权公告号 CN B (45) 授权公告日 2
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1 (19) 中华人民共和国国家知识产权局 (12) 发明专利 (21) 申请号 X (22) 申请日 (65) 同一申请的已公布的文献号申请公布号 CN A (10) 授权公告号 (45) 授权公告日 (51)Int.Cl. H03M 13/27 ( ) H03M 13/00( ) 审查员刘晴晴 (43) 申请公布日 (73) 专利权人芯原微电子 ( 成都 ) 有限公司地址 四川省成都高新区天华二路 219 号天府软件园 C 区 10 栋 23 层 2301 房号专利权人芯原微电子 ( 上海 ) 股份有限公司芯原微电子 ( 北京 ) 有限公司 (72) 发明人蒋祥顺曾毅 (74) 专利代理机构上海光华专利事务所 ( 普通 代理人余明伟 合伙 ) 权利要求书 2 页 8 页附图 3 页 (54) 发明名称一种 Turbo 译码器及译码方法 (57) 摘要本发明提供一种 Turbo 译码器及译码方法, 包括 : 藉由输入缓冲电路 第一多路复用电路 软输入缓冲电路接收地址信息及软信息, 将软信息分为多路并行信号 ; 藉由各软输入软输出译码电路对多路信号进行并行译码 ; 藉由数据缓存电路 外信息缓冲电路对译码得到的外信号进行延迟缓存和读取, 避免并行译码过程中对存储器读写的冲突, 然后再次藉由各软输入软输出译码电路进行并行译码, 如此循环, 通过多次迭代实现译码 本发明使用并行双向迭代的 Max Log Map 算法, 有效地提高的 Turbo 译码的吞吐量和译码时延 ; 同时实现了 WCMDA 的并行译码, 大大降低了 WCDMA 的译码延时, 使硬件资源得到充分复用
2 权利要求书 1/2 页 1. 一种 Turbo 译码器, 适于 WCDMA 系统, 其特征在于, 所述 Turbo 译码器至少包括 : 输入缓冲电路 第一多路复用电路 N 个软输入缓冲电路 第二多路复用电路 N 个软输入软输出译码电路 第三多路复用电路 N 个数据缓存电路 N 个外信息缓冲电路 N 个硬判决电路 N 个软输出缓冲电路及控制电路 ; 所述输入缓冲电路用于接收地址信息及软信息 ; 所述第一多路复用电路连接于所述输入缓冲电路的输出端, 用于将软信息根据输入的地址信息并行送入多个所述软输入缓冲电路中 ; 各软输入缓冲电路连接于所述第一多路复用电路的输出端, 用于对输入的多路软信息进行缓存 ; 所述第二多路复用电路连接于多个所述软输入缓冲电路的输出端, 用于将多路软信息并行送入多个所述软输入软输出译码电路中 ; 各软输入软输出译码电路连接于所述第二多路复用电路的输出端, 用于对输入的软信息进行译码转换为外信息, 经过多次迭代实现译码 ; 所述软输入软输出译码电路包括正向迭代单元和反向迭代单元 ; 所述正向迭代单元包括第一分支度量模块 第一状态度量模块 第一外信息度量模块及第一加法模块 ; 所述反向迭代单元包括第二分支度量模块 第二状态度量模块 第二外信息度量模块及第二加法模块 ; 所述第一分支度量模块接收并对正向软信息及正向外信息进行分支度量计算 ; 所述第一状态度量模块连接所述第一分支度量模块的输出端, 其输出信号连接至存储器中, 用于进行状态度量计算 ; 所述第一外信息度量模块连接所述第一状态度量模块 所述第二分支度量模块及所述存储器的输出端, 用于进行外信息度量计算 ; 所述第一加法模块连接所述第一外信息度量模块的输出端, 实现所述第一外信息度量模块输出的外信息与正向外信息的加法操作 ; 所述第二分支度量模块接收并对反向软信息及反向外信息进行分支度量计算 ; 所述第二状态度量模块连接所述第二分支度量模块的输出端, 其输出信号连接至存储器中, 用于进行状态度量计算 ; 所述第二外信息度量模块连接所述第二状态度量模块 所述第一分支度量模块及所述存储器的输出端, 用于进行外信息度量计算 ; 所述第二加法模块连接所述第二外信息度量模块的输出端, 实现所述第二外信息度量模块输出的外信息与反向外信息的加法操作 ; 所述第三多路复用电路连接于各软输入软输出译码电路及各数据缓存电路之间, 用于实现各软输入软输出译码电路与各数据缓存电路之间的数据传输 ; 所述数据缓存电路连接于各软输入软输出译码电路与各外信息缓冲电路, 用于对各软输入软输出译码电路与各外信息缓冲电路之间传输的数据进行并行写入和读取 ; 所述外信息缓冲电路用于缓存各软输入软输出译码电路输出的外信息, 并回传给各软输入软输出译码电路, 以实现多次迭代 ; 所述硬判决电路连接于所述第三多路复用电路的输出端, 对所述第三多路复用电路的输出信号电平进行检测 ; 所述软输出缓冲电路连接于各硬判决电路的输出端, 用于输出译码结果 ; 所述控制电路为各电路提供控制信号 2. 根据权利要求 1 所述的 Turbo 译码器, 其特征在于 : 所述控制电路包括交织器 并行控制单元 控制和状态寄存单元 ; 所述交织器连接于所述控制和状态寄存单元的输出端, 通过地址变化控制所述第一多路复用电路 所述第二多路复用电路及所述第三多路复用电路协 2
3 权利要求书 2/2 页 同工作 ; 所述并行控制单元连接于所述控制和状态寄存单元的输出端, 用于为各软输入软输出译码电路提供控制信号 3. 根据权利要求 1 所述的 Turbo 译码器, 其特征在于 : 所述数据缓存电路为先进先出队列缓存器 4. 根据权利要求 1 或 3 所述的 Turbo 译码器, 其特征在于 : 所述数据缓存电路包括 N 个子数据缓存器, 各子数据缓存器包括 3 个缓存单元, 其中, 第一缓存单元用于缓存所述软输入软输出译码电路写入所述外信息缓冲电路中的地址信息及外信息 ; 第二缓存单元用于缓存所述软输入软输出译码电路读取所述外信息缓冲电路的地址信息 ; 第三缓存单元用于缓存所述软输入软输出译码电路从所述外信息缓冲电路中读出的外信息 5. 根据权利要求 1 所述的 Turbo 译码器, 其特征在于 : 所述 Turbo 译码器还包括连接于所述软输出缓冲电路输出端的循环冗余校验电路, 通过冗余校验对译码结果进行检查 6. 一种 Turbo 译码方法, 基于如权利要求 1 5 任意一项所述的 Turbo 译码器实现, 其特征在于, 所述 Turbo 译码方法包括 : 接收地址信息及软信息, 将地址信息及软信息分为多路并行信号, 对多路信号进行并行译码, 分别对译码得到的外信号进行延迟缓存和读取, 避免并行译码过程中对存储器读写的冲突, 然后再次进行并行译码, 如此循环, 通过多次迭代实现译码 7. 根据权利要求 6 所述的 Turbo 译码方法, 其特征在于 : 所述 Turbo 译码方法采用双向迭代的 Max Log Map 算法 8. 根据权利要求 6 所述的 Turbo 译码方法, 其特征在于 : 所述 Turbo 译码方法具体方法包括 : 缓存地址信息 : 将外信息通过第一先进先出队列缓存单元存入外信息缓冲电路 ; 读取外信息 : 将地址信息存入第二先进先出队列缓存单元, 根据地址信息从外信息缓冲电路中读取外信息并存入第三先进先出队列缓存单元 3
4 1/8 页 一种 Turbo 译码器及译码方法 技术领域 [0001] 本发明涉及通讯技术领域, 特别是涉及一种 Turbo 译码器及译码方法 背景技术 [0002] Turbo 码又被称为并行级联卷积码 (Parallel Concatenated Convolutional Code,PCCC), 它将卷积码和随机交织器结合在一起, 充分应用了随机化编码条件, 通过交织器实现由短码构造长码, 并采用软输出迭代译码来逼近最大似然译码, 从而获得几乎接近 Shannon 理论极限的译码性能 Turbo 码被大量应用在无线通信领域, 包括通讯卫星, 数字图像传输, 第三代移动电话等 [0003] 图 1 所示为常用的应用于 LTE(Long Term Evolution, 长期演进技术 ) 及 WCDMA (Wideband Code Division Multiple Access, 宽带码分多址 ) 领域的卷积 Turbo 编码器, 其具体结构如下 : 第一子编码器 11 和第二子编码器 12 的结构相同, 中间通过交织器 13 连接, 第一子编码器 11 和第二子编码器 12 均采用递归系统码 (Recursive Systematic Code,RSC) 结构, 包括多个加法单元和延迟单元, 二进制信息流 C k 直接输入给第一子编码器 11, 产生校验比特数据 Z k, 二进制信息流 Ck 经交织器 13 交织后再输入给第二子编码器 12 进行编码, 相应地产生校验比特数据 Z k, 编码后生成的码字包含原信息序列 X k 以及两个子编码器生成的校验序列 Z k 和 Z k, 即生成的码字为 {X k,z k,z k } [0004] LTE 和 WCDMA 系统中均采用图 1 结构的卷积 Turbo 编码器, 仅仅内部交织器 13(Turbo code internal interleaver) 有差异 LTE 采用特殊设计的 QPP(Quadratic Polynomial Permutation, 二次置换多项式 ) 交织器, 该交织器可保证并行译码过程中, 对存储器 (memory) 的读写不会有冲突 所以, 在 LTE 系统中一般采用并行译码技术以减低译码延时 然而,WCDMA 系统中无法采用 QPP 交织器, 而一般交织器不能够避免并行译码中存储器访问的冲突,WCDMA 系统一般只采用串行译码, 即使有多个译码硬件资源, 也只能对多码块并行处理, 而不能对单码块分段并行译码 因此, 普通的 WCDMA 译码器不能有效降低译码延时 [0005] 因此, 如何降低 WCDMA 系统的译码延时, 提高 Turbo 译码器的吞吐量, 已成为本领域技术人员亟待解决的问题之一 发明内容 [0006] 鉴于以上所述现有技术的缺点, 本发明的目的在于提供一种 Turbo 译码器及译码方法, 用于解决现有技术中 Turbo 译码器的吞吐量小, 译码延时长等问题 [0007] 为实现上述目的及其他相关目的, 本发明提供一种 Turbo 译码器, 所述 Turbo 译码器至少包括 : [0008] 输入缓冲电路 第一多路复用电路 N 个软输入缓冲电路 第二多路复用电路 N 个软输入软输出译码电路 第三多路复用电路 N 个数据缓存电路 N 个外信息缓冲电路 N 个软输出缓冲电路及控制电路 ; [0009] 所述输入缓冲电路用于接收地址信息及软信息 ; 4
5 2/8 页 [0010] 所述第一多路复用电路连接于所述输入缓冲电路的输出端, 用于将输入软信息根据输入的地址信息并行送入多个所述软输入缓冲电路中 ; [0011] 各软输入缓冲电路连接于所述第一多路复用电路的输出端, 用于对输入的多路软信息进行缓存 ; [0012] 所述第二多路复用电路连接于多个所述软输入缓冲电路的输出端, 用于将多路并行送入多个所述软输入软输出译码电路中 ; [0013] 各软输入软输出译码电路连接于所述第二多路复用电路的输出端, 用于对输入的软信息进行译码转换为外信息, 经过多次迭代实现译码 ; [0014] 所述第三多路复用电路连接于各软输入软输出译码电路及各数据缓存电路之间, 用于实现各软输入软输出译码电路与各数据缓存电路之间的数据传输 ; [0015] 所述数据缓存电路连接于各软输入软输出译码电路与各外信息缓冲电路, 用于对各软输入软输出译码电路与各外信息缓冲电路之间传输的数据进行并行写入和读取 ; [0016] 所述外信息缓冲电路用于缓存各软输入软输出译码电路输出的外信息, 并回传给各软输入软输出译码电路, 以实现多次迭代 ; [0017] 所述软输出缓冲电路连接于所述第三多路复用电路的输出端, 用于输出译码结果 ; [0018] 所述控制电路为各电路提供控制信号 [0019] 优选地, 所述软输入软输出译码电路包括正向迭代单元和反向迭代单元 ; 所述正向迭代单元包括第一分支度量模块 第一状态度量模块 第一外信息度量模块及第一加法模块 ; 所述反向迭代单元包括第二分支度量模块 第二状态度量模块 第二外信息度量模块及第二加法模块 ; [0020] 所述第一分支度量模块接收并对正向软信息及正向外信息进行分支度量计算 ; 所述第一状态度量模块连接所述第一分支度量模块的输出端, 其输出信号连接至存储器中, 用于进行状态度量计算 ; 所述第一外信息度量模块连接所述第一状态度量模块 所述第二分支度量模块及所述存储器的输出端, 用于进行外信息度量计算 ; 所述第一加法模块连接所述第一外信息度量模块的输出端, 实现所述第一外信息度量模块输出的外信息与正向外信息的加法操作 ; [0021] 所述第二分支度量模块接收并对反向软信息及反向外信息进行分支度量计算 ; 所述第二状态度量模块连接所述第二分支度量模块的输出端, 其输出信号连接至存储器中, 用于进行状态度量计算 ; 所述第二外信息度量模块连接所述第二状态度量模块 所述第一分支度量模块及所述存储器的输出端, 用于进行外信息度量计算 ; 所述第二加法模块连接所述第二外信息度量模块的输出端, 实现所述第二外信息度量模块输出的外信息与反向外信息的加法操作 [0022] 优选地, 所述控制电路包括交织器 并行控制单元 控制和状态寄存单元 ; 所述交织器连接于所述控制和状态寄存单元的输出端, 通过地址变化控制所述第一多路复用电路 所述第二多路复用电路及所述第三多路复用电路协同工作 ; 所述并行控制单元连接于所述控制和状态寄存单元的输出端, 用于为各软输入软输出译码电路提供控制信号 [0023] 优选地, 所述数据缓存电路为先进先出队列缓存器 [0024] 更优选地, 所述数据缓存电路包括 N 个子数据缓存器, 各子数据缓存器包括 3 个缓 5
6 3/8 页 存单元, 其中, 第一缓存单元用于缓存所述软输入软输出译码电路写入所述外信息缓冲电路中的地址信息及外信息 ; 第二缓存单元用于缓存所述软输入软输出译码电路读取所述外信息缓冲电路的地址信息 ; 第三缓存部分用于缓存所述外信息缓冲电路传回所述软输入软输出译码电路的外信息 [0025] 优选地, 所述 Turbo 译码器还包括连接于所述软输出缓冲电路输出端的循环冗余校验电路, 通过冗余校验对译码结果进行检查 [0026] 为实现上述目的及其他相关目的, 本发明还提供一种 Turbo 译码方法, 所述 Turbo 译码方法至少包括 : [0027] 接收地址信息及软信息, 将地址信息及软信息分为多路并行信号, 对多路信号进行并行译码, 分别对译码得到的外信号和地址信号进行延迟缓存和读取, 避免并行译码过程中对存储器读写的冲突, 然后再次进行并行译码, 如此循环, 通过多次迭代实现伪随机译码 [0028] 优选地, 所述 Turbo 译码方法采用双向迭代的 Max Log Map 算法 [0029] 优选地, 所述 Turbo 译码方法具体方法包括 : [0030] 缓存地址信息 : 将外信息通过第一先进先出队列缓存单元存入外信息缓冲电路 ; [0031] 读取外信息 : 将地址信息存入第二先进先出队列缓存单元, 根据地址信息从外信息缓冲电路中读取外信息并存入第三先进先出队列缓存单元 [0032] 如上所述, 本发明的 Turbo 译码器及译码方法, 具有以下有益效果 : [0033] 本发明的 Turbo 译码器及译码方法使用并行双向迭代的 Max Log Map 算法, 有效地提高的 Turbo 译码的吞吐量和译码时延 ; 同时实现了 WCMDA 的并行译码, 大大降低了 WCDMA 的译码延时, 使硬件资源得到充分复用 附图说明 [0034] 图 1 显示为现有技术中的卷积 Turbo 编码器的结构示意图 [0035] 图 2 显示为本发明的 Turbo 译码器的结构示意图 [0036] 图 3 显示为本发明的软输入软输出译码电路的结构示意图 [0037] 元件标号说明 [0038] 11 第一子编码器 [0039] 12 第二子编码器 [0040] 13 交织器 [0041] 201 混合自动重传请求电路 [0042] 202 接口电路 [0043] 203 系统状态寄存器 [0044] 204 数字信号处理器 [0045] 21 输入缓冲电路 [0046] 221~224 第一 ~ 第四多路复用电路 [0047] 231 软输入缓冲电路 [0048] 232 软输出缓冲电路 [0049] 24 软输入软输出译码电路 6
7 4/8 页 [0050] 正向迭代单元 反向迭代单元 [0051] 第一 ~ 第二分支度量模块 [0052] 第一 ~ 第二状态度量模块 [0053] 第一 ~ 第二外信息度量模块 [0054] 第一 ~ 第二加法模块 [0055] 243 存储器 [0056] 25 数据缓存电路 [0057] 26 外信息缓冲电路 [0058] 27 硬判决电路 [0059] 28 控制电路 [0060] 281 输入输出控制单元 [0061] 282 输出缓冲单元 [0062] 283 控制和状态寄存单元 [0063] 284 交织器 [0064] 285 并行控制单元 [0065] 29 循环冗余校验电路 具体实施方式 [0066] 以下通过特定的具体实例说明本发明的实施方式, 本领域技术人员可由本所揭露的内容轻易地了解本发明的其他优点与功效 本发明还可以通过另外不同的具体实施方式加以实施或应用, 本中的各项细节也可以基于不同观点与应用, 在没有背离本发明的精神下进行各种修饰或改变 [0067] 请参阅图 2~ 图 3 需要说明的是, 本实施例中所提供的图示仅以示意方式说明本发明的基本构想, 遂图式中仅显示与本发明中有关的组件而非按照实际实施时的组件数目 形状及尺寸绘制, 其实际实施时各组件的型态 数量及比例可为一种随意的改变, 且其组件布局型态也可能更为复杂 [0068] 如图 2 所示, 本发明提供一种 Turbo 译码器, 所述 Turbo 译码器至少包括 : [0069] 混合自动重传请求电路 201 输入缓冲电路 21 第一多路复用电路 个软输入缓冲电路 231 第二多路复用电路 个软输入软输出译码电路 24 第三多路复用电路 个数据缓存电路 25 4 个外信息缓冲电路 26 4 个硬判决电路 27 4 个软输出缓冲电路 232 第四多路复用电路 224 控制电路 28 接口电路 202 系统状态寄存器 203 数字信号处理器 204 [0070] 如图 2 所示, 所述混合自动重传请求电路 201 连接于所述输入缓冲电路 21 的输入端, 同时连接所述控制电路 28, 受所述控制电路 28 的控制, 在输入信息出错时重新输入信号, 在本实施例中, 输入信息包括软信息 LLR[63:0] 及地址信息 Addr[12:0] [0071] 如图 2 所示, 所述输入缓冲电路 21 用于接收地址信息及软信息 [0072] 如图 2 所示, 所述第一多路复用电路 221 连接于所述输入缓冲电路 21 的输出端, 用于将软信息根据输入的地址信息并行送入多个所述软输入缓冲电路 231 中 [0073] 具体地, 在本实施例中, 所述第一多路复用电路 221 为 4 路复用电路, 在实际使用 7
8 5/8 页 中, 可根据具体需要设定, 不以本实施例为限 所述第一多路复用电路 221 将收到的信息分 为 4 段进行并行处理 [0074] 如图 2 所示, 各软输入缓冲电路 231 连接于所述第一多路复用电路 221 的输出端, 用 于对输入的多路软信息进行缓存 [0075] 具体地, 在本实施例中, 所述软输入缓冲电路 231 设定为 4 路, 分别为第一软输入缓 冲电路 第二软输入缓冲电路 第三软输入缓冲电路 第四软输入缓冲电路 在实际使用中, 可根据具体需要设定, 不以本实施例为限 [0076] 如图 2 所示, 所述第二多路复用电路 222 连接于多个所述软输入缓冲电路 231 的输 出端, 用于将多路软信息并行送入多个所述软输入软输出译码电路 24 中 [0077] 具体地, 在本实施例中, 所述第二多路复用电路 222 为 4 路复用电路 [0078] 如图 2 所示, 各软输入软输出译码电路 24 连接于所述第二多路复用电路 222 的输出 端, 用于对输入的软信息进行译码转换为外信息, 经过多次迭代实现译码 [0079] 具体地, 在本实施例中, 所述软输入软输出译码电路 24 设定为 4 路, 分别为第一软 输入软输出译码电路 第二软输入软输出译码电路 第三软输入软输出译码电路 第四软输 入软输出译码电路 如图 3 所示, 各软输入软输出译码电路 24 包括正向迭代单元 241 和反向 迭代单元 242 所述正向迭代单元 241 包括第一分支度量模块 2411 第一状态度量模块 2412 第一外信息度量模块 2413 及第一加法模块 2414; 所述反向迭代单元 242 包括第二分支度量 模块 2421 第二状态度量模块 2422 第二外信息度量模块 2423 及第二加法模块 2424 所述第 一分支度量模块 2411 接收并对正向软信息 Lxf_i Lzf_i 及正向外信息 Lpf_i 进行分支度量 γ k 计算, 其中,k=0,1,N 1; 所述第一状态度量模块 2412 连接所述第一分支度量模块 2411 的输出端, 其输出信号连接至存储器 243 中, 用于进行状态度量 α 计算 ; 所述第一外信息 度量模块 2413 连接所述第一状态度量模块 2412 所述第二分支度量模块 2421 及所述存储器 243 的输出端, 用于进行外信息度量 LLR k (x) 计算, 其中,k=N/2 1,...,0; 所述第一加法 模块 2414 连接所述第一外信息度量模块 2413 的输出端, 实现所述第一外信息度量模块 2413 输出的外信息与正向外信息的加法操作 所述第二分支度量模块 2421 接收并对反向软信息 Lxb_i Lzb_i 及反向外信息 Lpb_i 进行分支度量 γ k 计算, 其中,k=N 1, 1,0; 所述第二 状态度量模块 2422 连接所述第二分支度量模块 2421 的输出端, 其输出信号连接至存储器 243 中, 用于进行状态度量 β 计算 ; 所述第二外信息度量模块 2423 连接所述第二状态度量模 块 2422 所述第一分支度量模块 2411 及所述存储器 243 的输出端, 用于进行外信息度量 LLR k (x) 计算, 其中,k=N/2,,N 1; 所述第二加法模块 2424 连接所述第二外信息度量模块 2423 的输出端, 实现所述第二外信息度量模块 2423 输出的外信息与反向外信息的加法操 作 [0080] 具体地, 所述软输入软输出译码电路 24 通过双向迭代的 Max Log Map 算法实现译 码, 所述正向迭代单元进行正向迭代, 所述反向迭代单元进行反向迭代, 当两部分交叠时 ( 迭代了 N/2 步 ), 进行外信息计算, 所述软输入软输出译码电路 24 只需要 N 个 cycle 就可完成 一次半迭代, 比单向迭代方式可减少一半的时延 [0081] 如图 2 所示, 所述第三多路复用电路 223 连接于各软输入软输出译码电路 24 及各数 据缓存电路 25 之间, 用于实现各软输入软输出译码电路 24 与各数据缓存电路 25 之间的数据 传输 8
9 6/8 页 [0082] 具体地, 在本实施例中, 所述第三多路复用电路 223 为 4 路复用电路 [0083] 如图 2 所示, 所述数据缓存电路 25 连接于各软输入软输出译码电路 24 与各外信息缓冲电路 26, 用于对各软输入软输出译码电路 24 与各外信息缓冲电路 26 之间传输的数据进行并行写入和读取 [0084] 具体地, 在本实施例中, 所述数据缓存电路 25 设定为 4 路, 分别为第一数据缓存电路 第二数据缓存电路 第三数据缓存电路 第四数据缓存电路 各数据缓存电路为先进先出队列缓存器 各数据缓存电路包括 4 个子数据缓存器, 各子数据缓存器均为先进先出队列缓存器, 包括 3 个缓存单元, 其中, 第一缓存单元 FIFO_write 用于缓存所述软输入软输出译码电路 24 写入所述外信息缓冲电路 26 中的地址信息及外信息 ; 第二缓存单元 FIFO_read_ addr 用于缓存所述软输入软输出译码电路 24 读取所述外信息缓冲电路 26 的地址信息 ; 第三缓存单元 FIFO_read_Lext 用于缓存所述软输入软输出译码电路 24 从所述外信息缓冲电路 26 中读出的外信息 [0085] 如图 2 所示, 所述外信息缓冲电路 26 用于缓存各软输入软输出译码电路 24 输出的外信息, 并回传给各软输入软输出译码电路 24, 以实现多次迭代 [0086] 如图 2 所示, 各硬判决电路 27 连接于所述第三多路复用电路 223 的输出端, 对输出信号的 0 1 电平进行检测 [0087] 具体地, 在本实施例中, 所述硬判决电路 27 设定为 4 路, 分别为第一硬判决电路 第二硬判决电路 第三硬判决电路 第四硬判决电路 [0088] 如图 2 所示, 所述软输出缓冲电路 232 连接于所述硬判决电路 27 的输出端, 用于输出译码结果 [0089] 具体地, 在本实施例中, 所述软输出缓冲电路 232 设定为 4 路, 分别为第一软输出缓冲电路 第二软输出缓冲电路 第三软输出缓冲电路 第四软输出缓冲电路 [0090] 如图 2 所示, 所述第四多路复用电路 224 连接于所述软输出缓冲电路 232 的输出端, 用于分别输出译码结果 [0091] 如图 2 所示, 所述循环冗余校验电路 29 连接于所述软输出缓冲电路 232 的输出端, 通过冗余校验对译码结果进行检查 [0092] 如图 2 所示, 所述控制电路 28 连接所述第四多路复用电路 224 所述循环冗余校验电路 29 的输出端, 为各电路提供控制信号 [0093] 具体地, 如图 2 所示, 所述控制电路 28 包括交织器 284 并行控制单元 285 控制和状态寄存单元 283 输入输出控制单元 281 及输出缓冲单元 282 所述输入输出控制单元 281 连接于所述控制和状态寄存单元 283 的输出端, 为所述输出缓冲单元 282 提供控制信号 所述输出缓冲单元 282 连接所述第四多路复用电路 224 的输出端, 向外电路输出译码结果 所述交织器 284 连接于所述控制和状态寄存单元 283 的输出端, 通过地址变化控制所述第一多路复用电路 221 所述第二多路复用电路 222 及所述第三多路复用电路 223 协同工作 所述并行控制单元 285 连接于所述控制和状态寄存单元 283 的输出端, 用于为各软输入软输出译码电路 24 提供控制信号 [0094] 如图 2 所示, 所述接口电路 202 连接于所述控制电路 28, 为所述 Turbo 译码器提供输入输出接口 [0095] 如图 2 所示, 所述系统状态寄存器 203 连接所述控制电路 28, 用于存储所述 Turbo 译 9
10 7/8 页 码器的系统状态 [0096] 如图 2 所示, 所述数字信号处理器 204(DSP) 连接所述控制电路 28, 用于进行数字信号的处理 [0097] 上述 Turbo 译码器的工作原理如下 : [0098] 步骤 S1: 藉由所述输入缓冲电路接收地址信息 Address[12:0] 及软信息 LLR[63: 0], 藉由所述第一多路复用电路 221 及所述软输入缓冲电路 231 将软信息分为多路并行信号 [0099] 具体地, 在本实施例中, 将地址信息及软信息分为 4 路并行处理, 在实际使用中, 可根据实际需要设定为多路并行信号, 不以本实施例为限 [0100] 步骤 S2: 藉由所述软输入软输出译码电路 24 对多路信号进行并行译码 [0101] 具体地, 采用双向迭代的 Max Log Map 算法, 通过所述正向迭代单元进行正向迭代, 所述反向迭代单元进行反向迭代, 当两部分交叠时 ( 迭代了 N/2 步 ), 进行外信息计算, 所述软输入软输出译码电路 24 只需要 N 个 cycle 就可完成一次半迭代, 比单向迭代方式可减少一半的时延 [0102] 步骤 S3: 分别对译码得到的外信号进行延迟缓存和读取, 避免并行译码过程中对存储器读写的冲突, 然后再次进行并行译码, 如此循环, 通过多次迭代实现译码 [0103] 具体地, 在 WCDMA 系统中, 将所述软输入软输出译码电路 24 输出的外信息通过第一先进先出队列缓存单元存入外信息缓冲电路 26 更具体地, 所述第一软输入软输出译码电路 ~ 所述第四软输入软输出译码电路将外信息写入到所述第一外信息缓冲电路时, 直接将 4 路并行的外信号写入所述第一数据缓存电路的 4 个子数据缓存电路中, 在本实施例中, 外信息缓存入第一缓存单元 先进先出队列控制电路根据所述第一外信息缓冲电路的状态将外信息写入所述第一外信息缓冲电路 ; 所述第二外信息缓冲电路 ~ 所述第四外信息缓冲电路的写操作类似, 在此不一一赘述 [0104] 具体地, 在 WCDMA 系统中, 将读地址信息通过第二先进先出队列缓存单元存入所述数据缓存电路 25, 通过第三先进先出队列缓存单元从外信息缓冲电路 26 中读取外信息 更具体地, 所述第一软输入软输出译码电路 ~ 所述第四软输入软输出译码电路从所述第一外信息缓冲电路读取外信息时, 首先将读地址信息分别写入与所述第一外信息缓冲电路相连的 4 个子数据缓存电路中, 在本实施例中, 地址信息缓存入第二缓存单元 先进先出队列控制电路根据所述第一外信息缓冲电路的状态和地址信息, 从所述第一外信息缓冲电路中读取外信息, 并将读回的外信息分别存入第三先进先出队列缓存单元中, 先进先出队列控制电路再根据时序要求将第三先进先出队列缓存单元中的数据分别送到所述第一软输入软输出译码电路 ~ 所述第四软输入软输出译码电路中 通过两路分别存储和读出可避免冲突发生 [0105] 具体地, 在 LTE 系统中, 采用 QPP 交织器, 各数据缓存电路 25 可关闭直接将外信息顺序存入各外信息缓冲电路 26 并读出, 不会产生冲突 [0106] 在本实施例中, 通过遍历 WCDMA 所有的码块长度发现, 第一缓存单元 FIFO_write 和第二缓存单元 FIFO_read_addr 的深度为 16, 第三缓存单元 FIFO_read_Lext 的深度为 32 [0107] 在本实施例中, 所述 Turbo 译码器支持分段并行译码方式如下 : [0108] 1) 码块的长度小于 1536 时, 每个软输入软输出译码电路可以单独处理一个码块 10
11 8/8 页 最多 4 个码块可分别送到 4 个软输入软输出译码电路处理 [0109] 2) 码块长度大于 1536 且小于 3072 时, 每个码块分成两段处理, 占用两个软输入软输出译码电路 最多 2 个码块送入 4 个软输入软输出译码电路进行并行译码 [0110] 3) 码块长度大于 3072 时, 分为 4 段处理, 占用 4 个软输入软输出译码电路 [0111] 通过不同的硬件参数可对处理信息的容量进行设定, 不以本实施例为限 [0112] 如上所述, 本发明的 Turbo 译码器及译码方法, 具有以下有益效果 : [0113] 本发明的 Turbo 译码器及译码方法使用并行双向迭代的 Max Log Map 算法, 有效地提高的 Turbo 译码的吞吐量和译码时延 ; 同时实现了 WCMDA 的并行译码, 大大降低了 WCDMA 的译码延时, 使硬件资源得到充分复用 [0114] 综上所述, 本发明提供一种 Turbo 译码器及译码方法, 包括 : 藉由输入缓冲电路 第一多路复用电路 软输入缓冲电路接收地址信息及软信息, 将软信息分为多路并行信号 ; 藉由各软输入软输出译码电路对多路信号进行并行译码 ; 藉由数据缓存电路 外信息缓冲电路对译码得到的外信号进行延迟缓存和读取, 避免并行译码过程中对存储器读写的冲突, 然后再次藉由各软输入软输出译码电路进行并行译码, 如此循环, 通过多次迭代实现伪随机译码 本发明的 Turbo 译码器及译码方法使用并行双向迭代的 Max Log Map 算法, 有效地提高的 Turbo 译码的吞吐量和译码时延 ; 同时实现了 WCMDA 的并行译码, 大大降低了 WCDMA 的译码延时, 使硬件资源得到充分复用 所以, 本发明有效克服了现有技术中的种种缺点而具高度产业利用价值 [0115] 上述实施例仅例示性说明本发明的原理及其功效, 而非用于限制本发明 任何熟悉此技术的人士皆可在不违背本发明的精神及范畴下, 对上述实施例进行修饰或改变 因此, 举凡所属技术领域中具有通常知识者在未脱离本发明所揭示的精神与技术思想下所完成的一切等效修饰或改变, 仍应由本发明的权利要求所涵盖 11
12 附图 1/3 页 图 1 12
13 附图 2/3 页 图 2 13
14 附图 3/3 页 图 3 14
Microsoft Word - 16-李霞-终审.doc
第 8 卷第 2 期信息与电子工程 Vo1.8,No.2 2010 年 4 月 INFORMATION AND ELECTRONIC ENGINEERING Apr.,2010 文章编号 :1672-2892(201002-0201-06 基于 FPGA 的 Turbo 码译码器的设计 李霞, 王正彦 ( 青岛大学自动化工程学院, 山东青岛 266071 摘要 : 介绍了一种基于现场可编程门阵列 (FPGA
第10章 Turbo码
第六章 Turbo 码 虽然软判决译码 级联码和编码调制技术都对信道码的设计和发展产生了重大影响, 但是其增益与 Shannon 理论极限始终都存在 ~ 3dB 的差距 因此, 在 Turbo 码提出以前, 信道截止速率 R 0 一直被认为是差错控制码性能的实际极限,Shannon 极限仅仅是理论上的极限, 是不可能达到的 根据 Shannon 有噪信道编码定理, 在信道传输速率 R 不超过信道容量
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7 7.8 7.8. 前言 7.8.2 卷积编码器表示 7.8.3 卷积译码公式 7.8.4 卷积码的特性 7.8.5 最常用的卷积码 7.8.6 卷积码在 GSM 系统中的应用 7.8.7 卷积码在 WCDMA 系统中的应用 2 7.8. 线性分组码由两个整数 n 和 k 以及一个生成矩阵或者生成多项式决定, 其中 k 是输入的数据比特数,n 是输出比特数 其特点就是每个 n 元组码字由 k 元组输入消息唯一决定
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第三章 Q3 1 1. 省略了 I/O 操作的复杂逻辑, 易实现, 耗费低 ; 2. 可以利用丰富的内存寻址模式实现灵活的 I/O 操作 Q3 2 假设存储单元 ds1 处寄存器地址为 0x2000, 代码如下 #define ds1 0x2000 while ( *ds1 == 0 ) ; Q3 3 假设设备 (dev1) 中有两个寄存器 ds1 和 dd1,dev1 的地址为 0x1000,ds1
TD
*TD-000212-05* 20- 应用实例 4 本例显示的是使用两个亚低 音扬声器和多个顶箱的双声 道 立体声 设置 除了各声道都增加了一个顶 箱外 也可以增加更多的顶 箱 本例和例 3 的情况一 致 声道 2 或 右声道 声道 1 或 左声道 要接到更多的顶箱 将最后 一个顶箱的全幅线路输出接 头处的线缆接到下一个顶箱 的全幅线路输入接头 在不 降低信号质量的情况下 最
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电子技术基础 ( 第 版 ) 3. 图解单相桥式整流电路 ( 图 4-1-3) 电路名称电路原理图波形图 整流电路的工作原理 1. 单相半波整流电路 u 1 u u sin t a t 1 u 0 A B VD I A VD R B
直流稳压电源 第 4 章 4.1 整流电路及其应用 学习目标 1. 熟悉单相整流电路的组成, 了解整流电路的工作原理. 掌握单相整流电路的输出电压和电流的计算方法, 并能通过示波器观察整流电路输出电压的波形 3. 能从实际电路中识读整流电路, 通过估算, 能合理选用整流元器件 4.1.1 认识整流电路 1. 图解单相半波整流电路 ( 图 4-1-1) 电路名称电路原理图波形图 4-1-1. 图解单相全波整流电路
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第九章
2.5 Internet 3G 9.1 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32 1 2 4 9 9.2 GSMCDMA3G 1G GSMTDMA 2G 2.5 CDMA 3G GSM GSM900MHz GSM1800MHz GSM1900MHz CDMA Code
2 中 国 农 业 资 源 与 区 划 2016 年 可, 有 效 减 少 确 定 中 存 在 的 主 观 性 和 人 情 倾 向 三 要 健 全 精 准 扶 贫 大 数 据 平 台 2016 年, 全 国 将 建 设 扶 贫 开 发 大 数 据 平 台, 各 地 要 在 精 准 识 别 的 基 础
第 ３７卷 第 ３期 中 国 农 业 资 源 与 区 划 ６年 ３月 Ｃ Ｊ Ａ Ｒ Ｒ Ｐ Ｖ ３７ Ｎ ３ ４ ７５ Ｍ ６ ７ ６ ５ ９ ６ ３ 问题研究 农业产业扶贫应解决好的几个问题 刘北桦 詹 玲 农业部发展计划司 北京 ６ 摘 要 产业扶贫是脱贫攻坚的重头戏 农业是贫困地区的基础产业和民生产业 是贫困人口生活和收入 的重要来源 文章分析了当前农业产业扶贫中存在的困难和问题 提出要树立精准理念
现代天文学7.ppt
1983 1983 1 H 1 He 4 C 12 O 16 1 2 6 8 X A Z 2 19 α β γ F ( g) = Gmm' / d 2 F ( e) = qq' / d 2 F( e) / F( g) = 2.3 10 39 1919 α, 1930 α Be 3 4 6 6 4 4.0291 4.0015 0.0276 E=mc 2 4.12 10
广东宜通世纪科技股份有限公司2014年年度报告全文
广 东 宜 通 世 纪 科 技 股 份 有 限 公 司 2014 年 年 度 报 告 2015 年 03 月 1 第 一 节 重 要 提 示 目 录 和 释 义 本 公 司 董 事 会 监 事 会 及 董 事 监 事 高 级 管 理 人 员 保 证 本 报 告 所 载 资 料 不 存 在 任 何 虚 假 记 载 误 导 性 陈 述 或 者 重 大 遗 漏, 并 对 其 内 容 的 真 实 性 准 确
第 卷 第 期 年 月 半 导 体 学 报! " # $%&'%' $!&' #% #$1 /#1 $'! / ?/ ?/ / 3 0,?/ ) * +!!! '!,!! -. & ' $! '! 4% %&1)/1(7%&)03 (% )
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FPGAs in Next Generation Wireless Networks WPChinese
FPGA 2010 3 Lattice Semiconductor 5555 Northeast Moore Ct. Hillsboro, Oregon 97124 USA Telephone: (503) 268-8000 www.latticesemi.com 1 FPGAs in Next Generation Wireless Networks GSM GSM-EDGE 384kbps CDMA2000
附 件 : 湖 北 省 会 计 人 员 继 续 教 育 实 施 办 法 第 一 条 为 规 范 会 计 人 员 继 续 教 育 工 作, 加 强 持 有 会 计 从 业 资 格 证 书 人 员 ( 以 下 简 称 会 计 人 员 ) 继 续 教 育 的 管 理, 推 进 全 省 会 计 人 员 继 续 教 育 工 作 科 学 化 规 范 化 信 息 化, 培 养 造 就 高 素 质 的 会 计 队
2016 28 2016 2013 50 2013 69 2016 2016 10 2016 1 2016 24 2016 1 2016 2016 7 1 2017 6 30 1 2016 2 2012 17 2016 2016 24 2016 1 2016 1 2016 1 2016 1 2016 2016 24 2016 24 2016 24 24 12 2016 CN 24 24 12 2016
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- 21-1 2 1 52 1963 1 7 154 2 1478 62 3 202 193-21 - - 22-4 58 4 5 1998 12 415 416 6 431 7 1993 359 - 23-8 8 5 1573 9 10 2120 1982 2 11 1480 729-730 - 23 - - 24-12 1007~1072 14 15 12 1997 4 9-10 13 1997
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Code for design of communication engineering for fiber to the home in residential districts and residential buildings Code for design of communication engineering for fiber to the home in residential districts
Convolutional Codes
Convolutional Codes Jinlong Li Nature Inspired Computation and Applications Laboratory University of Science and Technology of China (USTC) Hefei 230027, Anhui, China jlli@ustc.edu.cn http://staff.ustc.edu.cn/~jlli
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声 明 本 次 股 票 发 行 后 拟 在 创 业 板 市 场 上 市, 该 市 场 具 有 较 高 的 投 资 风 险 创 业 板 公 司 具 有 业 绩 不 稳 定 经 营 风 险 高 退 市 风 险 大 等 特 点, 投 资 者 面 临 较 大 的 市 场 风 险 投 资 者 应 充 分 了 解 创 业 板 市 场 的 投 资 风 险 及 本 公 司 所 披 露 的 风 险 因 素, 审 慎
水晶分析师
大数据时代的挑战 产品定位 体系架构 功能特点 大数据处理平台 行业大数据应用 IT 基础设施 数据源 Hadoop Yarn 终端 统一管理和监控中心(Deploy,Configure,monitor,Manage) Master Servers TRS CRYSTAL MPP Flat Files Applications&DBs ETL&DI Products 技术指标 1 TRS
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权利要求书 1/1 页 1. 一种闪烁屏封装结构, 其特征在于, 所述闪烁屏封装结构包括 : 基板 ; 所述基板包括相对的第一表面与第二表面 ; 形成于所述基板第一表面的用于将 X 射线转化为可见光的闪烁层 ; 覆盖所述闪烁层的用于反射所述闪烁层转化得到的可见光的反射胶层 2. 根据权利要求 1 所
(19) 中华人民共和国国家知识产权局 (12) 实用新型专利 (21) 申请号 201720006307.1 (10) 授权公告号 CN 206400115 U (45) 授权公告日 2017.08.11 (22) 申请日 2017.01.04 (73) 专利权人上海奕瑞光电子科技有限公司地址 201201 上海市浦东新区张江高科技产业东区瑞庆路 590 号 9 幢 2 层 202 室 (72)
目 录 CONTENTS 4. 报 告 编 写 说 明 5. 董 事 长 致 辞 6. 关 于 我 们 9. 社 会 责 任 理 念 与 管 理 14. 履 行 产 业 责 任 促 进 民 族 通 信 业 崛 起 创 新 科 技 构 造 绿 色 环 境 27. 打 造 高 科 技 特 色
大 唐 电 信 科 技 产 业 集 团 二 零 一 四 年 企 业 社 会 责 任 报 告 创 造 无 限 沟 通 目 录 CONTENTS 4. 报 告 编 写 说 明 5. 董 事 长 致 辞 6. 关 于 我 们 9. 社 会 责 任 理 念 与 管 理 14. 履 行 产 业 责 任 促 进 民 族 通 信 业 崛 起 3 24. 创 新 科 技 构 造 绿 色 环 境 27. 打 造 高
(19) 中华人民共和国国家知识产权局 (12) 发明专利 (21) 申请号 (22) 申请日 (65) 同一申请的已公布的文献号申请公布号 CN A (43) 申请公布日 (73) 专利权人深圳市华星光电
(19) 中华人民共和国国家知识产权局 (12) 发明专利 (21) 申请号 201610251510.5 (22) 申请日 2016.04.20 (65) 同一申请的已公布的文献号申请公布号 CN 105861992 A (43) 申请公布日 2016.08.17 (73) 专利权人深圳市华星光电技术有限公司地址 518132 广东省深圳市光明新区塘明大道 9 2 号 (10) 授权公告号 (45)
(19) 中华人民共和国国家知识产权局 (12) 实用新型专利 (21) 申请号 (10) 授权公告号 CN U (45) 授权公告日 (22) 申请日 (73) 专利权人汕头大学地址 广东省
(19) 中华人民共和国国家知识产权局 (12) 实用新型专利 (21) 申请号 201520866271.5 (10) 授权公告号 (45) 授权公告日 2016.05.11 (22) 申请日 2015.11.03 (73) 专利权人汕头大学地址 515000 广东省汕头市金平区大学路汕头大学 (72) 发明人范衠黄国杉余泽峰林惠标李文姬 (74) 专利代理机构广州三环专利代理有限公司 44202
1 引言
第 36 卷第 17 期计算机工程 2010 年 9 月 V ol.36 No.17 Computer Engineering September 2010 工程应用技术与实现 文章编号 :1000 3428(2010)17 0260 04 文献标识码 :A 中图分类号 :TN764 超宽带系统中维特比译码器的设计与实现 欧阳淦, 刘亮, 叶凡, 任俊彦 ( 复旦大学专用集成电路与系统国家重点实验室,
长 安 大 学 硕 士 学 位 论 文 基 于 数 据 仓 库 和 数 据 挖 掘 的 行 为 分 析 研 究 姓 名 : 杨 雅 薇 申 请 学 位 级 别 : 硕 士 专 业 : 计 算 机 软 件 与 理 论 指 导 教 师 : 张 卫 钢 20100530 长安大学硕士学位论文 ３ １ ３系统架构设计 行为分析数据仓库的应用模型由四部分组成 如图３ ３所示
Fig1 Theforceappliedtothetrainwhenrunning :w = w j +w q (3) :w = w = w 0 +w j (4) w i 121 基本阻力 w r = 600 R ( N/kN) (8) :R : [2] w s [3] w s =0
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31 4 2012 8 JournalofLanzhouJiaotongUniversity Vol31No4 Aug2012 :1001-4373(2012)04-0097-07 * 张友兵 张 波 ( 100073) : 分析了列车运行过程中的受力情况 给出了制动过程中减速度的计算方法 并采用正向 反向两种迭代方式计算列车制动曲线 两种方式计算出的制动曲线一致 证明了计算制动曲线的方法是正确的
1 7 10 240 í é é í º 182 230nm A X 240 TURBO LDPC
--- 2 TURBO LDPC --- / / / (dbm) -20-40 -60-80 0-100 0 4 8 12 16 d 2 2 d>>dc dc --- f2-f1 >> Bc RAKE ARQ α 1 α 2 α 3 α M Selective Combining SNR Equal-Gain Combining maximal Ratio Combining SNR 10-1
3. 构造和动作原理 3.1 概要 主要元件有 开关机构 自动脱扣装置 带手动脱扣 按钮 触点 消弧装置 接线端子及塑壳 消弧装置 三菱的MCCB以栅极空隙 形状与 材料的最佳组合获得超群的消弧性 能 塑壳 上盖 磁束 塑壳 底座 栅极 电弧 磁力 消弧 触点 脱扣按钮 按下脱扣 可进行外部机械式脱扣 用于确认 附件开关和手动复位功能的动作 开关机构 触点快速开关 开关速度与操纵柄 的移动速度无关
《分析化学辞典》_数据处理条目_1.DOC
3 4 5 6 7 χ χ m.303 B = f log f log C = m f = = m = f m C = + 3( m ) f = f f = m = f f = n n m B χ α χ α,( m ) H µ σ H 0 µ = µ H σ = 0 σ H µ µ H σ σ α H0 H α 0 H0 H0 H H 0 H 0 8 = σ σ σ = ( n ) σ n σ /
控制器 EtherCAT EtherCAT EtherCAT 接下一个电机驱动模块 (X4) 接下一个电机驱动模块 (X5) X11 IN X4 IN X3 OUT X5 IN X6 OUT X2 X1 X4 IN X3 OUT X5 IN X6 OUT X2 X1 SYS STA DC BUS D
控制器 thert thert thert 接下一个电机驱动模块 () 接下一个电机驱动模块 () 电机驱动模块 电机驱动模块 电源模块 接下一个电机驱动模块 () 接下一个电机驱动模块 () 接下一个电机驱动模块 () 接下一个电机驱动模块 () X 0 X 0 4 /RK /RK 注 注 制动电阻阻值 Ω Φ 80: 适用电机驱动模块型号 8-M-XXXX--XX Φ : 适用电机驱动模块型号
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7.2 并行接口 二. 可编程并行接口芯片 8255A 的功能及其应用 与 CPU 一侧相连的引脚 D0 PA0 ~ ~ ~ ~ ~ D7 PA7 RESET PC7 WR RD PC4 PC3 PC0 A0 PB0 A1 PB7 CS PA 口 PC 口上半部 PC 口下半部 PB 口 A 组 B 组 与 I/O 设备相连的引脚 7.2 并行接口二. 可编程并行接口芯片 8255A 的功能及其应用
1 V = V 1 F = F-1 1 E = E -1 β 1 + 3 = 4 = 2β 2 α 1 + 4 = 4= 2α 2 γ 1 + 2 = 4= 2γ 2 1 + 2 + 3 + 4 = 2 1 1 = 2 - a + b + c 2E 2E + E = 2 q p 1 1 1 1 + = + p q 2 E p q V F E 1 3 3 4 4 6 2 3 4 8 6 12 3 4
(19) 中华人民共和国国家知识产权局 (12) 发明专利 (21) 申请号 (22) 申请日 (65) 同一申请的已公布的文献号申请公布号 CN A (43) 申请公布日 (10) 授权公告号 CN 10
(19) 中华人民共和国国家知识产权局 (12) 发明专利 (21) 申请号 201510003797.5 (22) 申请日 2015.01.06 (65) 同一申请的已公布的文献号申请公布号 CN 104505124 A (43) 申请公布日 2015.04.08 (10) 授权公告号 (45) 授权公告日 2017.07.28 (56) 对比文件 CN 101751989 A,2010.06.23,
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SIGA简报第510期.doc
2013 7 17 20... 1... 2... 3... 3... 4... 6 2013 7 17 20 [ ] 1 8 2 8 3 8 [ ] 4 8 5 8 6 8 7 8 上海市图像图形学学会 ＳＩＧＡ 简报 总第 ５１０ 期 ２０１３ 年 第 ３ 期 复旦大学张江校区内的软件楼与微电子楼 复旦大学张江校区荷花池 理事长 张文军 常务副理事长 许志祥 秘书长 支琤 上海市图像图形学学会网址
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第 7 章信道编码 1 本章内容 绪论 线性分组码 循环码 卷积码 Turbo 码 2 7.1 引言 在设计数字通信系统时, 首先应从合理地选择调制解调方法 合适的发射功率等方面考虑, 若仍不能满足系统误码率要求, 则要考虑采用本章所讲的差错控制编码措施 纠错码, 是当消息经过有噪信道传输或要恢复存储的数据时用来纠错的 用来传输消息的物理介质叫做信道( 如电话线 卫星连接 用于移动通信的无线信道等
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编码理论 周武旸 wyzhou@ustc.edu.cn 636485 第一章绪论 课程内容. 信道编码的历史及研究现状.2 简单编码方式回顾.2. 线性分组码.2.2 循环码 第二章基础理论 2. 信道编码定理 2.2 硬判决与软判决 2.3 基本信道模型及其信道容量 2.4 MAP 与 ML 算法 2.5 因子图与和积算法 第三章 BCH 码 2 第四章卷积码 4. 卷积码的编码 4.2 卷积码的结构特性
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Microsoft Word - Delta Controller ASCII_RTU_SC
Delta Controller ASCII/RTU ( 适用台达变频器 伺服驱动器 PLC 温度控制器 ) 人机默认值通讯速率 :9600, 7, None, 2 (ASCII); 9600, 8, None, 2 (RTU) 控制器站号 :1 控制区 / 状态区 :None/None 控制器接线的说明 Delta Servo a. RS-232(DOP-A/AE/AS, DOP-B 系列适用 )
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Chapter #
第三章 TCP/IP 协议栈 本章目标 通过本章的学习, 您应该掌握以下内容 : 掌握 TCP/IP 分层模型 掌握 IP 协议原理 理解 OSI 和 TCP/IP 模型的区别和联系 TCP/IP 介绍 主机 主机 Internet TCP/IP 早期的协议族 全球范围 TCP/IP 协议栈 7 6 5 4 3 应用层表示层会话层传输层网络层 应用层 主机到主机层 Internet 层 2 1 数据链路层
危險物與有害物標示及通識規則
危 害 化 學 品 標 示 及 通 識 規 則 修 正 條 文 第 一 章 總 則 第 一 條 本 規 則 依 職 業 安 全 衛 生 法 ( 以 下 簡 稱 本 法 ) 第 十 條 第 三 項 規 定 訂 定 之 第 二 條 本 法 第 十 條 所 稱 具 有 危 害 之 化 學 品 ( 以 下 簡 稱 危 害 化 學 品 ), 指 下 列 或 有 害 : 一 : 符 合 國 家 標 準 CNS15030
胡 鑫 陈兴蜀 王海舟 刘 磊 利用基于协议分析和逆向工程的主动测量方法对 点播系统进行了研究 通过对 点播协议进行分析 获悉该协议的通信格式和语义信息 总结出了 点播系统的工作原理 在此基础上设计并实现了基于分布式网络爬虫的 点播系统主动测量平台 并对该平台获取的用户数据进行统计分析 获得了 点播系统部分用户行为特征 研究结果对 点播系统的监控及优化提供了研究方法 点播 协议分析 爬虫 主动测量
第四章 １０２ 图 ４唱１６ 基于图像渲染的理论基础 三张拍摄图像以及它们投影到球面上生成的球面图像 拼图的圆心是相同的 而拼图是由球面图像上的弧线图像组成的 因此我 们称之为同心球拼图 如图 ４唱１８ 所示 这些拼图中半径最大的是圆 Ｃｋ 最小的是圆 Ｃ０ 设圆 Ｃｋ 的半径为 ｒ 虚拟相机水平视域为 θ 有 ｒ Ｒ ｓｉｎ θ ２ ４畅１１ 由此可见 构造同心球拼图的过程实际上就是对投影图像中的弧线图像
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XZJ5940JQZ800 全地面起重机 QAY800 全地面起重机 ( 起重性能表 ) 中华人民共和国徐州工程机械集团有限公司徐州重型机械有限公司 目录 一 七节主臂工况起重性能表 支腿全伸... 7 1 七节主臂 _t-1 支腿全伸 12.8m 13m, 平衡重 0t... 7 2 七节主臂 _t-2 支腿全伸 12.8m 13m, 平衡重 0t... 7 3 七节主臂 _t-1 支腿全伸 12.8m
市本级（公示版）中国联通嘉兴市分公司2014年WCDMA网工程新建基站环境影响报告表.doc
编 RMTC-GF14-HP 号 573021-P2 2014 年 中 国 联 通 浙 江 WCDMA 无 线 网 络 新 建 工 程 - 嘉 兴 工 程 项 目 环 境 影 响 报 告 表 ( 市 本 级 )( 报 批 稿 ) 建 设 单 位 : 中 国 联 合 网 络 通 信 有 限 公 司 嘉 兴 市 分 公 司 编 制 单 位 : 浙 江 国 辐 环 保 科 技 中 心 证 书 编 号 :
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控制面板及侧 背面端子 液晶电视快速操作引导 液晶电视快速操作引导 控制面 板 按键介 绍 控制面板按键及侧面端子介绍 感光头 红外接收器 指示灯 电源 开 关 按键 频 道- 频 道+ 音 量- 音 量+ 频道选择键 音量控制键 菜单 确定 返 回/主 页 确定键 返回/主页键 菜单键 背面端 子 介绍 USB1 光纤音频 输出 USB2 USB3 SD卡 SD卡槽 CA卡 V 注:当您使用非本机配送的重低音音箱连接本机
(19) 中华人民共和国国家知识产权局 (12) 发明专利申请 (21) 申请号 (22) 申请日 (71) 申请人中石化石油工程技术服务有限公司地址 北京市朝阳区北辰西路 8 号北辰世界中心 A 座 703 申请人中石化胜利石油工程
(19) 中华人民共和国国家知识产权局 (12) 发明专利申请 (21) 申请号 201810139438.6 (22) 申请日 2018.02.11 (71) 申请人中石化石油工程技术服务有限公司地址 100101 北京市朝阳区北辰西路 8 号北辰世界中心 A 座 703 申请人中石化胜利石油工程有限公司中石化胜利石油工程有限公司钻井工艺研究院 (10) 申请公布号 (43) 申请公布日 2019.08.20
吉林大学学报 工学版 ２４４ 第 ４ 卷 复杂 鉴于本文篇幅所限 具体公式可详见参考文 献 ７ 每帧的动力学方程建立及其解算方法如图 ３ 所示 图４ 滚转角速度与输入量 η 随时间的变化波形 Ｆｉｇ ４ Ｗａｖｅｆｏｒｍ ｏｆ ｒｏｌｌ ｒａｔｅ ａｎｄ ｉｎｐｕｔ η ｗｉｔｈ ｔｉｍｅ ｃｈａｎｇｉｎｇ 图５ Ｆｉｇ ５ 滚转角随时间的变化波形 Ｗａｖｅｆｏｒｍ ｏｆ ｒｏｌｌ ａｎｇｌｅ ｗｉｔｈ
方向可以有如此深厚的理论基础与之媲美 我的一个学生就认为 : 理论上的完备性与数学上的优美表达正是编码的魅力所在 但理论上的完备性并不能使其直接应用于实际, 因此从码字构造的方向来说, 如何将 LDPC 码应用于实际工作才是值得深入研究的 为了保证其实现性, 性能上就要有所妥协 在编码方面, 以准循
第八章 LDPC 码 8. 研究 LDPC 码的原因 码编道信 码组分 线性码 非线性码 循环码 非循环码 BCH 码 RS 码 奇偶校验码 汉明码 码积卷 系统卷积码 非系统卷积码 Mackay 等人的再发现 Turbo 码 LDPC 码 可以看到, 信道编码的发展可以简单的归纳为分组码 卷积吗 分组码这样一个过程 ( 在这里按其结构将 Turbo 码也归入卷积码的范畴 ) 其中 Turbo 码的出现以及迭代译码的思想引入使得信道编解码产生了前所未有的飞跃,
通信与电子系统综合实验
中国科学技术大学电子工程与信息科学系 通信与电子系统综合实验 课程报告 曹梦霏 2010-1-8 电子设计自动化实验室 摘要 本报告主要总结了一个月以来在电子设计自动化实验室里的所学 依据课程指导, 学习分为两大部分 : 第一部分是硬件实验台和软件编程环境的熟悉实验, 其中包括 FPGA 部分和 DSP 部分, 分别根据实验手册进行实践, 报告中将简要提到学习到的知识 ; 第二部分是自选实验, 本报告选择的是
K-HW508K / HW516K K-NL408K / NL416K 最新固件版本 :V G Seagate Pipeline HD2 ST CS - 可用 Seagate Pipeline HD2 ST1000VM002 - 可用 1T Seagate SV35.5
注意请使用 5T 或 6T 的硬盘架 (WJ-ND400/ WJ-HDE400/WJ-HD716/WJ-HD616) 请不要在 5TB 或 6TB 硬盘底部安 2 颗螺丝 ( 下方标记 ), 因为螺丝要长于螺旋孔的深度 顶视图 底视图 1 K-HW508K / HW516K K-NL408K / NL416K 最新固件版本 :V3.200 500G Seagate Pipeline HD2 ST3500312CS
KV-cache 1 KV-cache Fig.1 WorkflowofKV-cache 2.2 Key-value Key ; Key Mem-cache (FIFO) Value Value Key Mem-cache ( Value 256B 100 MB 20%
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