µPSD3000 系列

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1 8032 FLASH MCU µpsd3251f-40t6 µpsd FlashPSD Flash SRAM I/O I 2 C, ADC and PWM 8032, 16 / FlashPSD µpsd32 JTAG ISP 2K SRAM Flash - 64K Flash - 16K Flash - Flash I2C ADC 6 I/O 37 I/O PLD JTAG V

2 RAM... 8 XRAM-PSD µpsd MCU INT I2C INT

3 I/O MCU / USART ADC I2C SXSTA S1STA S2STA SXDAT: S1DAT S2DAT SXADR S1ADR S2ADR PSD ISP PSD PSD FLASH FLASH FLASH FLASH SRAM SRAM PLD PSD TURBO DPLD

4 CPLD OMC IMC I/O PSD MCU I/O PLD I/O JTAG ISP PCR B C D PLD SRAM I/O PLD JTAG JTAG JTAG FLASH AC/DC V V MHZ MCU MHZ MCU MHZ MCU CPLD 5V CPLD 5V CPLD 5V V

5 5V RESET 5V VSTBYON 5V ISC 5V TQFP52-52 PQFP

6 Flash K Flash - 16k Flash. EEPROM EEPROM - Flash (IAP) SRAM - 2K SRAM RTOS, PLD - Flash SRAM k - (VM) Flash 8032 IAP V 40MHz,3.3V 24MHz - 16 / I2C - PWM ADC 46 I/O 6 I/O - I/O:GPIO,DDC,I2C,PWN,PLD I/O, JTAG PLD - glue (state machines) - PALs,PLDs, 74HCXX - PSDsoft EXPRESS - - JTAG (ISP) FASHLINKTM PC - 1

7 - PLD TQFP 1. µpsd32 2

8 2. TQFP52 3

9 3. TQFP52 4

10 µpsd3251f K 64K 8032 FLASH FLASH FLASH 512K FLASH 128k Flash 64k PSD Flash RAM SFR 256 RAM 128 PSD 2K 4. PC A B B SP PSW R0-R7 DPTR 5

11 5.. 8 B BA 16 B. B h 007Fh SP 07h, 07h 7Fh 6

12 PCH PCL PCH:0FFh, PCLL:0FEh. PSW CPU RAM 00h 1Fh: 0 3 PSW 8 BCD [ CY]. CPU ALU [ AC]. ALU 3 ALU 4 [ RS0,RS1]. RAM 00-07H: Fh: h:2 18-1Fh:3 [ OV] Fh h CLRV (BIT) 6 [ P]. 1 1 P=0 P=1. R0-R7.. 8 DPH DPL PSW( ) 7

13 Flash 128K 256K Flash 32K Flash Flash PSD Flash CPU 0000h 9 CPU h h 0 000Bh h 1 001Bh RAM 128 SFRs 256 RAM SRAM-DDC PSD 8K XRAM-PSD RAM 8 RAM RAM XRAM-PSD PSD 8K XRAM-PSD PSDsoft DPLD PLD XRAMPSD C PC

14 16 0h 8h 80h FFh 3. RAM µpsd

15 RAM 80-FFh RAM mov A,3EH;A --RAM(3E) R0 R1, DPTR --[40H] 3. R0 R7, 3 R0---R7 mov PSW,# B; 0 mov A,#30h mov R1,A 10

16 4. 5. mov A,#100H DPTR PC mov c A,@A+DPTR

17 4 <byte> ADD A, <byte> ADD a,7fh( ) ADD A,@R0( ) ADD a,r7( ) ADD A,#127( ) A INC MUL AB A B 16 B A DIV AB A B 8 A 8 B DIV AB DIV AB2n n DIV AB A B DA A BCD BCD ADD ADDC DA A BCD DA A BCD DA A BCD

18 5 µpsd3200 AND, OR, OR, NOT, A B B AND( ) ANL A,<byte>, A B <byte> 5 ANL A,<byte> ANL A,7FH ANL A,@R1 ANL A,R6 ANL A,#53H A XRL <byte> #data XRL P1,#0FFH A RL A, RLC A, A SWAP A A 4 4 BCD A 100 BCD MOV B,#10 DIV AB SWAP A ADD A,B 10 A 4 B SWAP ADD A RAM. 6 MOV <dest>,<src> A RAM 128 RAM µpsd3200 RAM, PUSH PUSH POP SP RAM

19 16 MOV DPTR XCH A,.<byte> A XCHD 4 XCH XCHD 8 BCD 8 XCHBCD A A MOV 14 XCH 9 9 XCHD BCD A 7. BCD MOVs: 14 R1 R0 BCD 2EH 2DH CJNE LOOP CJNE R1 2EH 2DH 2CH 2BH 2AH 2AH A 8. BCD XCHs: 9 9. BCD 14

20 10. RAM. Ri R0 RAM RAM A 11.??

21 MOVC 11 MOVC A MOVC A,@A+DPTR A MOVC PC A MOV A, ENTRY NUMBER CALL TABLE TABLE TABLE: MOVC A,@A+PC RET RET MOVC PC RET RET 12. µpsd3200 RAM 128 SFR

22 00h 7Fh h FFh SFR MOV C,FLAG MOV P1.0,C FLAG 128 SFR I/O FAGL 1 0 PSW A CCLR C PSW PSW ANL ORL XRL C =bit 1 XRL bit2 MOV C, bit1 JNB bit2, OVER CPL C OVER: bit1 C bit2=0 Cbit2=0 bit1 XRL bit2 =bit1 bit2 =1 C JNB 1 JC,JB,JBC 0 JNC,JNB bit2 bit2=0 CPL C 1 JBC C PSW PC,

23 13 JMP add SJMP,LJMP AJMP,JMP SJMP 2 SJMP LJMP K AJMP PC 11 5 AJMP 2K DPTR A DPTR5 0 4 A MOV DPTR,#JUMP TABLE MOV A,INDEX_NUMBER RL A RL A JUMP TABLE: AJMP CASE 0 AJMP CASE 1 AJMP CASE 2 AJMP CASE 3 AJMP CASE 4 13 CALL addr LCALL ACALL CPU CALL LCALL 16 64K ACALL 11 ACALL 2K 16 RET CALL RETI RET RETI RETI RETI RETI RET 18

24 µpsd PSW JZ JNZ A DJNZ N N DJNZ N=10 MOV COUNTER,#10 LOOP:(begin loop)... (end loop) DJNZ COUNTER,LOOP (continue) CJNE 9 9 BCD R1 2AH R1 2EH R1 R1 2AH S1 S6 SC-MOD 13 P1 P2 µpsd3200 CPU 13 1 S1 4 S4 6 S6 MOVX MOVX 13 MOVX 19

25 13. µpsd3200 µpsd32 µpsd3200 MCU PSD MCU 8032 PSD 8032CPU I/O 16 PLD A B C D I/O MCU 0~4 PSD CPU A0~A15 D0~D7 RD_ WR_ PSEN_ ALE RESET_ PSDsoft PLD PSD 20

26 14. µpsd32 MCU MCU LVD I2C I/O 21

27 15 SFR SFR

28 16. SFR 23

29 24

30 25

31 17. PSD 26

32 =csiop + csiop PSDsoft * 0 10 INT0 0 I2C INT1 1 2 Int0 INT0 TCON IT0 TCON IE TF0 TF1 TF0 TF1 TF0 TF

33 2 2 TF2 TF2 2 T2EX 2 P1.1 T2EX T2CON EXEN2 EXF2 2 90C320 I2C I2C S2STA INTR Int1 INT1 TCON IT1 TCON IE1 RI TI USART USART A7H,B7H

34

35 19. IP IPA 0 = 1 = IE IEA IE EA 20. IE 30

36 21. IEA 22. IP 23. IPA S5P2 5 2 S5P2 RETI 31

37 S5P2 PSW PC 24 RETI RETI RET 24. CPU PWM 8 I2C 32

38 LVD SRAM 25. PCON 26. PCON 27. PCON PCON.0 1 CPU A RAM PCON.0 RETI PCON

39 PCON.1 1 RAM I/O MCU MCU PSD I/O B C D I/O µpsd3251f SFR SFR I/O 1 P1SFS 2 P1.0 P1.3 GPIO GPIO I2C 3 P3SFS GPIO PXSFS P1SFS 91H 30. P3SFS 93H 34

40

41 17. µpsd3251f XTAL1 XTAL2 XTAL1 XTAL2 µpsd3251f XTAL1 XTAL2 36

42 18. µpsd3251f RESET LVR CPU PSD 37

43 RESET RESET 1ms AC VDD LVR VDD 10ms LVR LVR PCON LVREN LVR 5V 4V±0.25V 3.3V 2.5V±0.2V 0.1V 1µs 22 WDT µpsd3200 CPU 22 WDRST WDKEY WDT FFFFFH WDT MHZ WDT WDT 00~7EH WDRST WDRST 22 7 WDRST 00 WDKEY =55H WDT WDT 32. WDKEY: 0AEH 38

44 33. WDKEY 34. WDRST: 0AEH 35. WDRST Tfosc Tfosc / µpsd3251f 16 Timer0 Timer1 Timer /6CPU S5P2 1 S2P CPU 1 0 1/12 CPU Timer0 Timer1 0 1 TMOD C/T / TMOD M1 M

45 36. TCON 37. TCON TF1 TR1=1 GATE=0 TR=1 /INT1=1 GATE=1 INT1 TR1 TCON GATE TMOD 13 8 TH1 5 TL1 TL TR1 TF1 /INT1 TR0 TF0 /INT0 GATE TMOD TMOD 40

46 39. TMOD

47 TL1 22 TL1 TF1 TH1 TL1 THL TR1=0 0 3 TL0 TH TL0 C/T GATE TR0 INT0 TF0 TH0 1 TR1 TF1 TH µpsd T2CON C/T2 3 T2CON 41 T2CON EXEN2 EXEN2= TF2 1 EXEN2=1 2 T2EX TL2 TH2 RC2L RC2H T2EX T2CON EXF2 1 EXF2 TF2 24 T2CON EXEN2 EXEN2=

48 TF2 1 RC2L RC2H 16 2 EXEN2=1 2T2EX EXF (RCLK RCLK1)=1 TCLK TCLK1 = T2CON 41. T2CON 43

49 42. 2 =

50 25. 2 USART µpsd P3.0 RX P3.1 TX P1.2 RX P1.3 TX SCON SCON2 SBUF 2 SBUF2 SBUF SBUF 4 0. RXD TXD8 1/6CPU TXD RXD SCON RB TXD RXD SCON TB8 0 1 PSW P TB8 9 SCON RB8 1/16 1/32 CPU

51 11 TXD RXD SBUF RI=0 REN=1 REN= RB8 RB8=1 SCON SM SM2=1 SM2 SM2 1 SM SM2=1 SCON SCON TB8 RB8 TI RI 43. SCON 46

52 44. SCON. 0fosc/12 2 SMOD SMOD=0 1/64CPU SMOD=1, 1/32CPU 2 =(2 SMOD /64) fosc SMOD 1 3 (2 SMOD /32) (Timer1 ) 3 TMOD =0010B 1 3 = 2 SMOD /32 fosc/12 [256 (TH1)] 1 16 TMOD =0001B / 2. µpsd3200 T2CON TCLK / RCLK / 2 T2CON 47

53 T2CON TCLK RCLK UART1 PCON TCLK1 RCLK1 UART2 TH2 RC2H RC2L = 2 /16. C/T2=0 2 1/6CPU =fosc/(32 [65536-(RC2H,RC2L)]) RC2H,RC2L 16 RC2H RC2L 2 T2CON PCON RCLK+TCLK=1 TH2 TF2 1 2 EXEN2 1 T2EX 1 0 EXF2 1 RC2H,RC2L TH2,TL2 2 T2EX 2 TH2 TL2 1 RC / 2 RC TR2 0. RXD TXD / 8 8 1/6 CPU 26 0 SBUF S6P2 SBUF 1 9 TX SBUF RXD TXD S3 S4 S5 S6 S1 S TX T1 1 S1P1 SBUF 10 S1P1 REN=1 RI=0 S6P2 RX TXD S3P1 S6P1 1 S5P2 RXD 1 0 RX SBUF SCON RI 10 S1P1 RI 1 1. TXD RXD

54 1 SCON RB SBUF SBUF 1 9 TX 16 S1P1 16 SBUF TXD TXD TX TI 1 SBUF RXD 1 0 RXD FFH 16 bit times RXD RX SBUF RB8 RI 1 SBUF RB8 RI 1 RI=0 2 SM2=0 =1 RB8 8 SBUF RI RXD TXD RXD TB SCON RB8 2 1/16 1/32 CPU SBUF SBUF TB8 9 TXD 16 S1P116 SBUF TXD TXD TB8 TB8 0 TX TI 1 SBUF

55 11 RXD 1 0 RXD FFH RXD RX SBUF RB8 RI 1 SBUF RB8 RI 3 RI=0 4 SM2=0 9 =1 RI 1 9 RB8 8 SBUF RXD

56

57

58

59

60 ADC 8 A/D A/D AVREF A/D ACON A/D ADAT 46 ACON A/D P1SFS I/O 8 ASCL 6MHZ ADC MCU ADST 1 ADAT A/D ADAT A/D ADSF 1 30 A/D A/D A/D ADSF 1 A/D A/D ADSF 30. A/D 45. ADC 55

61 46. ACON 6MHZ ASCL 8 ADC = Fosc/2 / +1 Fosc MCU ADC ADC =8 8 ADC 10.67us( 6 MHZ) ADAT A/D ADSF 1 ADSF PCON ADSFINT INT1 ADSF 1 EXINT1 P3.3 I/O 1 I2C µpsd3200 I2C I2C SDAx SCLx SDA SCL SDA1 SCL1 DDC SDA2 SCL2 I2C I2C I/O SDA1/P4.0 SCL1/P4.1 SDA2/P3.6 SCL2/P3.7 I2C I/O 56

62 SxCON SxSTA SxDAT SxADR 33. I2C I/O 48. SxCON S1CON S2CON 57

63 49. SxCON 50. SCL SxSTA S1STA S2STA SxSTA I2C I2C SxSTA 58

64 52. SxSTA 1. INTR, SxSTA 5 SxSTA 2. I2C INTR ( DDC2B SWENB=0) 1 1 AA=1 ack_int 2 GC(SxADR.0)=1 AA=1 ack_int 3 ack_int 4 ack_int 5 stop_int SXDAT: S1DAT S2DAT SxDAT bit7 53. SXDAT S1DAT S2DAT SxADR S1ADR S2ADR SxADR I2C MCU 40MHZ 55. S1SETUP,S2SETUP 59

65 56. 40MHZ 57. PSD PSD 8032CPU I/O 16 PLD B C D I/O MCU I/O PSD A0 A15 D0 D7 RD WR PSEN ALE RESET MCU PSDsoft PLD PSD 44 PSD 512KFlash Flash 4 128K Flash 2 Flash 16K SRAM SRAM CPLD CPLD PLD DPLD PSD 60

66 I/O B C D MCU I/O PLD I/O MCU I/O I/O JTAG ISP MCU 256 PMU 8032 CPU PSD Flash 100,000 PLD 1, Flash Flash PLD 61

67 PLD ISP C JTAG MCU PSD MCU SRAM Flash Flash PLD PSD JTAG 81 PSD 62

68 81. PSD WINDOWS PSDsoft Windows95 Windows98 Windows-NT µpsd3200 PSD HDL PSD 45 PSDsoft PSDsoft ST FlashLINK JTAG µpsd3251f 45. PSDsoft 63

69 PSD 82 PSD CSIOP CSIOP 256 PSD 82 CSIOP I/O PSD 14 PSD 5 PLD I/O PMU JTAG 64

70 PSD Flash Flash SRAM PLD DPLD PSDsoft Flash Flash Flash 4 Flash 2 Flash Flash FlashReady/Busy PC3 PSDsoft Ready/Busy DPLD 110 PLDs 4 FS0 FS3 3 Flash 2 CSBOOT0 CSBOOT1 3 3 Ready/Busy PC3 Flash Flash Ready/Busy PC3 0 1 Flash Flash MCU MCU MCU MCU Flash Flash 83 MCU ROM Flash Flash MCU RAM Flash Flash MCU Ready/Busy PC3 65

71 Read 2. X = XXXXh RA = RD = RA PA = WR,CNTL0 PA PSD PD = PA WR,CNTL0 SA = FS0~FS7 CSBOOT0~CSBOOT3 3. FS0~FS7 CSBOOT0~CSBOOT3 PSDsoft 4. A11~A Flash ID DQ5/DQ us 8. 00H 01H A1,A0 = 1,0 9. Flash ID Flash MCU Flash MCU Flash 66

72 PSD Flash Flash ROM 83 Flash Flash 83 coded cycles AAH 555H 55H AAAH A15 A12 FS0 FS3 CSBOOT0 CSBOOT1 Flash FlashFlash Flash FS0 FS3 Flash CSBOOT0 CSBOOT1 Flash PSD FS0 FS3 CSBOOT0 CSBOOT1 WR CNTL0 Vcc Vlko MCU ROM RAM Flash Flash MCU MCU Flash Flash Flash 83 MCU Flash Flash Flash A6 A1 A FS0 FS3 CSB00T0 CSBOOT1 Flash Flash 01h 00h NVM Flash Flash MCU PSD I/O 105 Flash Flash MCU Flash 67

73 MCU 84 Flash MCU 94 Flash 84. DQ7 Flash DQ7 DQ7 Q7 46 Flash DQ7 0 DQ7 1 Flash Flash DQ us DQ6 Flash FS0 FS3 CSBOOT0 CSBOOT1 DQ D0 D7 4 6 DQ6 Flash Flash DQ us DQ5 Flash 1 Flash Flash 0 1 DQ5 Flash Flash Flash DQ5 Flash DQ3 100us±20% DQ3 0 DQ

74 Flash Flash Flash 1 FFh 0 MCU Flash MCU Flash MCU 83 MCU Flash MCU 3 PC3 DQ7 46 MCU MCU Flash DQ7 7 MCU DQ7 DQ5 DQ7 7 DQ5 0 DQ5 1 DQ7 DQ5 MCU DQ7 46 MCU 1 0 DQ5 1 Flash 46 DQ7 0 DQ5 1 0 MCU DQ7 DQ5 PSDsoft ANSIC 46. DQ6 47 MCU MCU Flash 69

75 MCU DQ6 MCU DQ6 DQ5 DQ6 DQ5 0 DQ5 1 DQ6 DQ5 MCU DQ MCU 1 0 DQ5 1 Flash 46 DQ6 DQ5 1 0 MCU DQ6 DQ5 PSDsoft ANSIC Flash Flash 83 6 Flash 102 Flash DQ5 DQ6 DQ7 DQ5 1 00h 0FFh PSD Flash Flash us 70

76 Flash Flash Flash DQ3 DQ3 0 DQ3 1 Flash 102 Flash DQ5 DQ6 DQ7 Flash Flash Flash FS0~FS3 CSBOOT0~CSBBOT1 0B0h 83 Flash DQ6 Flash 0.1us 15us DQ6 Flash Flash Flash Flash Flash Flash Flash 030h 83 Flash Flash Flash JTAG PSDsoft JTAG JTAG Flash MCU Flash MCU Flash CSIOP Flash

77 Sec<i>_Prot 1 = Flash Flash <i> Sec<i>_Prot 0 = Flash Flash <i> 86. Flash 1. Sec<i>_Prot 1 = Flash Flash <i> Sec<i>_Prot 0 = Flash Flash <i> Security_Bit 0 = 1 = Flash Flash 83 AAh 555h 55h AAAh Flash Flash ID Flash DQ5 1 Flash Flash DQ5 1 Flash 25us Flash Flash 25us Flash RESET Flash Flash 25us 25us MCU Flash SRAM DPLD SRAM RS0 SRAM SRAM RS0 SRAM SRAM VSTBY PC2 µpsd3200 SRAM 2V 2V SRAM PC4 SRAM VBATON PC4 SRAM RS0 VSTBY PC2 VBATON PC4 PSDsoft SRAM FS0 FS3 CSBOOT0 CSBOOT1 SRAM DPLD PSDsoft 1 Flash Flash 2 Flash Flash 72

78 3 Flash Flash 4 SRAM I/O I/O 5 Flash Flash Flash 6 SRAM I/O I/O SRAM I/O I/O 8000h BFFFh FS0 8000h 9FFFh CSBOOT0 8000h 87FFh RS0 RS0 SRAM CSBOOT0 87FFh 9FFFh Flash 0 9FFFh Flash 0 Flash 0 Flash FS1 8000h BFFFh 48. PSD I/O MCU PSD CSIOP VM PSDsoft VMMCU SRAM Flash Flash Flash PSDsoft VM MCU 87 VM 87. VM 73

79 PSEN Flash RD Flash SRAM I/O VM 0Ch Flash Flash SRAM PSEN RD Flash VM b2 b

80 8 MCU 256 MCU PGR0 PGR7 DPLD FS0 FS3 CSBOOT0 CSBOOT1 SRAM RS D0 D7 MCU CSIOP+E0h

81 PLD PLD µpsd PSDsoft PLD 88. DPLD CPLD PSD PLD PLD DPLD PLD CPLD 112 PLD DPLD 113 PLD CPLD 52 PLD DPLD PSD I/O CPLD OMD IMC AND CPLD ECS1 ECS2 ANDPSDsoft PLD MCU I/O

82 PSD Turbo 70ns PLD Turbo 0 PLD 127 Turbo PMMR2 5 MCU PLD MCU PLD PLD 52. PLD DPLD 53 DPLD PSD DPLD Flash 4 FS0 FS3 3 Flash 2 CSBOOT0 CSBOOT1 3 1 SRAM RS0 2 1 CSIOP PSD 1 JTAG C JTAG 2 I/O 77

83 53. DPLD 1. MCU CPLD CPLD CPLD D ECS1 ECS2 ECS1 ECS2 OMC D ECS1 ECS2 52 CPLD 24 IMC 16 OMC AND 137 I/O IMC OMC PSD MCU MCU OMC PLD AND 78

84 54. I/O OMC 8 B McellAB0 McellAB7 8 B C McellBC0 McellBC7 McellAB PSDsoft A B B C McellBC OMC AND OMCXOR OMC AND OMC PSDsoft D T JK SR AND CLKIN PD1 CLKIN PD1 79

85 PC0 PC1 PC5 PC6 JTAG CPLD PSDsoft McellAB0 McellAB7 3 6 McellBC0 McellBC3 4 5 McellBC4 McellBC7 4 6 OMC PSDsoft OMC OMC CSIOP MCU 117 I/O PSD

86 MCU MCU MCU PSDsoft 55. CPLD OMC 8 OMC 00h 1 MCU OMC McellAB0 McellAB3 MCU McellABMcellAB 0Fh OMC I/O PLD AND OR PSDsoft PLD PSDsoft I/O AND IMC CPLD 20 B C 56 PLD 81

87 MCU CPLD AND MCU ALE4 IMC PSDsoft AN1171 MCU IMC 117 I/O PSD 56. I/O PSD PSD 4 I/O B C D D 1 8 PSDsoft MCU CSIOP PCR 57 I/O

88 57 A B PSDsoft CPLD CPLD ECS1 ECS2 PDB PDB MCU PDB 57. I/O 83

89 JTAG N/A = 2. B,C,D CPLD AND 92. I/O OR OR CPLD AND PSDsoft CPLD MCU PDB MCU B C PLD ALE PLD AND PLD MCU 116 I/O PSDsoft MCU CSIOP PSDsoft 84

90 MCU PLD I/O I/O MCU AN MCU I/O MCU I/O MCU I/O I/O CSIOP PSD MCU 82 0 MCU I/O MCU I/O 119 I/O MCU 57 C D MCU I/O PSDsoft PLD I/O PLD I/O PLD I/O PLD I/O CPLD CPLD PLD 0 PSDsoft PLD 1 PLD I/O PSDsoftPLD I/O MCU 1 MCU 92 B MCU JTAG ISP C JTAG ISP C JTAG ISP JTAG 133 JTAG PCR MCU CSIOP PCR 93 00h 85

91 93. PCR MCU I/O 1 MCU I/O A B D I/O P.T 95. P.T A/B C B C PLD AND 96D 86

92 62 CMOS 1 CMOS 1 97 B C D 98 MCU 98 MCU N/A = 98. MCU I/O MCU I/O MCU 1 MCU 87

93 CPLD MCU MCU OMC 110 PLD OMC OMC OMC 1 0 IMC IMC PLD MCU 110 PLD MCU B B A B 59 MCU I/O CPLD McellAB7 McellAB0 A B McellBC7 McellBC0 B C CPLD IMC 92 PB3~PB0 PB7~PB4 60. C 88

94 C 60 MCU I/O CPLD McellBC7 McellBC0 B C CPLD IMC ISP PSD JTAG JTAG 133 JTAG C PC2 VSTBY PC4 VBATON VCC VBAT C 89

95 61. D D D I/O PD D 8 1 PD1 D 60 MCU I/O CPLD ECS1 CPLD CPLD IMC D PSDsoft CLKIN PD1 APD CPLD D ECS1 ECS D 90

96 PSD Flash SRAM 0 PLD PMMR APD PSD APD PLD APD 128 PSD PMMR0 PLD 0 PLD MCU MCU APD PLD PLD MCU PLD PLD MCU PMMR PSD PLD PLD DPLD CPLD 91

97 63. APD PSD PMMR0 PLD 0 PLD APD ALE PSD 63 APD ALD ALE/AS PD0 15 CLK IN PD1 PDN PSD APD ALE 15 CLK IN PD1 PSD ALE PSD RESET PSD PLD MCU PMMR PLDMCU CLKIN PD1 PLD CLKIN PD1 APD CLKIN PD1 PLD I/O I/OI/O 99 PSD PLD PSD SRAM PMMR0 PMMR2 92

98 PMMR

99 PLD PLD PMMR ns PLD 15MHZ 1 10ns 0 PLD PLD µpsd3251f 5MHZ PMMR2 MCU PLD 101. PMMR Reset 102. APD SRAM PSD SRAM SRAM VSTBY PC2 VCC VSTBY SRAM VSTBY PC2 SRAM SRAM ISTBY 0.5µA SRAM 2V VBATON PC4 VCC VSTBY CLKIN PD1 PLD CLKIN PD1 PLD AND OMC CLKIN PD1 PLD PMMR CLKIN PD1 PLD AND 94

100 PSD MCU WR RD PSEN ALE PLD PLD AND PLD PMMR CLKIN PD1 PLD AND 65. RESET VCC PSD Tnlnh-po Flash /RESET PSD Topr Flash WR FS0 FS3 CSBOOT0 CSBOOT1 WR CNTL0 VCC VLKO Flash PSD Tnlnh topr 65 I/O PLD 103 I/O PLD PLD PLD VCC PLD PLD 95

101 VM SR_cod PeriphMode 0 JTAG JTAG C ( 104). ( Flash ),PLD, PSD JTAG. JTAG. JTAG (IEEE ) TMS,TCK,TDI TDO. TSTAR TERR JTAG PSD ( ) C JTAG TMS,TCK,TDI TDO. AN1153, JTAG (ISP). JTAG JTAG JTAG ( FlashLINK ) JTAG TDO JTAG JTAG,TSTAT TERR RESET JTAG PSD RESET MCU MCU AN1153, JTAG (ISP) µpsd3251f JTAG (ISC), PSDsoft FlashLINK JTAG JTAG (ISC) JTAG (ISC) ST. FlashLINK µpsd

102 104. JTAG JTAG JTAG (TMS,TCK,TDI TDO),TSTAT TERR ISC_ENABLE. µpds JTAG. AN1153. Flash,,TERR., ( ), ISC_CLEAR ISC_DISABLE. TSTAT 98 / (PC3) /. PSD (, Flash ),TSTAT. Flash,TSTAT, Flash,TSTAT. TSTAT TERR ISC_ENABLE,. Flash 1, JTAG,. JTAG,.,.. PSDsoft. Flash PSDsoft. ST,µPSD3251F PLD 1 PLD AC/DC µpsd32 AD DC DC AC PLD 97

103 MCU DC. PLD,Flash SRAM MA (MHZ) PLD MA/MHZ PT PLD, Turbo 0,. 66. PLD Icc 5V 98

104 107. Vcc=5.0V PSD STMicroelectronics SURE 99

105 IPC/JEDEC J-STD-020A 2. JEDEC Std JESD22-A114A (C1=100 pf, R1=1500, R2=500 ) DC AC, DC AC.DC AC.,. 5V 109. (5V ) 111. tavlx ALE 100

106

107 5V 112. DC (5V ) 102

108 1. CPU Icc XTAL1 tclch,tchcl=5ns VIL=Vss+0.5V,VIH=Vcc-0.5V,XTAL2 0=RESET=Vcc, Icc 1mA 2. CPU Icc XTAL1 tclch,tchcl=5ns VIL=Vss+0.5V,VIH=Vcc-0.5V,XTAL2 0=Vcc,RESET=Vss, 3. IPD( ) EA XTAL1=Vss,XTAL2 RESET=Vss, 0=Vcc, 4. PLD I/O =0mA 103

109 40MHz MCU MHZ MCU Vcc= V : VSS = 0 V; CL Port 0, ALE PSEN 100 pf; CL 80 pf 2. µpsd ns 0 40MHz MCU MHZ MCU Vcc= V : VSS = 0 V; CL Port 0, ALE PSEN 100 pf; CL 80 pf 104

110 40MHz MCU MHZ MCU Vcc= V : VSS = 0 V; CL Port 0, ALE PSEN 100 pf; CL 80 Pf

111 71. CPLD 5V 120. CPLD 5V 1. PA3~PA0,PB3~PB0, PD2~PD1 2. MCU tpd 0 2 RD,WR,PSEN ALE CPLD

112 CPLD 5V 122. CPLD 5V 1. PA3~PA0,PB3~PB0, PD2~PD1 2. CLKIN (PD1) tclcl = tch + tcl. CPLD 5V 124. CPLD 5V 107

113 72. / 73. / 74. -PLD

114 5V V 1. PLD / A,B,C ALE/AS tavlx tlxax V V DQ0-DQ7 DQ7 tq7vqv 109

115 79. RESET Reset 5V 134. Reset 5V 1. RESET Flash 2. Flash VSTBYON 5V 136. VSTBYON 5V 1. VSTBYON Vcc 2ms 110

116 ISC 5V 138. ISC 5V 1. PLD ISC 2. PLD 80. ISC 81. MCU AC I/O 111

117 AC Vcc-0.5V V 0 VIH 1 VIL PSD AC I/O 100MvIOL ILH 100Mv 20Ma, VOH VOL C1,C2 = 30pF±10Pf C1,C

118 85. PSD AC I/O 86. PSD AC % 2. TA = 25 PQFP52 52 PQFP 113

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