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湾珊席
6 years ago
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1 Lecture 27: System Bus 系统总线总线基本概念总线设计要素总线设计要素总线标准总线标准总线互连结构总线互连结构

2 总线的分类总线在各层次上提供部件之间的连接和交换信息通路分为以下几类 : 芯片内总线 : 在芯片内部各元件之间提供连接 - 例如,CPU 芯片内部, 各寄存器 ALU 指令部件等之间有总线相连系统总线 : 在系统主要功能部件 (CPU MM 和各种 I/O 控制器 ) 间提供连接 - 单总线结构将 CPU MM 和各种 I/O 适配卡通过底板总线 (Backplane Bus) 互连, 底板总线为标准总线 (Industry standard) - 多总线结构将 CPU Cache MM 和各种 I/O 适配卡用局部总线处理器 - 主存总线高速 I/O 总线扩充 I/O 总线等互连主要有两大类 : Processor- Memory Bus (Design specific or proprietary)» 短而快, 仅需与内存匹配, 使 CPU-MM 之间达最大带宽 I/O Bus (Industry standard)» 长而慢, 需适应多种设备, 一侧连接到 Processor- Memory Bus 或 Backplane Bus, 另一侧连到 I/O 控制器 ( 注 :Intel 公司在推出等芯片组时, 对 System Bus 有专门的定义, 将处理器总线称为前端总线 (Front Bus) 或系统总线 ) 通信总线 : 在主机和 I/O 设备之间或计算机系统之间提供连接 - 通常是电缆式总线, 如 SCSI RS-232 USB 等 SKIP

3 Intel 体系结构中特指的系统总线北桥芯片组把处理器存储器总线分成了两个总线 : 处理器总线 ( 系统总线, 前端总线 ) 存储器总线 BACK

4 系统总线的组成系统总线通常由一组控制线控制线一组一组数据线数据线和一组和一组地址线地址线构成构成也有些总线没有单独的地址线, 地址信息通过数据线来传送, 这种情况称为数据 / 地址复用数据线 (Data Bus): 承载在源和目部件之间传输的信息数据线的宽度反映一次能传送的数据的位数地址线 (Address Bus) : 给出源数据或目的数据所在的主存单元或 I/O 端口的地址地址线的宽度反映最大的寻址空间控制线 (Control Bus) : 控制对数据线和地址线的访问和使用用来传输定时信号用来传输定时信号和命令信息典型的控制信号包括 : - 时钟 (Clock): 用于总线同步 - 复位 (Reset): 初始化所有设备 - 总线请求 (Bus Request): 表明发出该请求信号的设备要使用总线 - 总线允许 (Bus Grant): 表明接收到该允许信号的设备可以使用总线 - 中断请求 (Interrupt Request): 表明某个中断正在请求 - 中断回答 (Interrupt Acknowledge) : 表明某个中断请求已被接受 - 存储器读 (memory read): 从指定的主存单元中读数据到数据总线上 - 存储器写 (memory write): 将数据总线上的数据写到指定的主存单元中 - I/O 读 (I/O read): 从指定的 I/O 端口中读数据到数据总线上 - I/O 写 (I/O Write) : 将数据总线上的数据写到指定的 I/O 端口中 - 传输确认 (transmission Acknowledge) : 表示数据已被接收或已被送到总线

5 总线设计要素总线设计要考虑的基本要素尽管有许多不同的总线实现方式, 但总线设计的基本要素和考察的性能指标一样 1 信号线类型 (Signal line type): 专用 (Separate) / 复用 (Multiplexed) 2 仲裁方法 (Arbitrating): 集中式 (Center) / 分布式 (distributed) 3 定时方式 (Timing): 同步通信 (Synchronous) / 异步通信 (Asynchronous) 4 事务类型 (Bus Transaction): 总线所支持的各种数据传输类型和其他总线操作类型, 如 : 存储器读存储器写存储器写 I/O 读 I/O 写读指令读指令中断响应中断响应等 5 总线带宽 (Bus Bandwidth): 单位时间内在总线上传输的最大数据量 ( 是一种传输能力 ) 相当于公路的最大载客量例如, 沪宁高速每车道最多每 5 分钟发一辆车, 每辆车最多 50 人, 共有 6 个车道, 则最大流量为多少 (? 人 / 小时 )? 最大载客量 :6 道 x12 车 / 小时 x50 人 / 车 = 3600 人 / 小时

6 信号线类型总线的信号线类型有 : 专用复用专用信号线 : - 信号线专用来传送某一种信息例如, 使用分立的数据线和地址线, 使得数据信息专门由数据线传输, 地址信息专门由地址线传输复用信号线 : - 信号线在不同的时间传输不同的信息例如, 许多总线采用数据 / 地址线分时复用方式, 用一组数据线在总线事务的地址阶段传送地址信息, 在数据阶段传送数据信息这样就使得地址和数据通过同一组数据线进行传输信号分时复用的优缺点 : - 优 : 减少总线条数, 缩小体积降低成本降低成本 - 缺 : 总线模块的电路变复杂, 且不能并行

7 总线裁决 ( 总线控制 / 使用 / 访问权的获得 ) 总线被多个设备共享, 但每一时刻只能有一对设备使用总线传输信息什么是总线裁决? 当多个设备需要使用总线进行通信时, 采用某种策略选择一个设备使用总线为什么要进行总线裁决? 总线被连接在其上的所有设备共享, 如果没有任何控制, 那么当多个设备需要进行通信时, 每个设备都试图为各自的传输将信号送到总线上, 这样就会产生混乱所以必须进行总线裁决如何避免上述混乱? 在总线中引入一个或多个总线主控设备, 只能主控设备控制总线 - 主控设备 : 能发起总线请求并控制总线 ( 如 : 处理器 ) - 从设备 : 只能响应从主控设备发来的总线命令 ( 如 : 主存 ) 利用总线裁决决定哪个总线主控设备将在下次得到总线使用权

8 总线裁决 ( 总线控制 / 使用 / 访问权的获得 ) 1 总线裁决信号 : 总线请求线和总线许可线总线请求线可以和数据线复用, 但这样会影响带宽如 : 数据线和总线请求线复用时, 总线裁决和数据传输不能同时进行 2 总线裁决有两种方式 : 集中式和分布式集中式 : 将控制逻辑做在一个专门的总线控制器或总线裁决器专门的总线控制器或总线裁决器中, 通过将所有的总线请求集中起来利用一个特定的裁决算法特定的裁决算法进行裁决菊花链 (Daisy chain) 计数器定时查询 (Query by a counter) 集中并行 (Centralized, Parallel) 分布式 : 没有专门的总线控制器, 其控制逻辑分散在各个部件或设备中自举式 (Self-selection) 冲突检测 (Collision detection) 3 裁决方案应在以下两个因素间进行平衡等级性 (Priority) 具有高优先级的设备应该先被服务 SKIP 公平性 (Fairness) 即使具有最低优先权的设备也不能永远得不到总线使用权

9 菊花链总线裁决菊花链查询电路 Grant 从最高优先权的设备依次向最低优先权的设备串行相连如果到达的设备有总线请求, 则 Grant 信号就不再往下传, 该设备建立总线忙 Busy 信号, 表示它已获得了总线使用权 Grant 1 Grant 2 Grant 3 Grant 查询信号串行查询方式 Request 1 Request 2 Request n 相当于击鼓传花 Device 1 Highest Priority Device 2 Device N Lowest Priority Bus Arbiter Grant Grant Grant Busy Request BACK Advantage: 1 简单 (simple), 只需几根线就能按一定优先次序实现总线裁决 2 易扩充设备 (flexible) Disadvantages: 1 不能保证公正性 2 对电路故障敏感 3 菊花链的使用限制了总线速度

10 计数器定时查询裁决基本思想 : 比菊花链查询多一组设备线 (DevID), 少一根总线允许线 BG 总线控制器接收到 BR 送来的总线请求信号后, 在总线未被使用 (Busy=0) 的情况下, 由计数器开始计数, 并将计数值通过设备线向各设备发出当某个有总线请求的设备号与计数值一致时, 该设备便获得总线使用权, 此时终止计数查询, 同时该设备建立总线忙 Busy 信号优点 : 1 灵活, 设备的优先级可通过设置不同的计数初始值来改变若每次初值皆为 0, 则固定 ; 若每次初值总是刚获得总线使用权的设备, 则是平等的循环优先级方式 2 对电路故障不如菊花链查询那样敏感缺点 :1 需要增加一组设备线 2 总线设备的控制逻辑变复杂 ( 需对设备号进行译码比较等 ) 相当于点名报到 Device 1 Device 2 Device N Bus Arbiter Dev ID Busy Request BACK

11 独立请求方式裁决并行判优电路 P0 p0 P1 p2 优先级怎样? 相当于领导说了算 G0 各设备都有一对总线请求线 Req 和总线允许线 Grant P1 G1 当某设备要使用总线时, 就通过对应的总线请求线将请求信号送到总线控制器 P2 p0>p1>p2 EN G2 并行判优方式总线控制器中有一个判优电路, 可根据各设备的优先级确定选择哪个设备控制器可给各请求线以固定的优先级, 也可编程设置 Bus Arbiter Grant Device 1 Req Device 2 BACK Device N 问题 : 如果有 N 个设备, 则菊花优点 :1 响应速度快 2 若可编程, 则优先级灵活链和独立请求各需多少裁决线? 缺点 :1 控制逻辑复杂, 控制线数量多 2 ~ 2N 裁决算法 : 总线控制器可采用固定的并行判优算法平等的循环菊花链算法动态优先级算法 ( 如 : 最近最少用算法先来先服务算法 ) 等

12 自举分布式裁决 BR0(Busy) BR1 BR2 BR3 Device0 Device1 Device2 Device3 优先级固定, 各设备独立决定自己是否是最高优先级请求者需请求总线的设备在各自对应的总线请求线上送出请求信号在总线裁决期间每个设备将比自己优先级高的请求线上的信号取回分析 : - 若有总线请求信号, 则本设备不能立即使用总线 - 若没有, 则可以立即使用总线, 并通过总线忙信号阻止其他设备使用总线 - 最低优先级设备可以不需要总线请求线, 为什么? - 需要较多连线用于请求信号, 所以, 许多总线用数据线 DB 作为总线请求线 N 个设备要多少请求信号? N 条! - NuBus(MacintoshII 中的底板式总线 ) SCSI 总线等采用该方案上图中的优先级 ( 优先级 ) 是什么? 设备 3> 设备 2> 设备 1> 设备 0 BACK

13 冲突检测方式裁决基本思想 : 当某个设备要使用总线时, 它首先检查一下是否有其他设备正在使用总线如果没有, 那它就置总线忙, 然后使用总线 ; 若两个设备同时检测到总线空闲, 则可能会同时使用总线, 此时发生冲突 ; 一个设备在传输过程中, 它会帧听总线以检测是否发生了冲突 ; 当冲突发生时, 两个设备都会停止传输, 延迟一个随机时间后再重新使用总线 - 该方案一般用在网络通信总线上, 如 :Ethernet 总线等 BACK

14 总线定时方式什么是总线的定时通过总线裁决确定了哪个设备可以使用总线, 那么一个取得了总线控制权的设备如何控制总线进行总线操作呢? 也即如何来定义总线事务中的每一步何时开始何时结束呢何时结束呢? 这就是总线通信的定时问题总线通信的定时方式 Synchronous ( 同步 ): 用时钟来同步定时 Asynchronous( 异步 ): 用握手信号定时 Semi-Synchronous ( 半同步 ): 同步 ( 时钟 ) 和异步 ( 握手信号 ) 结合 Split transaction( 拆分事务 ): 在从设备准备数据时, 释放总线处理器 - 存储器总线都采用同步方式异步方式只有通信总线或 I/O 才会使用 I/O 总线大多采用半同步方式拆分事务方式可以提高总线的有效带宽 SKIP

15 同步总线 (Synchronous Bus) 简单的同步协议如下图 : 一个总线事务 : 地址阶段 + 数据阶段 + + 数据阶段 CLK BReq BG R/W Address Data Cmd+Addr Data1 Data2 控制线上用一个时钟信号时钟信号进行定时, 有确定的通信协议 BACK Advantage( 优点 ): 控制逻辑少而速度快 Disadvantages( 缺点 ): (1) 所有设备在同一个时钟速率下运行, 故以最慢速设备为准 (2) 由于时钟偏移问题, 同步总线不能很长实际上, 存储器总线比这种协议的总线复杂得多存储器 ( 从设备 ) 响应需要一段时间, 并不能在随后的时钟周期就准备好数据

16 异步总线异步总线 (Asynchronous Bus) 非时钟定时, 没有一个公共的时钟标准因此, 能够连接带宽范围很大的各种设备总线能够加长而不用担心时钟偏移 (clock skew) 问题采用握手协议 (handshaking protocol) 即 : 应答方式只有当双方都同意时, 发送者或接收者才会进入到下一步, 协议通过一对附加的握手信号线 (Ready Ack) 来实现异步通信有非互锁半互锁和全互锁三种方式 Ready Ack 非互锁方式 Ready Ack 半互锁方式 Ready Ack 全互锁方式优点 : 灵活, 可挂接各种具有不同工作速度的设备缺点 : 1 对噪声较敏感 ( 任何时候都可能接收到对方的应答信号 ) 2 接口逻辑较复杂 BACK

17 Handshaking Protocol( 握手协议 ) 一个总线事务 : 地址阶段 + 数据阶段 + + 数据阶段 ReadReq Data Address Data Ack DataRdy Three control lines ReadReq: 请求读内存单元 ( 地址信息同时送到地址 / 数据线上 ) DataRdy: 表示已准备好数据 ( 数据同时送到地址 / 数据线上 ) Ack: ReadReq or DataRdy 的回答信号上述为 read 过程, 但 write 操作基本类似 ReadReq 和 Ack 之间的握手过程完成地址信息的传输 DataRdy 和 Ack 之间的握手过程完成数据信息的传输一共有多少次握手? 7 次是全互锁方式! BACK

18 半同步总线为解决异步方式对噪声敏感的问题, 在异步总线中引入时钟信号就绪和应答等握手信号 ( 如 :Wait 信号 TRDY 和 IRDY 信号等 ) 都在时钟的上升沿有效信号的有效时间限制在时钟到达的时刻, 而不受其他时间的信号干扰 CLK BReq BG R/W Address Cmd+Addr Wait Data Data1 Data1 Data2 通过 Wait 信号从设备告知主设备何时数据有效结合了同步和异步的优点既保持了所有信号都由时钟定时的特点, 又允许不同速度设备共存于总线 BACK

19 Split Bus Transaction( 拆分总线事务 ) 将一个事务分成两个子过程 : 过程 1: 主控设备 A 获得总线使用权后, 将请求的事务类型地址及其他信息 ( 如 A 的标识等 ) 发到总线, 从设备 B 记下这些信息 A 发完信息后便立即释放总线, 其他设备便可使用总线过程 2:B 收到 A 发来的信息后, 按照 A 的要求准备数据, 准备好后,B 便请求使用总线, 获使用权后,B 将 A 的编号及所需数据送到总线,A 便可接收子周期 1 子周期 2 时钟地址从设备地址主设备编号主控 ( M ) 从 ( S ) 数据 M 地址命令 S 总线空闲 ( 其它主控器可用 ) S 数据 M

20 Split Bus Transaction( 拆分总线事务 ) 请求 - 回答方式 (Request-Reply ) CPU 启动一次读或写事务 - 传送信息 :address, data, and command 然后等待存储器回答分离总线事务方式 (Split Bus Transaction) CPU 启动一次读 / 写事务后, 释放总线 - 传送信息 :address, data(write), and command 存储器启动一次回答事务, 请求使用总线 - 传送信息 : data (read) or acknowledge (write) 优点 : 系统总效率改善 ( 例如, 在存储器存取数据时可以释放总线, 以被其他设备使用 ) 缺点 : 单独的事务响应时间变长增加复杂性 BACK

21 例 1: 同步和异步总线的最大带宽比较举例 : 假定同步总线的时钟周期为 50ns, 每次总线传输花 1 个时钟周期, 异步总线每次握手需要 40ns, 两种总线的数据都是 32 位宽, 存储器的取数时间为 200ns 要求求出从该存储器中读出一个字时两种总线的带宽要求求出从该存储器中读出一个字时两种总线的带宽分析如下 : 同步总线的步骤和时间为 : (1) 发送地址和读命令到存储器 :50ns (2) 存储器读数据 :200ns 如果存储器读为 230ns, 则结果为多少? (3) 传送数据到 CPU:50ns 总时间为 350ns,4B/350ns=11.4MB/s 所以总时间为 300ns, 故最大总线带宽为 4B/300ns, 即 :13.3MB/s 异步总线的步骤和时间为 : 第 1 步为 :40ns; 第步为 :Max(3x40ns,200ns)=200ns; ( 第步都和存储器访问时间重叠 ) 第步为 :3x40ns=120ns 总时间为 360ns, 故最大带宽为 4B/360ns=11.1MB/s 由此可知 : 同步总线仅比异步快大约 20% 要获得这样的速度, 异步总线上的设备和存储器必须足够快, 以使每次在 40 ns 内能完成一个子过程

22 例 2: 数据块大小对带宽的影响假定有一个系统具有下列特性 : (1) 系统支持 4~16 个 32 位字的块访问 (2)64 位同步总线, 时钟频率为 200MHz, 每个 64 位数据传输需一个时钟周期, 地址发送到存储器需 1 个时钟周期 (3) 在每次总线操作 ( 事务 ) 间有两个空闲时钟周期 (4) 存储器访问时间对于开始的 4 个字是 200ns, 随后每 4 个字是 20ns 假定先前读出的数据在总线上传送的同时, 随后 4 个字的存储器读操作也在重叠进行, 一个总线事务由一个地址传送后跟一个数据块传送组成请求出分别用 4- 字块和 16- 字块方式读取 256 个字时的持续带宽和等待时间并且求出两种情况下每秒钟内的有效总线事务数

23 举例 - 数据块大小对带宽的影响分析 4- 字块传送情况 : 对于 4- 字块传送方式, 一次总线事务由一个地址传送后跟一个 4- 字块的数据传送组成也即每个总线事务传送一个 4 个字的数据块每个数据块所花时间为 : (1) 发送一个地址到主存花 1 个时钟周期 (2) 从主存读 4 个字花 :200ns/(5ns/Cycle)=40 个时钟周期 ( 一个周期是 10 9 ns/200mhz=1000/200=5ns) (3) 4 个字 (128 位 ) 的传输需 2 个时钟周期 ( 一个 64 位数据传输需 1 个时钟周期 ) (4) 在这次传送和下次之间有 2 个空闲时钟周期所以一次总线事务总共需 45 个周期, 256 个字需 256/4=64 个事务, 所以整个传送需 45x64=2880 个时钟周期, 因而总等待时间为 :2880 周期 x 5ns/ 周期 =14400ns 每秒钟的总线事务数为 : 64 x (1s/14400ns) = 4.44M 个总线带宽为 :(256 x 4B)/14400ns =71.11MB/s I/O 200 ns 1 clock = 40 clock 5ns/ cycle 2 clock 2 clock Block address Read memory Data transfer Bus idle Memory Latency = 2880 clock cycles Bandwidth = 71.11MB /sec

24 举例 - 数据块大小对带宽的影响分析 16- 字块传送情况 : 对于 16- 字块传送, 一次总线事务由一个地址传送后跟一个 16- 字块的数据传送组成也即每个总线事务传送一个 16 个字的数据块第一个 4- 字所花时间为 : (1) 发送一个地址到主存花 1 个时钟周期 (2) 从主存读开始的 4 字花 :200ns/(5ns/Cycle)=40 个时钟周期 (3) 传 4 个字需 2 个时钟周期, 在传输期间存储器开始读取下一个 4 字 (4) 在本次和下次之间有 2 个空闲时钟, 此期间下一个 4 字已读完所以,16 字中其余三个 4 字只要重复上述最后两步因此对于 16- 字块传送, 一次总线事务共需花费的周期数为 : x (2 +2) = 57 个周期,256 个字需 256 / 16=16 个事务, 因此整个传送需 57 x 16 = 912 个时钟周期故总等待时间为 :912 周期 x 5ns / 周期 =4560ns 几乎仅是前者的 1/3 每秒钟的总线事务个数为 :16 x (1s / 4560ns) = 3.51M 个总线带宽为 :(256 x 4B)x (1s/4560ns) =224.56MB/s, 比前者高 3.6 倍由此可见, 大数据块传输的优势非常明显 I/O 1 clock 40 clock 2 clock 2 clock Latency = 912 clock cycles Bandwidth = MB /sec Memory

25 增加同步总线带宽的措施提高时钟频率 Data bus width( 增加数据线宽度 ) 能同时传送更多位 Example: SPARCstation 20 s memory bus 有 128 bit Cost: more bus lines Block transfers( 允许大数据块传送 ) 背对背总线周期, 也称为突发 (Burst) 传输方式只要开始送一次地址, 后面连续送数据 Cost: (a) 增加复杂性 (b) 延长响应时间 Split Bus Transaction( 拆分总线事务 ) 一次总线事务时间延长, 但整个系统带宽增加 Cost: (a) 增加复杂性 (b) 延长响应时间不采用分时复用方式地址和数据可以同时送出 Cost( 代价 ): (a) more bus lines, (b) 增加复杂性

26 关于 I/O 总线标准 I/O 总线是各类 I/O 控制器与 CPU 内存之间传输数据的一组公用信号线, 这些信号线在物理上与主板扩展槽中插入的扩展卡 (I/O 控制器 ) 直接连接 I/O 总线是标准总线,I/O 总线标准有 : ISA / EISA 总线 :( 已逐步被淘汰 ) Multibus 总线 :( 已逐步被淘汰 ) PCI 总线 : 前几年 PC 机所用的主流标准 PCI-Express( 高速 PCI 总线 ): 目前 PC 机所用的主流标准 I/O 总线的带宽总线的数据传输速率 (MB/s) = 数据线位数 /8 总线工作频率 (MHz) 每个总线周期的传输次数

27 PCI 总线扩展槽

28 ( 自学 ) PCI 总线标准 (1) 信号线 PCI 有 50 根必须的信号线按功能可分为以下几组 : 系统信号 : 包括时钟和复位线地址和数据信号 : 包含 32 根分时复用的地址 / 数据线 4 根分时复用的总线命令 / 字节使能线以及对这 36 根信号线进行奇偶校验的一根校验信号线接口控制信号 : 对总线事务进行定时控制, 用于在事务的发起者和响应者之间进行协调裁决信号 : 它不同于其他信号, 不是所有设备共享同一根信号线, 而是每个总线主控设备都有一对仲裁线 : 总线请求和总线允许 PCI 采用集中式裁决, 所有设备的仲裁线都连接到一个总线裁决器中错误报告信号 : 用于报告奇偶校验错以及其他错误 (2) PCI 命令总线活动以发生在总线主控设备和从设备之间的总线事务形式总线事务形式进行进行总线总线主控设备就是事务的就是事务的发起者, 从设备是事务的是事务的响应者, 即目标目标当总线主控设备获得总线使用权后, 在事务的地址周期, 通过分时复用的总线命令 / 字节使能信号线 C/BE 发出总线命令, 也即事务类型事务类型

29 ( 自学 ) PCI 总线标准 PCI 的总线命令 ( 事务类型 ) 有 : 中断响应 : 用于对 PCI 总线上的中断控制器提出的中断请求进行响应地址线不起作用, 在数据周期从中断控制器读取一个中断向量, 此时 C/BE 信号线表示读取的中断向量的长度特殊周期 : 用于总线主设备向一个或多个目标广播一条消息 I/O 读和 I/O 写 :I/O 读 / 写命令用于在发起者和一个 I/O 控制器之间进行数据传送存储器读存储器行读存储器行读存储器多行读存储器多行读 : 用于总线主控设备从存储器中读取数据 PCI 支持突发传送, 所以它将占用一个或多个数据周期这些命令的解释依赖于总线上的存储控制器是否支持 PCI 的高速缓存协议如果支持的话, 那么, 与存储器之间的数据传送以 Cache 行的方式进行存储器写存储器写并无效存储器写并无效 : 这两种存储器写命令用于总线主控设备向存储器写数据, 它们将占用一个或多个数据周期其中存储器写并无效命令用于回写 Cache 行到存储器, 所以它必须保证至少有一个 Cache 行被写回配置读配置写配置写 : 用于一个总线主控设备对连接到 PCI 总线上的设备中的配置参数进行读或更新每个 PCI 设备都有一个寄存器组 ( 最多可有 256 个寄存器 ), 这个寄存器用于系统初始化时对本设备进行配置双地址周期 : 由一个事务发起者用来表明它将使用 64 位地址来寻址

30 ( 自学 ) PCI 总线标准存储器读存储器行读存储器行读存储器多行读存储器多行读 : 用于总线主控设备从存储器中读取数据 PCI 支持突发传送, 所以它将占用一个或多个数据周期这些命令的解释依赖于总线上的存储控制器是否支持 PCI 的高速缓存协议如果支持的话, 那么, 与存储器之间的数据传送以 Cache 行的方式进行

31 ( 自学 ) PCI 总线标准 (3) PCI 数据传送过程 PCI 总线上的数据传送由一个地址周期和一个或多个数据周期组成上的数据传送由一个地址周期和一个或多个数据周期组成所有事件在时钟下降沿 ( 即在时钟周期中间 ) 同步总线设备在时钟上升沿采样总线信号写操作时序类似!

32 ( 自学 ) PCI 总线标准 (4) PCI 总线裁决采用独立请求方式, 有两个独立的裁决线 : 请求线 REQ 和允许线 GNT 总线仲裁器可使用静态的固定优先级法循环优先级法或先来先服务法等仲裁算法采用隐式仲裁方式, 在总线进行数据传送时进行总线仲裁, 仲裁不会浪费总线周期

33 回顾 :I/O 总线,I/O 控制器与 I/O 设备的关系 I/O 控制器芯片组主板插槽机箱 IDE 接口硬盘光驱机箱插座 I/O 设备键盘鼠标器内存 CPU I/O 总线机箱插座 I/O 设备打印机扫描仪主板 PCI 插槽 I/O 控制器 ( 扩充卡 ) 板卡插座 I/O 设备 I/O 接口设备侧的通信总线 ( 电缆 ) 显示器麦克风网线 I/O 设备通常都是物理上相互独立的设备, 它们一般通过通信总线通信总线与 I/O 控制器连接 I/O 控制器通过扩展卡或者南桥芯片与 I/O 总线连接 I/O 总线经过北桥芯片与内存经过北桥芯片与内存 CPU 连接

34 回顾 :I/O 总线,I/O 控制器与 I/O 设备的关系寄存器组 R6 y ALU 显卡主存储器 0 CPU 总线接口 CPU( 前端 ) 总线北桥芯片存储器总线 y A I/O 总线南桥芯片 I/O 总线 USB 控制器和接口以太网卡主板扩展槽 PCI 接口磁盘控制器声卡视频卡鼠标器键盘网线光驱 disk

36 小结总线是共享的传输介质和传输控制部件, 用于在部件或设备间传输数据总线可能在芯片内芯片之间芯片之间板卡之间和计算机系统之间连接 I/O 总线是 I/O 控制器与主机之间传输数据的一组公用信号线, 它们在物理上与主板扩展槽中插入的扩展卡 (I/O 控制器 ) 直接连接总线可以采用同步或异步方式进行定时同步总线用时钟信号定时 ; 异步总线用握手信号定时可以结合同步和异步方式进行半同步定时通信可以把一个总线事务分离成两个事务, 在从设备准备数据时释放总线 ( 总线事务分离方式 ) 总线的裁决 : 有集中和分布两类裁决方式分布裁决 : 自举裁决冲突检测集中裁决 : 菊花链独立请求并行判优总线标准 (PCI 总线 ) 总线互连结构单总线结构 ( 早期计算机采用 ) 多总线结构 ( 现代计算机采用 )

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<4D F736F F D20B5DAC8FDCBC4D5C2D7F7D2B5B4F0B0B82E646F63> 第三章 Q3 1 1. 省略了 I/O 操作的复杂逻辑, 易实现, 耗费低 ; 2. 可以利用丰富的内存寻址模式实现灵活的 I/O 操作 Q3 2 假设存储单元 ds1 处寄存器地址为 0x2000, 代码如下 #define ds1 0x2000 while ( *ds1 == 0 ) ; Q3 3 假设设备 (dev1) 中有两个寄存器 ds1 和 dd1,dev1 的地址为 0x1000,ds1